時(shí)序電路和組合電路_第1頁(yè)
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時(shí)序電路和組合電路_第3頁(yè)
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1、、組合邏輯電路設(shè)計(jì)1.程序module encoder(a0,a1,a2,a3,y0,y1);input a0,a1,a2,a3;output y0,y1;wire 3:0 a;reg 1:0 y;assign a = (a3,a2,a1,a0;assign y0 = y0;assign y1 = y1;always (a)begincase (a)4b0001 : y = 2b00;4b0010 : y = 2b01;4b0100 : y = 2b10;4b1000 : y = 2b11;default : y = 2bxx;endcaseendendmodule2.仿真3.仿真波形分析程序

2、為編碼器程序，其中輸入端口 a0, al, a2, a3分別設(shè) 定時(shí)鐘周期為：400ns, 2us, 1.2us, 1.2us。從圖中可以看出： 編碼器沒(méi)有實(shí)現(xiàn)編碼器的功能，主要是對(duì)于不定狀態(tài)的處理。只 有部分滿足了編碼器的設(shè)計(jì)要求，其余的屬于不定狀態(tài)，是不應(yīng) 該出現(xiàn)的。只是由于使用了 case語(yǔ)句。綜合語(yǔ)句不會(huì)自動(dòng)進(jìn)行 優(yōu)先級(jí)判定，而直接并行的綜合。1.程序module counter(nreset,clock,data);input nreset,clock;output 7:0 data;reg 7:0 data;always(posedge clock)beginif(!nreset) data=8h00;else data=data+1;endendmodule2.仿真：3.仿真結(jié)果分析程序?yàn)橥綇?fù)位的加法技術(shù)器，從綜合結(jié)果來(lái)看，

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