電工電子技術(shù)及應(yīng)用 課件 第11、12章 觸發(fā)器及時(shí)序邏輯電路、脈沖信號的產(chǎn)生和整形_第1頁
電工電子技術(shù)及應(yīng)用 課件 第11、12章 觸發(fā)器及時(shí)序邏輯電路、脈沖信號的產(chǎn)生和整形_第2頁
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文檔簡介

11.1雙穩(wěn)態(tài)觸發(fā)器11.2時(shí)序邏輯電路11.1雙穩(wěn)態(tài)觸發(fā)器雙穩(wěn)態(tài)觸發(fā)器是組成時(shí)序邏輯電路的基本單元電路,其輸出端有兩種可能的穩(wěn)定狀態(tài):0態(tài)或1態(tài)。按邏輯功能可分為RS觸發(fā)器、JK觸發(fā)器、D觸發(fā)器和T觸發(fā)器等。11.1.1基本RS觸發(fā)器將兩個(gè)與非門的輸出端、輸入端相互交叉連接,就構(gòu)成了基本RS觸發(fā)器,如圖11.1.1(a)所示,圖11.1.1(b)所示為它的邏輯符號正常工作時(shí),Q和的邏輯狀態(tài)相反。通常用Q端的狀態(tài)來表示觸發(fā)器的狀態(tài)。當(dāng)=0時(shí),稱觸發(fā)器為0態(tài)或復(fù)位狀態(tài),當(dāng)Q=1時(shí),稱觸發(fā)器為1態(tài)或置位狀態(tài)。下面分四種情況來討論觸發(fā)器的邏輯功能。(1)設(shè)觸發(fā)器原狀態(tài)為0態(tài),即根據(jù)觸發(fā)器的邏輯圖,Q=0送到門G2的輸入端,從而保證了;而送到門G1的輸入端,與共同作用,又保證了Q=0。因此觸發(fā)器仍保持了原來的0態(tài)。設(shè)觸發(fā)器原狀態(tài)為1態(tài),即送到門G1的輸入端,從而保證了Q=1;而Q=1送到門G2的輸入端,與共同作用,又保證了因此觸發(fā)器仍保持了原來的1態(tài)。可見,無論原狀態(tài)為0還是為1,當(dāng)均為高電平時(shí),觸發(fā)器具有保持原狀態(tài)的功能,也說明觸發(fā)器具有記憶0或1的功能。正因如此,觸發(fā)器可以用來存放一位二進(jìn)制數(shù)。(2)當(dāng)RD=0時(shí),無論原來Q的狀態(tài)如何,都有所以觸發(fā)器置為0態(tài)。因而端稱為置0端或復(fù)位端。觸發(fā)器置0后,無論變?yōu)椋被蛉詾椋埃灰3指唠娖接|發(fā)器保持0態(tài)。(3)無論的狀態(tài)如何,都有Q=1,所以,觸發(fā)器被置為1態(tài)。一旦觸發(fā)器被置為1態(tài)之后,只要保持不變,即使D由0跳變?yōu)椋?,觸發(fā)器仍保持1態(tài)。端稱為置1端或置位端。(4)無論觸發(fā)器原來狀態(tài)如何,只要同時(shí)為0,都有不符合Q和,為相反的邏輯狀態(tài)的要求。一旦D由低電平同時(shí)跳變?yōu)楦唠娖?,由于門的傳輸延遲時(shí)間不同,使得觸發(fā)器的狀態(tài)不確定。據(jù)此得到基本RS觸發(fā)器的邏輯狀態(tài)表,如表11.1.1所示。在圖11.1.1(b)所示的邏輯符號中,輸入端靠近方框處畫有小圓圈,其含義是負(fù)脈沖置位或復(fù)位,即低電平有效。也有采用正脈沖來置位或復(fù)位的基本RS觸發(fā)器,其邏輯符號中輸入端靠近方框處沒有小圓圈。基本RS觸發(fā)器,雖然具有記憶和置0、置1功能,可以用來表示或存儲一位二進(jìn)制數(shù)碼,但由于基本RS觸發(fā)器的輸出狀態(tài)受輸入狀態(tài)的直接控制,使其應(yīng)用范圍受到限制。因?yàn)橐粋€(gè)數(shù)字系統(tǒng)中往往有多個(gè)觸發(fā)器,有時(shí)要求用統(tǒng)一的信號來指揮各觸發(fā)器同時(shí)動作,這個(gè)指揮信號叫“時(shí)鐘脈沖”。有時(shí)鐘脈沖控制的觸發(fā)器叫可控觸發(fā)器。11.1.2時(shí)鐘控制的RS觸發(fā)器時(shí)鐘控制的RS觸發(fā)器及其邏輯符號如圖11.1.2所示。后面兩個(gè)與非門G1、G2構(gòu)成基本RS觸發(fā)器;前面的兩個(gè)與非門G3、G4組成控制電路,通常稱為控制門,以控制觸發(fā)器翻轉(zhuǎn)的時(shí)刻。C為時(shí)鐘脈沖CP輸入端,為直接復(fù)位端或直接置0端,為直接置位端或置1端,它們不受時(shí)鐘脈沖CP的控制,端線處的小圓圈表明低電平有效,因此不用時(shí)應(yīng)使其為1態(tài)。由圖可見,當(dāng)CP端處于低電平,即CP=0時(shí),將G3、G4封鎖。這時(shí)不論R和S端輸入何種信號,G3、G4輸出均為1,基本RS觸發(fā)器的狀態(tài)不變。當(dāng)CP端處于高電平,即CP=1時(shí),G3、G4打開,輸入信號通過G3、G4的輸出去觸發(fā)基本RS觸發(fā)器。下面分析CP=1時(shí)觸發(fā)器的工作情況:R=0,S=1,G3輸出低電平0,從而使G1輸出高電平1,即Q=1;R=1,S=0,這時(shí)將使觸發(fā)器置0;當(dāng)R=S=0時(shí),G3、G4的輸出全都為1,觸發(fā)器的狀態(tài)不變。但當(dāng)R=S=1,G3、G4的輸出均為0,違背了基本RS觸發(fā)器的輸入條件,應(yīng)禁止。因此,對時(shí)鐘控制的RS觸發(fā)器來說,R端和S端不允許同時(shí)為1。一般用Qn表示時(shí)鐘脈沖到來之前觸發(fā)器的輸出狀態(tài),稱為初態(tài),Qn+1表示時(shí)鐘脈沖到來之后觸發(fā)器的輸出狀態(tài),稱為次態(tài)。根據(jù)上述分析可列出時(shí)鐘控制的RS觸發(fā)器邏輯狀態(tài)表,如表11.1.2所示。時(shí)鐘控制的RS觸發(fā)器在CP=0期間,無論R和S如何變化,觸發(fā)器輸出端狀態(tài)都不變。而在CP=1期間,若R或S發(fā)生多次變化則會引起觸發(fā)器狀態(tài)的多次變化。而邊沿觸發(fā)器的狀態(tài)變化只發(fā)生在時(shí)鐘脈沖的上升沿或下降沿時(shí)刻。11.1.3JK觸發(fā)器JK觸發(fā)器是一種功能比較完善,應(yīng)用極為廣泛的觸發(fā)器。不同的內(nèi)部電路結(jié)構(gòu)具有不同的觸發(fā)特性,可以用邏輯符號加以區(qū)分。圖11.1.3所示為CP下降沿觸發(fā)的JK觸發(fā)器的邏輯符號。它有一個(gè)直接置位端一個(gè)直接復(fù)位端兩個(gè)輸入端J和K,C端為時(shí)鐘脈沖輸入端,靠邊框的小圓圈代表下降沿觸發(fā),即CP=1時(shí),觸發(fā)器輸出狀態(tài)不變,CP由1跳變?yōu)椋皶r(shí),觸發(fā)器輸出狀態(tài)依據(jù)J和K端的狀態(tài)而定。若C端處無小圓圈,則表明在CP的上升沿觸發(fā)。表11.1.3所示為JK觸發(fā)器的邏輯狀態(tài)表。

由邏輯狀態(tài)表可知,JK觸發(fā)器的邏輯功能為(1)當(dāng)J=0,K=0時(shí),時(shí)鐘脈沖觸發(fā)后,觸發(fā)器的狀態(tài)不變,即如果現(xiàn)態(tài)為1,時(shí)鐘脈沖觸發(fā)后,觸發(fā)器狀態(tài)仍為1態(tài)。若現(xiàn)態(tài)為0,時(shí)鐘脈沖觸發(fā)后,觸發(fā)器狀態(tài)仍保持0態(tài)。也即J和K都為0時(shí),觸發(fā)器具有保持原狀態(tài)的功能。(2)當(dāng)J=0,K=1時(shí),無論觸發(fā)器原來是何種狀態(tài),時(shí)鐘脈沖觸發(fā)后,輸出均為0態(tài);當(dāng)J=1,K=0時(shí),時(shí)鐘脈沖觸發(fā)后,輸出均為1態(tài)。即J、K相異時(shí),時(shí)鐘脈沖觸發(fā)后,輸出端同J端狀態(tài)。(3)當(dāng)J=1,K=1時(shí),時(shí)鐘脈沖觸發(fā)后,觸發(fā)器狀態(tài)翻轉(zhuǎn),即若原來為1態(tài),時(shí)鐘脈沖觸發(fā)后,觸發(fā)器狀態(tài)變?yōu)椋埃蝗粼瓉頌椋皯B(tài),時(shí)鐘脈沖觸發(fā)后,觸發(fā)器狀態(tài)變?yōu)椋睉B(tài)。也即來一個(gè)觸發(fā)脈沖,觸發(fā)器狀態(tài)翻轉(zhuǎn)一次,說明它具有計(jì)數(shù)功能。此時(shí),觸發(fā)器從邏輯功能上可稱為T′觸發(fā)器,T′觸發(fā)器在每來一個(gè)脈沖時(shí),翻轉(zhuǎn)一次。J=K時(shí)的觸發(fā)器從邏輯功能上可稱為T觸發(fā)器。當(dāng)T=0時(shí),每來一個(gè)脈沖時(shí),觸發(fā)器保持原來狀態(tài);當(dāng)T=1時(shí),每來一個(gè)脈沖時(shí),觸發(fā)器翻轉(zhuǎn)一次。為了擴(kuò)大JK觸發(fā)器的使用范圍,常常做成多輸入結(jié)構(gòu),各同名輸入端為與邏輯關(guān)系。11.1.4D觸發(fā)器D觸發(fā)器也是一種應(yīng)用廣泛的觸發(fā)器。圖11.1.4所示為D觸發(fā)器的邏輯符號。D為輸入端,為直接置位端,為直接復(fù)位端,在CP的上升沿觸發(fā)(若C端有小圓圈,則表示下降沿觸發(fā))。表11.1.4所示為其邏輯狀態(tài)表。11.2時(shí)序邏輯電路電路在某一時(shí)刻的穩(wěn)定輸出,不僅與當(dāng)前的輸入有關(guān),還與電路過去的狀態(tài)有關(guān),把這種電路稱為時(shí)序邏輯電路。在結(jié)構(gòu)上,時(shí)序邏輯電路除包含組合邏輯電路部分外,還包含存儲電路(鎖存器或觸發(fā)器)。計(jì)數(shù)器就是一種典型的時(shí)序邏輯電路,是用來累計(jì)輸入脈沖數(shù)目的邏輯部件。在數(shù)字邏輯系統(tǒng)中,需要對輸入脈沖的個(gè)數(shù)進(jìn)行計(jì)數(shù)或?qū)γ}沖信號進(jìn)行分頻、定時(shí),以實(shí)現(xiàn)數(shù)字測量、運(yùn)算和控制。因此計(jì)數(shù)器是數(shù)字系統(tǒng)中一種基本的數(shù)字部件。計(jì)數(shù)器的種類很多,按計(jì)數(shù)脈沖的作用方式可分為異步計(jì)數(shù)器和同步計(jì)數(shù)器。按計(jì)數(shù)的功能可分為加法計(jì)數(shù)器、減法計(jì)數(shù)據(jù)和可逆計(jì)數(shù)器。按進(jìn)位制可分為二進(jìn)制、十進(jìn)制和任意進(jìn)制計(jì)數(shù)器。二進(jìn)制計(jì)數(shù)器是指在輸入脈沖的作用下,計(jì)數(shù)器按自然態(tài)序循環(huán)經(jīng)歷2n個(gè)獨(dú)立狀態(tài)(n為計(jì)數(shù)器中觸發(fā)器的個(gè)數(shù)),因此又可稱為模2n進(jìn)制計(jì)數(shù)器,即模數(shù):M=2n。計(jì)數(shù)器可以由JK或D觸發(fā)器構(gòu)成,目前廣泛應(yīng)用的是各種類型的集成計(jì)數(shù)器。11.2.1計(jì)數(shù)器計(jì)數(shù)原理及基本電路

圖11.2.1所示為由D觸發(fā)器組成的異步計(jì)數(shù)器。它的結(jié)構(gòu)特點(diǎn)是:各級觸發(fā)器的時(shí)鐘來源不同,除第一級時(shí)鐘脈沖輸入端由外加時(shí)鐘脈沖控制外,其余各級時(shí)鐘脈沖輸入端與其前一級的輸出端相連。各觸發(fā)器動作時(shí)刻不一致,所以稱為異步計(jì)數(shù)器。每來一個(gè)時(shí)鐘脈沖,D觸發(fā)器(邏輯功能等同于T觸發(fā)器)狀態(tài)翻轉(zhuǎn)一次。下面分析它的工作過程。

由于外加時(shí)鐘脈沖接第一級的時(shí)鐘脈沖輸入端,因此每來一個(gè)時(shí)鐘脈沖的下降沿,觸發(fā)器Q0的狀態(tài)翻轉(zhuǎn)。當(dāng)Q0由1變0時(shí),Q1才翻轉(zhuǎn),其他情況下Q1均不變。同理,只有當(dāng)Q1從1變?yōu)椋皶r(shí),Q2狀態(tài)才翻轉(zhuǎn)。假設(shè)計(jì)數(shù)器初始狀態(tài)為Q2Q1Q0=000,第一個(gè)時(shí)鐘脈沖的下降沿到達(dá)后,電路由000翻轉(zhuǎn)為001。當(dāng)?shù)诙€(gè)CP下降沿到達(dá)后,計(jì)數(shù)器由001翻轉(zhuǎn)為010,……,依此類推,經(jīng)過8個(gè)計(jì)數(shù)脈沖后,計(jì)數(shù)器狀態(tài)又恢復(fù)為000,即完成了一個(gè)計(jì)數(shù)循環(huán),得其狀態(tài)表如表11.2.1所示。由表可見,該電路是一個(gè)異步三位二進(jìn)制加法計(jì)數(shù)器。由以上分析可得出如下結(jié)論;(1)三級觸發(fā)器組成的計(jì)數(shù)器,經(jīng)8個(gè)計(jì)數(shù)脈沖,計(jì)數(shù)器狀態(tài)循環(huán)一次,所以又稱為八進(jìn)制計(jì)數(shù)器(或稱模8計(jì)數(shù)器)。因而,n個(gè)觸發(fā)器串聯(lián),可組成模數(shù)為2n的計(jì)數(shù)器。(2)每來一個(gè)CP脈沖,計(jì)數(shù)器的狀態(tài)加1,所以叫加法計(jì)數(shù)。若將三個(gè)觸發(fā)器按圖11.2.2所示的方法連接,則構(gòu)成異步減法計(jì)數(shù)器。其工作過程請讀者自行分析。

由上述分析可知,要構(gòu)成異步二進(jìn)制加法或減法計(jì)數(shù)器,只需用具有T功能的觸發(fā)器構(gòu)成計(jì)數(shù)器的每一位,最低位時(shí)鐘脈沖輸入端接用來計(jì)數(shù)的時(shí)鐘脈沖源CP,其他位觸發(fā)器的時(shí)鐘輸入端則接到與它相鄰低位的Q端或

端,是接Q端還是

端,應(yīng)視觸發(fā)器的觸發(fā)方式和計(jì)數(shù)功能而定。如果構(gòu)成加法計(jì)數(shù)器,且觸發(fā)器為下跳沿觸發(fā),則相鄰低位作由1到0變化時(shí),其Q端正好作比它高一位觸發(fā)器所需的由1到0跳變的計(jì)數(shù)脈沖輸入,因此該位時(shí)鐘脈沖輸入端應(yīng)接相Q端;如果構(gòu)成計(jì)數(shù)器的觸發(fā)器為上跳沿觸發(fā),則剛才的加法計(jì)數(shù)器變?yōu)闇p法計(jì)數(shù)器,減法計(jì)數(shù)器變?yōu)榧臃ㄓ?jì)數(shù)器,具體工作過程請讀者自行分析。

異步計(jì)數(shù)器的優(yōu)點(diǎn)是結(jié)構(gòu)簡單,缺點(diǎn)是各觸發(fā)器信號逐級傳遞,需要一定的傳輸延遲時(shí)間,因而計(jì)數(shù)速度受到限制,為此可采用同步二進(jìn)制計(jì)數(shù)器。為了提高計(jì)數(shù)器的工作速度,可將計(jì)數(shù)脈沖同時(shí)加到計(jì)數(shù)器中各個(gè)觸發(fā)器的時(shí)鐘脈沖輸入端,使各觸發(fā)器的狀態(tài)變換與計(jì)數(shù)脈沖同步,再將各輸入端適當(dāng)連接,n個(gè)觸發(fā)器就可組成模數(shù)為2n的同步加減計(jì)數(shù)器或十進(jìn)制計(jì)數(shù)器。

十進(jìn)制計(jì)數(shù)器是在二進(jìn)制計(jì)數(shù)器的基礎(chǔ)上得出的,用四位二進(jìn)制數(shù)來代表十進(jìn)制數(shù)的每一位,所以也稱為二—十進(jìn)制計(jì)數(shù)器,使用最多的是8421BCD碼十進(jìn)制計(jì)數(shù)器。采用8421BCD碼,要求計(jì)數(shù)器從0000開始計(jì)數(shù),到第9個(gè)計(jì)數(shù)脈沖作用后變?yōu)椋保埃埃?,輸入第10個(gè)計(jì)數(shù)脈沖后,又返回到初始狀態(tài)0000,即計(jì)數(shù)器狀態(tài)經(jīng)過10個(gè)脈沖循環(huán)一次,實(shí)現(xiàn)“逢十進(jìn)一”。11.2.2常用中規(guī)模集成計(jì)數(shù)器中規(guī)模集成計(jì)數(shù)器種類較多,使用也十分廣泛,它可分為同步計(jì)數(shù)器和異步計(jì)數(shù)器兩大類,通常的MSI計(jì)數(shù)器為BCD碼十進(jìn)制計(jì)數(shù)器或四位二進(jìn)制計(jì)數(shù)器,這些計(jì)數(shù)器的功能較完善,還可自擴(kuò)展,如常用的集成同步四位二進(jìn)制加法計(jì)數(shù)器有74LS161、74LS163、74LS191、74LS193;同步十進(jìn)制加法計(jì)數(shù)器有74160、74LS190;異步四位二進(jìn)制加法計(jì)數(shù)器有74LS293;異步二—五—十進(jìn)制計(jì)數(shù)器有74LS290等。

74LS290的引線端子圖如圖11.2.3所示,74LS161是同步的可預(yù)置四位二進(jìn)制加法計(jì)數(shù)器,圖11.2.4所示為它的引線端子圖。1.異步集成計(jì)數(shù)器74LS290功能74LS290是異步二—五—十進(jìn)制計(jì)數(shù)器,R0(1)和R0(2)是清零輸入端,高電平有效;S9(1)和S9(2)是置“9”輸入端,其高電平使電路輸出狀態(tài)為1001。清零和置“9”信號只要有效就可實(shí)現(xiàn)相應(yīng)功能,不必等待時(shí)鐘脈沖,因而叫做異步清零和置“9”。CP0和CP1是它的兩個(gè)時(shí)鐘脈沖輸入端。引腳2和引腳6是空腳。只輸入計(jì)數(shù)脈沖CP0時(shí),由Q0輸出,為二進(jìn)制計(jì)數(shù)器,計(jì)數(shù)狀態(tài)為0和1;只輸入計(jì)數(shù)脈沖CP1時(shí),由Q3Q2Q1輸出,計(jì)數(shù)狀態(tài)從000開始加計(jì)數(shù)到100,為五進(jìn)制計(jì)數(shù)器;將Q0端與CP1連接,輸入計(jì)數(shù)脈沖CP0時(shí),計(jì)數(shù)狀態(tài)從0000開始加計(jì)數(shù)到1001,為十進(jìn)制計(jì)數(shù)器。2.同步集成計(jì)數(shù)器74LS161的功能Q3、Q2、Q1、Q0為計(jì)數(shù)器輸出端,RCO為進(jìn)位輸出端;EP、ET為控制(使能)輸入端,為清零控制端,為預(yù)置控制端,A0~A3依次為數(shù)據(jù)輸入端的低位至高位。(1)“異步清零”。當(dāng)時(shí),使各觸發(fā)器清成零狀態(tài),由于這種清零方式不需與時(shí)鐘脈沖CP同步就可直接完成,稱為“異步清零”。(2)“同步預(yù)置”。當(dāng)且在CP上升沿時(shí)可將相應(yīng)的數(shù)據(jù)置入各觸發(fā)器,由于將預(yù)置A0~A3數(shù)據(jù)置入相應(yīng)觸發(fā)器Q3、Q2、Q1、Q0需有CP時(shí)鐘脈沖相配合,因此稱為“同步預(yù)置”。(3)保持。當(dāng)且控制輸入端EP、ET中有一個(gè)為“0”電平,此時(shí)無論有無計(jì)數(shù)脈沖輸入,各觸發(fā)器的輸出狀態(tài)均保持不變。(4)計(jì)數(shù)。當(dāng)計(jì)數(shù)器進(jìn)行四位二進(jìn)制加法計(jì)數(shù)。當(dāng)同步計(jì)數(shù)器累加到“1111”時(shí),溢出進(jìn)位輸出端RCO送出高電平。11.2.3任意進(jìn)制計(jì)數(shù)器的構(gòu)成目前常用的計(jì)數(shù)器主要是二進(jìn)制和十進(jìn)制,當(dāng)需要任意進(jìn)制的計(jì)數(shù)器時(shí),只能將現(xiàn)有的計(jì)數(shù)器改接而得。下面介紹兩種改接方法。以N表示已有中規(guī)模集成計(jì)數(shù)器的進(jìn)制,以M表示待實(shí)現(xiàn)計(jì)數(shù)器的進(jìn)制。若M<N,只需一片集成計(jì)數(shù)器,如果M>N,則需多片集成計(jì)數(shù)器實(shí)現(xiàn)。1.M<N的情況在N進(jìn)制計(jì)數(shù)器的順序計(jì)數(shù)過程中,設(shè)法跳過N-M個(gè)狀態(tài),就得到了M進(jìn)制計(jì)數(shù)器。實(shí)現(xiàn)狀態(tài)跳躍的方式有置零法和置數(shù)法兩種。

置零法適用于有置零輸入端的計(jì)數(shù)器,圖11.2.5(a)所示為置零法原理示意圖。對于有異步置零輸入端的計(jì)數(shù)器,其工作原理為:設(shè)原有計(jì)數(shù)器為N進(jìn)制,當(dāng)它從全0狀態(tài)S0開始計(jì)數(shù)并收到M個(gè)計(jì)數(shù)脈沖以后,電路進(jìn)入SM狀態(tài)。若將SM狀態(tài)譯碼產(chǎn)生一個(gè)置零信號加到計(jì)數(shù)器的異步置零輸入端,則計(jì)數(shù)器將立刻返回S0狀態(tài),以跳過N~M個(gè)狀態(tài)而得到M進(jìn)制計(jì)數(shù)器。由于電路一進(jìn)入SM狀態(tài)后立即又被置成S0狀態(tài),SM狀態(tài)僅在極短的瞬間出現(xiàn),穩(wěn)定狀態(tài)的循環(huán)中不應(yīng)該包含SM狀態(tài)。而對于有同步置零輸入端的計(jì)數(shù)器,由于置零輸入端變?yōu)橛行щ娖胶笥?jì)數(shù)器并不會立刻被置零,必須等下一個(gè)時(shí)鐘信號到達(dá)后,才能將計(jì)數(shù)器置零,因而應(yīng)由SM-1狀態(tài)譯出同步置零信號。且SM-1狀態(tài)包含在穩(wěn)定狀態(tài)的循環(huán)當(dāng)中。置數(shù)法適用于有預(yù)置數(shù)功能的計(jì)數(shù)器,圖11.2.5(b)所示為置數(shù)法原理示意圖。置數(shù)法是通過給計(jì)數(shù)器重復(fù)置入某個(gè)數(shù)值來跳越N-M個(gè)狀態(tài),從而獲得M進(jìn)制計(jì)數(shù)器。置數(shù)操作可以在電路的任何一個(gè)狀態(tài)下進(jìn)行。對于異步式預(yù)置數(shù)的計(jì)數(shù)器,只要的信號一出現(xiàn),立即會將數(shù)據(jù)置入計(jì)數(shù)器中,而不受CP信號的控制,因此的信號應(yīng)從Si+1狀態(tài)譯出。由于Si+1狀態(tài)只在極短瞬間出現(xiàn),穩(wěn)定的狀態(tài)循環(huán)中不應(yīng)該包含這個(gè)狀態(tài)。而對于同步式預(yù)置數(shù)的計(jì)數(shù)器,的信號應(yīng)從Si狀態(tài)譯出,待下一個(gè)CP信號到來時(shí),才將要置入的數(shù)據(jù)置入計(jì)數(shù)器。穩(wěn)定的狀態(tài)循環(huán)中包含Si。12.1概述12.2集成555定時(shí)器及其應(yīng)用12.1概述在數(shù)字電路或系統(tǒng)中,時(shí)鐘脈沖信號用來控制和協(xié)調(diào)整個(gè)系統(tǒng)的工作。獲得這種矩形脈沖的方法有兩種:一種是利用多諧振蕩器直接產(chǎn)生;另一種是通過整形電路變換而成。整形電路又分為兩類:施密特觸發(fā)器和單穩(wěn)態(tài)觸發(fā)器,它們可以使輸入波形的邊沿變陡峭,形成規(guī)定的矩形脈沖。為了定量地描述矩形脈沖的特性,經(jīng)常使用如圖12.1.1所示參數(shù)來表述矩形脈沖的性能指標(biāo),即:脈沖周期T———周期性重復(fù)的脈沖序列中,兩個(gè)相鄰脈沖間的時(shí)間間隔。頻率f=1/T———單位時(shí)間內(nèi)脈沖重復(fù)的次數(shù)。脈沖幅度Um———脈沖電壓最大變化的幅值。脈沖寬度tw———從脈沖前沿0.5Um始,到脈沖后沿0.5Um止的一段時(shí)間。上升時(shí)間tr———脈沖從0.1Um上升到0.9Um所需的時(shí)間。下降時(shí)間tf———脈沖從0.9Um下降到0.1Um所需的時(shí)間。上述幾個(gè)指標(biāo)反映了一個(gè)矩形脈沖的基本特性。12.2集成555定時(shí)器及其應(yīng)用12.2.1集成555定時(shí)器的電路結(jié)構(gòu)與功能

555定時(shí)器是一個(gè)中規(guī)模數(shù)/模混合集成電路,應(yīng)用它可以很方便地構(gòu)成施密特觸發(fā)器、單穩(wěn)態(tài)觸發(fā)器以及多諧振蕩器。555定時(shí)器產(chǎn)品型號繁多,但所有雙極型產(chǎn)品型號的最后3位數(shù)碼都是555,所有CMOS型產(chǎn)品型號的最后4位數(shù)碼都是7555。而且,它們的功能和外部引腳的排列完全相同。為了提高集成度,隨后又出現(xiàn)了雙定時(shí)器產(chǎn)品556(雙極型)和7556(CMOS型)。

圖12.2.1所示為國產(chǎn)雙極型集成定時(shí)器CB555的電路結(jié)構(gòu)和外引線排列圖。它由電壓比較器C1和C2、電阻分壓器、基本RS鎖存器、集電極開路的放電三極管VD和輸出緩沖級幾個(gè)基本單元組成。其中電壓比較器C1和C2的參考電壓UR1和UR2由電源UCC經(jīng)三個(gè)5kΩ電阻分壓給出。

從圖12.2.1(b)的外引線排列圖可知,定時(shí)器具有8個(gè)引出端:①接地端;②觸發(fā)端,即比較器C2的輸入端;③輸出端;④置零輸入端,只要在該端加上低電平,輸出立即被置成低電平,而不受其他輸入端狀態(tài)的影響,正常工作時(shí)必須使其處于高電平;⑤控制電壓輸入端,當(dāng)該端懸空時(shí),如果從該端外接電壓,則UR1=UCO,UR2

⑥閾值端,即比較器C1的輸入端;⑦泄放端;⑧正電源端。

由圖12.2.1(a)可知,當(dāng)uI1>UR1、uI2>UR2時(shí),比較器C1的輸出uC1=0(即低電平)、比較器C2的輸出uC2=1(即高電平),RS鎖存器被置成0,三極管VD導(dǎo)通,同時(shí)uO為低電平。

當(dāng)uI1<UR1、uI2>UR2時(shí),比較器C1的輸出uC1=1,比較器C2的輸出uC2=1,RS鎖存器的狀態(tài)保持不變,因而三極管VD和輸出uO的狀態(tài)也維持不變。

當(dāng)uI1<UR1、uI2<UR2時(shí),比較器C1的輸出uC1=1,比較器C2的輸出uC2=0,故RS鎖存器被置成1,三極管VD截止,同時(shí)uO為高電平。

當(dāng)uI1>UR1、uI2<UR2時(shí),比較器C1的輸出uC1=0,比較器C2的輸出uC2=0,故RS鎖存器處于Q=

=1的狀態(tài),三極管VD截止,同時(shí)uO為高電平。這樣就得到了表12.2.1所示的CB555的功能表。555定時(shí)器的輸出緩沖級是為了提高電路的帶負(fù)載能力而設(shè)置的。如果將VD的集電極輸出端uOD經(jīng)過電阻接到電源上,那么只要該電阻的阻值足夠大,uOD將與uO具有相同的高、低電平。這一特點(diǎn)將在后續(xù)555定時(shí)器構(gòu)成多諧振蕩器中被利用。555定時(shí)器能在很寬的電源電壓范圍內(nèi)工作,并可承受較大的負(fù)載電流。雙極型555定時(shí)器的電源電壓范圍為5~16V,最大的負(fù)載電流達(dá)200mA。CMOS型555定時(shí)器的電源電壓范圍為3~18V,但最大的負(fù)載電流在4mA以下。555定時(shí)器在儀器、儀表和自動化控制裝置中應(yīng)用很廣。它可以組成定時(shí)、延時(shí)和脈沖調(diào)制等各種電路。12.2.2555定時(shí)器構(gòu)成施密特觸發(fā)器將555定時(shí)器的高電平觸發(fā)端和低電平觸發(fā)端連接起來,作為觸發(fā)信號的輸入端,就可構(gòu)成施密特觸發(fā)器。電路如圖12.2.2所示。

由于uI1和uI2是555定時(shí)器中電壓比較器的輸入端,而兩個(gè)比較器的參考電壓是不同的,當(dāng)將uI1和uI2連接在一起時(shí),RS鎖存器的置0、置1信號必然發(fā)生在輸入信號uI的不同電平。因此,輸出電壓uO由高電平變?yōu)榈碗娖交蛴傻碗娖阶優(yōu)楦唠娖剿鶎?yīng)的uI值也不相同。這樣就形成了施密特觸發(fā)特性。為提高比較器參考電壓UR1和UR2的穩(wěn)定性,通常在UCO端接一個(gè)0.01μF左右的濾波電容。下面討論電路的工作原理,首先分析uI從0逐漸升高的過程:圖12.2.3為圖12.2.2電路的電壓傳輸特性。如果參考電壓由外接電壓UCO供給,則不難看出這時(shí)通過改變UCO值可以調(diào)節(jié)回差電壓的大小。UCO越大,ΔUT也越大,電路的抗干擾能力就越強(qiáng)。12.2.3555定時(shí)器構(gòu)成單穩(wěn)態(tài)觸發(fā)器若以555定時(shí)器的uI2端作為觸發(fā)信號的輸入端,并將由VD和R組成的反相器輸出電壓uOD接至uI1端,同時(shí)在uI1對地接入電容C,就構(gòu)成如圖12.2.4所示的單穩(wěn)態(tài)觸發(fā)器。R、C為外接定時(shí)元件。在剛接通電源時(shí),如果沒有觸發(fā)信號,uI處于高電平,那么穩(wěn)定的電路狀態(tài)一定是uC1=uC2=1,Q=0,uO=0。假定接通電源后RS鎖存器停留在Q=0的狀態(tài),則VD導(dǎo)通使uC≈0,電容C上無電荷。故uC1=uC2=1,RS鎖存器保持Q=0的狀態(tài),uO=0將穩(wěn)定地維持不變。如果接通電源后RS鎖存器停留在Q=1的狀態(tài),這時(shí)VD一定截止,電源UCC便經(jīng)電阻R向電容C充電。當(dāng)充至uC1由1變?yōu)椋?,使RS鎖存器置0。同時(shí),VD導(dǎo)通,電容C經(jīng)VD迅速放電,使uC≈0。此后由于uC1=uC2=1,RS鎖存器保持0狀態(tài)不變,輸出也相應(yīng)穩(wěn)定在uO=0的狀態(tài)。因此,通電后穩(wěn)態(tài)時(shí)電路應(yīng)自動地停留在uO=0的穩(wěn)態(tài)上。當(dāng)觸發(fā)脈沖的下降沿到來時(shí),只要負(fù)脈沖的低電平值小于就使uC2=0(此時(shí)uC1=1),RS鎖存器被置成1,uO跳變?yōu)楦唠娖?,電路進(jìn)入暫穩(wěn)態(tài)。與此同時(shí)VD截止,UCC經(jīng)電阻R開始向電容C充電。當(dāng)充至?xí)r,uC1變?yōu)椋啊H绻藭r(shí)輸入端的觸發(fā)脈沖已經(jīng)消失,即uI回到高電平,uC2=1,則RS鎖存器被置成0,于是輸出返回uO=0的狀態(tài)。同時(shí)VD又變?yōu)閷?dǎo)通狀態(tài),電容C經(jīng)VD迅速放電,直至uC≈0,電路恢復(fù)穩(wěn)態(tài)。圖12.2.5所示為在外加觸發(fā)信號作用下uC和uO相應(yīng)的波形圖。輸出脈沖的寬度tW等于暫穩(wěn)態(tài)的持續(xù)時(shí)間,而暫穩(wěn)態(tài)的持續(xù)時(shí)間取決于外接電阻R和電容C的大小。由圖12.2.5可知,tW等于電容電壓在充電過程中從0上升到C所需要的時(shí)間,因此得到通常R的取值范圍在幾百歐姆到幾兆歐姆之間,電容C的取值范圍在幾百皮法到幾百微法之間,則tW的范圍為幾微秒到幾分鐘。但必須注意,隨著tW的寬度增加,它的精度和穩(wěn)定度也將下降。應(yīng)當(dāng)說明的是,這種單穩(wěn)態(tài)觸發(fā)器電路對輸入脈沖寬度是有一定要求的,即觸發(fā)脈沖寬度要小于暫穩(wěn)態(tài)持續(xù)時(shí)間tW。在實(shí)際應(yīng)用中如遇到uI的脈沖寬度大于tW時(shí),應(yīng)先經(jīng)微分電路將uI轉(zhuǎn)變成尖脈沖之后再加到電路的輸入端,如圖12.2.6所示。

單穩(wěn)態(tài)觸發(fā)器只有一個(gè)穩(wěn)定狀態(tài)。其工作特性可歸結(jié)為如下三點(diǎn):(1)單穩(wěn)態(tài)觸發(fā)器有穩(wěn)態(tài)和暫穩(wěn)態(tài)兩個(gè)不同的工作狀態(tài)。(2)在外界觸發(fā)信號作用下,能從穩(wěn)態(tài)翻轉(zhuǎn)到暫穩(wěn)態(tài),在暫穩(wěn)態(tài)維持一段時(shí)間tw

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