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降壓原理解釋一：FET為ON時的電路圖在FET為ON的時間里，L積蓄電流能的同時為輸出供電。虛線表示的電流路徑雖是微小的漏電流，但會使輕負(fù)載的效率變差。FET為OFF時的電路圖在FET為OFF時，L要保持OFF前的電流值，使SBD為ON。此時，由于線圈的左端被強制性地降到0V以下，VOUT的電壓下降，即降壓電路原理。由此，F(xiàn)ET的ON時間長L里積蓄的電流能越大，越能獲得大功率電源，降壓的幅度越小。降壓時，由于FET為ON時也要給輸出供電，所以不需要限制占空比的最大值。解釋二：降壓式 DC/DC 變 換器基本工作原理電路如圖所示。 VT1 為開關(guān)管，當(dāng) VT1 導(dǎo)通時，輸入電壓 Vi 通過電感 L1向負(fù)載RL供電，與此同時也向電容 C2 充電。在這個過程中，電容 C2及電感L1中儲存能量。當(dāng)VT1 截止時，由儲存在電感 L1中的能量繼續(xù)向 RL供電，當(dāng)輸出電壓要下降時，電容C2中的能量也向RL放電，維持輸出電壓不變。二極管VD1為續(xù)流二極管，以便構(gòu)成電路回路。輸出的電壓Vo經(jīng)R1和 R2組成的分壓器分壓，把輸出電壓的信號反饋至控制電路，由控制電路來控制開關(guān)管的導(dǎo)通及截止時間，使輸出電壓保持不變?？刂齐娐泛蚔TI，VD1是一體的都是RT8024升壓原理解釋一：FET為ON時的電路圖在FET為ON的時間里在L積蓄電流能。虛線表示的電流路徑雖是微小的漏電流，但會使輕負(fù)載的效率變差。FET為OFF時的電路圖在FET為OFF時， L要保持OFF前的電流值，相當(dāng)于在輸入回路增加了一個“電源”。由于線圈的左端被強制性固定于VIN，因此輸出VOUT的電壓要大于VIN，即升壓電路原理。由此，F(xiàn)ET的ON時間越長（FET的觸發(fā)占空比D越大），L里積蓄的電流能越大，越能獲得電源功率，于是升壓就越高。但是，F(xiàn)ET的ON時間太長的話，給輸出側(cè)供電的時間就極為短暫，F(xiàn)ET為ON時的損失也就

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