組合邏輯電路的設(shè)計(jì)與測(cè)試實(shí)驗(yàn)報(bào)告_第1頁(yè)
組合邏輯電路的設(shè)計(jì)與測(cè)試實(shí)驗(yàn)報(bào)告_第2頁(yè)
組合邏輯電路的設(shè)計(jì)與測(cè)試實(shí)驗(yàn)報(bào)告_第3頁(yè)
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洛陽(yáng)理工學(xué)院實(shí)驗(yàn)報(bào)告系別計(jì)算機(jī)與信息工程系班級(jí)學(xué)號(hào)姓名課程名稱數(shù)字邏輯實(shí)驗(yàn)日期 實(shí)驗(yàn)名稱實(shí)驗(yàn)項(xiàng)目二 組合邏輯電路的設(shè)計(jì)與測(cè)試成績(jī)實(shí)驗(yàn)?zāi)康模赫莆战M合邏輯電路的設(shè)計(jì)與測(cè)試方法實(shí)驗(yàn)條件：1.+5V直流電源 2.邏輯電平開(kāi)關(guān) 3.邏輯電平顯示器 4.直流數(shù)字電壓表5.CC4012X3(74LS20)實(shí)驗(yàn)內(nèi)容：1. 實(shí)驗(yàn)任務(wù):(1) 在實(shí)驗(yàn)裝置適當(dāng)?shù)奈恢眠x定上三個(gè)14P插座，按照集成塊定位標(biāo)記插好集成塊74LS20，按下圖接線，驗(yàn)證邏輯功能。（2）設(shè)計(jì)一個(gè)全加器，集成芯片自行確定。2. 實(shí)驗(yàn)步驟（1） 分析得出實(shí)驗(yàn)組合電路圖（2） 根據(jù)線路圖接線，實(shí)圖如下所示: (3)測(cè)試連通性，驗(yàn)證結(jié)果實(shí)驗(yàn)總結(jié)：在連接線路之前，需要將邏輯電路圖分析清楚，然后再接線，接線時(shí)，要注意檢查每條線是否完好，以及指示燈的好壞。

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