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文檔簡介

1、實(shí) 驗(yàn) 報(bào) 告課程名稱：fpga設(shè)計(jì)及應(yīng)用實(shí)驗(yàn)項(xiàng)目：設(shè)計(jì)二選一多路選擇器實(shí)驗(yàn)時(shí)間：2014年4月1號(hào)實(shí)驗(yàn)班級(jí)：12電子信息工程x班指導(dǎo)教師：李xx 二四年 四月 十三日廣東技術(shù)師范學(xué)院實(shí)驗(yàn)報(bào)告學(xué)院：電子與信息學(xué)院專業(yè)：電子信息工程班級(jí)：12電本x班成績：姓名：學(xué)號(hào)：20120442430組別：組員：實(shí)驗(yàn)地點(diǎn)：工業(yè)中心實(shí)驗(yàn)日期：4.01指導(dǎo)教師簽名：預(yù)習(xí)情況操作情況考勤情況數(shù)據(jù)處理情況實(shí)驗(yàn) 七 項(xiàng)目名稱： 設(shè)計(jì)二選一多路選擇器 一、 實(shí)驗(yàn)?zāi)康暮鸵笤O(shè)計(jì)二選一多路選擇器：通過簡單完整而典型的vhdl設(shè)計(jì)，初步了解vhdl表達(dá)和設(shè)計(jì)電路的方法并對(duì)由此而引出的語言對(duì)象和語言規(guī)則加以有針對(duì)性的說明。二、

2、 實(shí)驗(yàn)步驟1、創(chuàng)建新的工程，步驟如下：2、創(chuàng)建新的文件3、用vhdl語言根據(jù)實(shí)驗(yàn)要求的功能編寫代碼4、編譯5、 引腳分配6、 鏈接數(shù)據(jù)線，下載程序三、 實(shí)驗(yàn)源代碼 library ieee;use ieee.std_logic_1164.all;entity mux21a isport(a,b:in bit; s:in bit; y:out bit);end; architecture one of mux21a isbeginy=a when s=0 else b;end architecture one;四、 實(shí)驗(yàn)結(jié)果與總結(jié)1、通過本節(jié)上機(jī)實(shí)驗(yàn)，加深了解了vhdl語言現(xiàn)象和語句規(guī)律。2、程序很簡單，按照示例程序輸入沒有什么錯(cuò)誤。主要是通過這個(gè)簡單程序了解了仿真的全過程。3、實(shí)驗(yàn)后基

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