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文檔簡介

1、傳統(tǒng)數(shù)字系統(tǒng)設(shè)計流程設(shè)計目標人工給出真值表人工給出真值表人工化簡卡諾圖人工化簡卡諾圖得到最簡表達式得到最簡表達式人工使用人工使用LSI電路實現(xiàn)電路實現(xiàn)系統(tǒng)調(diào)試和驗證系統(tǒng)調(diào)試和驗證現(xiàn)代數(shù)字系統(tǒng)設(shè)計流程設(shè)計目標設(shè)計目標設(shè)計輸入設(shè)計輸入功能級仿真功能級仿真邏輯綜合邏輯綜合時序仿真時序仿真系統(tǒng)調(diào)試與驗證系統(tǒng)調(diào)試與驗證entity lab1 is port(a,b,c : in std_logic; y : out std_logic);end lab1; architecture rtl of lab1 isbegin yGenerate File關(guān)閉該界面基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)

2、計流程-生成PROM文件并下載到PROM 下面將生成的PROM文件燒到PROM芯片中。選擇Boundary Scan準備分配PROM文件給XCF04S基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)計流程-生成PROM文件并下載到PROM鼠標右鍵點擊芯片圖標選擇Assign New ConfigurationFile基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)計流程-生成PROM文件并下載到PROM選擇選擇counter_burn.mcs文件文件點擊“打開”按鈕基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)計流程-生成PROM文件并下載到PROM鼠標右健點擊芯片圖標,出現(xiàn)下面的菜單點擊“Program”選項，開始對FPGA進行編程基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)計流程-生成PROM文件并下載到PROM出現(xiàn)編程進度條編程完成后，出現(xiàn)下面界面基于基于VHDL語言的語言的ISE設(shè)計流程設(shè)計流程-生成PROM文件并下載到PROM 關(guān)閉電源重新上電，程序從關(guān)閉電源重新上電，程序從PROM自動引導(dǎo)到自動引導(dǎo)到FPGA芯片中。芯片中。 關(guān)閉配置界面，不保存任何信

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