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1、3 實(shí)驗(yàn)3 3.1 實(shí)驗(yàn)內(nèi)容題目：設(shè)計(jì)一個(gè)1位的四選一多路選擇器要求：1.使用二選一多路選擇器模塊進(jìn)行搭建 2. 出現(xiàn)正確的仿真波形，無(wú)需板子上驗(yàn)證。3.2 實(shí)驗(yàn)步驟1. 系統(tǒng)設(shè)計(jì)利用3個(gè)2選1選通器搭建4選1一位選通器。利用第二題中已編寫(xiě)好的2選1選通器，在新編寫(xiě)的4選1中實(shí)例化三個(gè)子模塊實(shí)現(xiàn)。設(shè)計(jì)原理圖如下：2. 重要源代碼及注釋4選1：module mux4to1(a,b,c,d,s1,s2,out);input wire a,b,c,d;input wire s1,s2;output wire out;wire out1,out2;mux2to1 f1(.a(a),.b(b),.sel

2、(s1),.out(out1);mux2to1 f2(.a(c),.b(d),.sel(s1),.out(out2);mux2to1 f3(.a(out1),.b(out2),.sel(s2),.out(out);endmodule子模塊2選1：module mux2to1(a,b,sel,out );input a,b,sel;output out;wire out;assign out=sel?a:b;endmodule3.3 結(jié)果分析1 Testbench代碼module test();reg a,b,c,d,s1,s2;wire out;mux4to1 U0(.a(a),.b(b),.c(c),.d(d),.s1(s1),.s2(s2),.out(out);initial begin a=0;b=0;c=0;d=0;s1=0;s2=0;endalwaysfork#10 a=1; #20 a=0;#15 b=1; #10 b=0;#5 c=1; #10 c=0;#30 d=1; #20 d=0;#5 s1=0; #10 s1=1;#10 s2=1; #20 s2=0;joinendmodule2 仿真波形圖3 說(shuō)明S1S2對(duì)應(yīng)輸出：00d;01b;10c;11a;010ns: s1s2為00,out=d;1020ns: s1s2

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