計(jì)算機(jī)組成原理習(xí)題實(shí)驗(yàn)三_第1頁
計(jì)算機(jī)組成原理習(xí)題實(shí)驗(yàn)三_第2頁
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文檔簡介

1、（一算術(shù)邏輯運(yùn)算實(shí)一實(shí)驗(yàn)?zāi)慷?shí)驗(yàn)設(shè)（一算術(shù)邏輯運(yùn)算實(shí)一實(shí)驗(yàn)?zāi)慷?shí)驗(yàn)設(shè)三實(shí)驗(yàn)內(nèi)式位字長的 據(jù)開關(guān)(“INPUTDEVICE”)用來給出參與運(yùn)算的數(shù)據(jù)，并經(jīng)過一三態(tài)門（74LS245）和數(shù)據(jù)總線相連，數(shù)據(jù)顯示燈“BUS UNIT）已和數(shù)據(jù)總線相連，用來顯示數(shù)據(jù)總線內(nèi)容。由于實(shí)驗(yàn)電路中的時(shí)序信號均已連至“W/RUNIT”的相應(yīng)時(shí)序信號引出端，因此，在進(jìn)行實(shí)T4S3、S2S1、S0 、Cn、MLDDR1、LDDR2、IO-R、SW-B 各電平控制其中 Cn、ALU-B、IO-R 為低電平有效，LDDR1、LDDR2 為高電平有效圖圖R=1B=0 DR1DR2表14M=LB0Vcc -B3-M邏輯操LL

2、LLF=ALLLHF=（A+B）LLHLF=（A+B）LLHHLHLLF=AF=AAB1F=ALHLHF=（A+B）LHHLF=ABLHHHHLLLF=AF=AABHLLHF=AF=A14M=LB0Vcc -B3-M邏輯操LLLLF=ALLLHF=（A+B）LLHLF=（A+B）LLHHLHLLF=AF=AAB1F=ALHLHF=（A+B）LHHLF=ABLHHHHLLLF=AF=AABHLLHF=AF=AB1HLHLF=B F=（A+B）S3 S2S1F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ F=（ H L H H H HH L H H H H L L H H L H H

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