
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
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文檔簡介
1、EDA 原理及應(yīng)用實(shí)驗(yàn)報(bào)告題目:汽車尾燈控制器設(shè)計(jì)班級:一、 設(shè)計(jì)題目:汽車尾燈控制器設(shè)計(jì)二、 設(shè)計(jì)目標(biāo):2 1 1 秒,汽車尾燈顯示方式分為以下四個(gè)狀態(tài):QA 狀態(tài):正常或其他行駛狀態(tài)時(shí),左右尾燈均熄滅不亮。QB 狀態(tài):當(dāng)左轉(zhuǎn)彎時(shí),左尾燈以亮-滅-亮-滅行駛閃爍,右尾燈滅; QC 狀態(tài):當(dāng)右轉(zhuǎn)彎時(shí),右尾燈以亮-滅-亮-滅行駛閃爍,左尾燈滅; QD 狀態(tài):當(dāng)發(fā)生緊急情況時(shí),左右尾燈同時(shí)采用亮-滅-亮-滅雙閃爍方式;三、 設(shè)計(jì)原理:(含系統(tǒng)總的原理圖)z=1LDQBz=0z=1(z,y,j)= 0QAy=0y=1y=1QCRDj=1j=0QDLD RDj=1z 2 秒的輸入時(shí)鐘;LD 代表左尾燈
2、,LD 由一個(gè)分頻器模塊,尾燈控制模塊,幾個(gè)獨(dú)立按鍵組成四、 設(shè)計(jì)內(nèi)容:(含狀態(tài)轉(zhuǎn)換圖、軟件流程圖、說明文字等,每單獨(dú)模塊的圖標(biāo)和 VHDL 程序;最后為總體程序框圖)尾燈控制器library ieee;use ieee.std_logic_1164.all;entity weideng is port(z,y,j,cp,rst : in std_logic;LD,RD : out std_logic);end;architecture one of weideng is type fsm_st is (QA,QB,QC,QD);signal current_state , next_stat
3、e : fsm_st; beginprocess (cp,rst) beginif rst = 0 then current_state = elsifcp = 1 and cpeventthen current_state LD = 1;RD= 1;if j = 0then next_state = QD; elsif z = 0 then next_state = QB; elsif y = 0 then next_state = else next_state LD = cp; RD = 1;if z = 1 orj = 0thennext_state = else next_state
4、 LD = 1; RD = cp;if y = 1 orj = 0 thennext_state = else next_state LD = cp; RD= cp; if j = 1 then next_state = else next_state = QD;end if; end case;end process; end;說明:z 0 時(shí)LD 0 時(shí)RD 平;j 0 LD 左尾燈RD 為優(yōu)先級。分頻器LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY DVF ISPORT(CL
5、K:IN STD_LOGIC;-D:IN STD_LOGIC_VECTOR(3 DOWNTO 0); FOUT:OUT STD_LOGIC);END;ARCHITECTURE one OF DVF IS SIGNAL FULL:STD_LOGIC; BEGINP_REG:PROCESS(CLK)VARIABLE CNT8:INTEGER RANGE 48000000 DOWNTO 0; BEGINIF CLKEVENT AND CLK=1 THEN IF CNT8=48000000 THENCNT8:=0; FULL=1;ELSE FULL=0;END END END PROCESS P_REG; P_DIV:PROCESS(FULL) BEGINIF FULLEVENT AND FULL=1 THEN CNT2:=NOT CNT2;IF CNT2=1 THEN FOUT=1;ELSE FOUT=0; END IF;END IF;END PROCESS P_DIV; END;說明:周期 2 秒的輸入時(shí)鐘RTL 狀態(tài)圖仿真圖總體程序框圖選擇器時(shí)鐘時(shí)鐘z=0LD=1y=0RD=1分頻器j=0LD,RD=1LED 燈z=0,j=0LD,RD=1y=0,j=0LD,RD=1
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