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/實驗名稱:利用例化語句進行層次化設(shè)計學生姓名:班級:學號:指導老師:同組人:成績:實驗目的及要求:實驗目的:學習利用例化語句進行層次化設(shè)計的方法.并仿真驗證自己的設(shè)計項目實驗要求:利用或門和半加器設(shè)計全加器實驗原理:?在半加器的基礎(chǔ)上,采用元件調(diào)用和例化語句,將元件連接起來,而實現(xiàn)全加器的VHDL編程和整體功能。全加器包含了兩個半加器和一個或門全加器的vhdl設(shè)計如下:(1)半加器的VHDL文本設(shè)計如下:(2)或門的VHDL文本設(shè)計如下:(3)全加器的vhdl設(shè)計如下:實驗步驟:(1)建立新文件夾adder(2)半加器的設(shè)計(1)輸入半加器源程序。打開QuartusII,單擊“file"菜單下的New,在New窗口中DesignFiles欄中選擇VHDlFile選項,然后在VHDL文本編輯框中輸入半加器的VHDL源程序(2)文件存盤.選擇AS,存盤文件名應(yīng)與實體名一致,即h_adder。vhd,找到已建立的文件夾adder,保存在新建的文件夾里(3)在主菜單中選擇Processing→StartCompilat(yī)ion命令,系統(tǒng)編譯,同時打開CompilationReportFlowSummary窗體,Stat(yī)us視圖顯示編譯進程(4)在主菜單中選擇命令,打開New對話框.單擊New對話框中的OtherFiles選項卡標簽,再選擇VectorWaveformFile選項,單擊OK按鈕,組建一個Waveform1。vwf的波形文件.(5)在Waveform1.vwf的波形文件左側(cè)單擊右鍵,選擇Insert→InsertNodeorBus(或直接雙擊界面)打開后再選擇NodeFinder按鈕,打開。在出現(xiàn)的對話框中的Filter下拉列表中選擇Pins:all項,單擊List按鈕,在NodesFound列表中顯示項目中的所有引腳節(jié)點。將所有節(jié)點都添加到Selected(6)選擇主菜單中的Edit→EndTime命令,打開對話框,在Time編輯框中輸入100,單位us。按住Ctrl鍵,同時向下滾動鼠標滑輪,使窗口比例合適,拖動選擇一段波形,使其被選中,然后單擊左側(cè)工具欄的按鈕,使選中的一段波形狀態(tài)變?yōu)?.采取同樣的方法,將輸入點都進行設(shè)置。(7)選擇as命令,接受默認名hadder。vwf,確定,存盤.為了對設(shè)計進行仿真,創(chuàng)建的波形文件的名稱必須與設(shè)計文件的名稱相同,并且它們要保存在同一個子目錄下。(8)選擇Processing→StartSimulation命令。如果沒有錯誤的話,彈出Simulatorwassuccessful(9)選擇→CreatsymbolFilesforcurrentfiles,接受對話框內(nèi)默認的名稱確認后,系統(tǒng)生成元件(3)按照上述步驟對或門設(shè)計和封裝(4)封裝好半加器和或門后,把其添加到元件庫中,再按照上述步驟進行全
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