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PAGE實(shí)驗(yàn)1一位全加器（綜合驗(yàn)證性）一、目的掌握組合邏輯電路，使用74LS00“與非門”電路構(gòu)成一位全加器組合邏輯電路。掌握組合邏輯電路的基本概念和結(jié)構(gòu)。二、要求：使用與非門構(gòu)成一位全加器組合邏輯電路。實(shí)驗(yàn)報(bào)告包括：1、畫出一位全加器邏輯電路圖；正確標(biāo)出集成電路引腳。74LS00“與非門”電路引腳名稱：2、標(biāo)上門電路腳號(hào)，連接邏輯電路；發(fā)光管1101103、模擬輸入Ai、Bi、Ci，記載Si、Ci-1實(shí)驗(yàn)結(jié)果。AiBiCiSiCi-1三、實(shí)驗(yàn)設(shè)備和集成電路1、數(shù)字邏輯實(shí)驗(yàn)板一塊。2、3片74LS00，連結(jié)導(dǎo)線50根。四、考核方式1、邏輯電路圖應(yīng)當(dāng)整潔、規(guī)范。2、實(shí)驗(yàn)前作好充分實(shí)驗(yàn)準(zhǔn)備。3、數(shù)字邏輯實(shí)驗(yàn)課是一項(xiàng)實(shí)踐性很強(qiáng)的教學(xué)課程。考核的重點(diǎn)是電路連接，調(diào)試和測(cè)試的實(shí)踐性環(huán)節(jié)?？疾鞂W(xué)生在實(shí)驗(yàn)中的動(dòng)手能力和事實(shí)求是的科學(xué)態(tài)度。核心是檢查是否能夠?qū)嶋H完成一位全加器數(shù)字邏輯電路，并電路運(yùn)行正確作為重要標(biāo)準(zhǔn)。在電路連接，調(diào)試和測(cè)試完成后，經(jīng)老師檢查確認(rèn)滿足實(shí)驗(yàn)要求，學(xué)生簽字，遞交報(bào)告書，方可通過實(shí)驗(yàn)一的驗(yàn)收。五、連接，調(diào)試和測(cè)試組合邏輯電路參考事項(xiàng)注意如下：1、實(shí)驗(yàn)開始時(shí)，檢查并確定實(shí)驗(yàn)設(shè)備上的集成電路是否符合要求。2、導(dǎo)線在插孔中一定要牢固接觸。集成電路引腳與引腳之間的連線一定要良好接觸。連線在面包板上排列整齊，連線的轉(zhuǎn)彎成直角。連線不要飛線。3、在組合邏輯電路連線時(shí)，為了防止連線時(shí)出錯(cuò)，可以在每連接一根線以后，在組合邏輯

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