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文檔簡介
1、ch1.1、三極管的截止條件是VBE0.5V ,截止的特點是Ib=Ic 0;飽和條件是Ib ( EC-Vces) / ( RC),飽和的特點是VBE 0.7V ,VCE=VCES 0.3V 。2、邏輯常量運算公式3、邏輯變量、常量運算公式4、 邏輯代數(shù)的基本定律根據(jù)邏輯變量和邏輯運算的基本定義,可得出邏輯代數(shù)的基本定律?;シ嵌?: A+A = l, A ? A = 0;,重疊定律(同一定律): A? A=A,A+A=A;反演定律 ( 摩根定律):A? B=A+B9 A+B=A ? B還原定律 :;,;ch2.1、三種基本邏輯是與、或、非。2、三態(tài)輸出門的輸出端可以出現(xiàn)高電平、底電平和高阻三種
2、狀態(tài)。ch3.1、組合電路的特點:電路任意時刻輸出狀態(tài)只取決于該時刻的輸入狀態(tài),而與該時刻前的電路狀態(tài)無關(guān)。2、編碼器:實現(xiàn)編碼的數(shù)字電路3、譯碼器:實現(xiàn)譯碼的邏輯電路4、數(shù)據(jù)分配器:在數(shù)據(jù)傳輸過程中,將某一路數(shù)據(jù)分配到不同的數(shù)據(jù)通道上。5、數(shù)據(jù)選擇器:邏輯功能是在地址選擇信號的控制下,從多路數(shù)據(jù)中選擇一路數(shù)據(jù)作為輸出信號。6、半加器:只考慮兩個一位二進(jìn)制數(shù)相加,而不考慮低位進(jìn)位的運算電路。7、全加器:實現(xiàn)兩個一位二進(jìn)制數(shù)相加的同時,再加上來自低位的進(jìn)位信號。8、在數(shù)字設(shè)備中,數(shù)據(jù)的傳輸是大量的,且傳輸?shù)臄?shù)據(jù)都是由若干位二進(jìn)制代碼0 和 1 組合而成的。9、奇偶校驗電路:能自動檢驗數(shù)據(jù)信息傳送
3、過程中是否出現(xiàn)誤傳的邏輯電路。10、競爭:邏輯門的兩個輸入信號從不同電平同時向相反電平跳變的現(xiàn)象。11、公式簡化時常用的的基本公式和常用公式有(要記?。?)2)(德 . 摩根定律)3)4)5)12、邏輯代數(shù)的四種表示方法是真值表、函數(shù)表達(dá)式、卡諾圖和邏輯圖。ch4.1、觸發(fā)器:具有記憶功能的基本邏輯單元。2、觸發(fā)器能接收、保存和輸出數(shù)碼0,1。各類觸發(fā)器都可以由門電路組成。3、基本觸發(fā)器特點1)有兩個穩(wěn)定狀態(tài)和兩個互補的輸出。2)在輸入信號驅(qū)動下,能可靠地確定其中任一種狀態(tài)。4、基本 RS觸發(fā)器特性表-R-SQ-Q說明0101置 01010置 1110 或 11 或 0保持原來狀態(tài)0011不
4、正常狀態(tài), 0 信號消失后, 觸發(fā)器狀態(tài)不定5、(從邏輯功能來分,有:RS觸發(fā)器、 JK 觸發(fā)器、 D 觸發(fā)器、 T 觸發(fā)器、 T觸發(fā)器等;從結(jié)構(gòu)來分,有:基本觸發(fā)器、TTL 主從觸發(fā)器、 CMOS主從邊沿觸發(fā)器、維持阻塞邊沿觸發(fā)器等。不同結(jié)構(gòu)的觸發(fā)器其觸發(fā)特點不同,這可以由觸發(fā)器的邏輯符號表示。在波形分析時, 要特別注意觸發(fā)器的觸發(fā)特點,才可以畫出正確的工作波形。)名稱基本RSRSJK符號功能表特性方程R+S=1RS=0狀態(tài)轉(zhuǎn)換圖無驅(qū)動表無觸發(fā)特點電位觸發(fā),低電平有效CP脈沖后沿觸發(fā)CP脈沖后沿觸發(fā)名稱DTT符號功能表特性方程Qn+1=D狀態(tài)轉(zhuǎn)換圖無驅(qū)動表無觸發(fā)特點CP脈沖前沿觸發(fā)CP脈沖后
5、沿觸發(fā)CP脈沖后沿觸發(fā)(邊沿)(邊沿)(邊沿)(D 觸發(fā)器特性方程此表中為簡寫,詳情請見書92 頁)6、 JK 觸發(fā)器有兩種觸發(fā)方式:主從和邊沿觸發(fā)方式。7、觸發(fā)器邏輯功能的轉(zhuǎn)換1) JK 型和 D 型相互轉(zhuǎn)換此內(nèi)容為重點,詳情請見書100 101 頁!2) JK 型和D 型轉(zhuǎn)換成其他類型ch5.1、按觸發(fā)方式將時序電路分成兩類:1 )同步時序電路2 )異步時序電路2、時序電路分為米里型和莫爾型兩類。3、時序邏輯電路的特點:電路任一時刻的輸出狀態(tài)不僅取決于當(dāng)時的輸入信號,而且還取決于電路原來的狀態(tài),或者說與以前的輸入有關(guān)。4、時序邏輯電路框圖:x :組合電路的輸入信號z :儲存電路的輸入信號y
6、:組合電路的輸出信號q:儲存電路的輸出信號5、數(shù)碼寄存器:用來存放一組二值代碼。6、移位寄存器:儲存二值代碼、具有移位功能。就是在移位脈沖作用下,將二值代碼左移或右移,左移和右移的方向是對邏輯圖而言的。7、數(shù)碼寄存器有雙拍和單拍兩種工作方式。1 )雙拍:接收數(shù)碼的過程分二步進(jìn)行,第一步清零,第二步接收數(shù)碼。2 )單拍:只需一個接收脈沖就可完成接收數(shù)碼的工作方式。8、鎖存器特點:1 )當(dāng)鎖存信號沒有到來時,鎖存器的輸出狀態(tài)隨輸入信號變化而變化2 )當(dāng)鎖存信號到達(dá)時,鎖存器輸出狀態(tài)保持鎖存信號跳變時的狀態(tài)。9、計數(shù)器應(yīng)用于:時鐘脈沖計數(shù)、定時、分頻、產(chǎn)生節(jié)拍脈沖、數(shù)字運算符等。10、計數(shù)器按觸發(fā)方
7、式分類:同步計數(shù)器、異步計數(shù)器。11、狀態(tài)轉(zhuǎn)換圖: (必會!詳情見書115 頁)( 3 位二進(jìn)制計數(shù)器轉(zhuǎn)改轉(zhuǎn)換圖)12、進(jìn)行遞增計數(shù)的計數(shù)器叫做加法計數(shù)器; 進(jìn)行遞減計數(shù)的計數(shù)器叫做減法計數(shù)器; 即可進(jìn)行遞增又可進(jìn)行遞減的計數(shù)器,叫做可逆計數(shù)器。13、可逆計數(shù)器也稱加/ 減計數(shù)器1)雙時鐘結(jié)構(gòu):一個加/ 減法計數(shù)器有兩個計數(shù)脈沖輸入端。2)單時鐘結(jié)構(gòu):一個加/ 減法計數(shù)器只有一個計數(shù)脈沖輸入端。14、利用中規(guī)模集成計數(shù)器構(gòu)成任意進(jìn)制計數(shù)器的方法有:乘數(shù)法、復(fù)位法、置數(shù)法。1)乘數(shù)法:計數(shù)脈沖接到N 進(jìn)制計數(shù)器的時鐘輸入端,N 進(jìn)制計數(shù)器的輸出接到制計數(shù)器的時鐘輸入端,兩個計數(shù)器一起構(gòu)成了N M
8、進(jìn)制計數(shù)器。2)用復(fù)位法構(gòu)成N 進(jìn)制計數(shù)器所選用的中規(guī)模集成計數(shù)器的計數(shù)容量必須大于輸入 N 個計數(shù)脈沖后,計數(shù)器應(yīng)回到全0 狀態(tài)。M進(jìn)N。當(dāng)3)置數(shù)法:采用置數(shù)法,必須對計數(shù)器進(jìn)行置數(shù)??梢栽谟嫈?shù)器計數(shù)到最大時,置入計數(shù)器狀態(tài)轉(zhuǎn)換圖中的最小數(shù),作為計數(shù)循環(huán)的起點,也可以在計數(shù)器計數(shù)到某個數(shù)之后,置入最大數(shù),然后接著從 0 開始計數(shù)。15、順序脈沖發(fā)生器也稱節(jié)拍脈沖發(fā)生器。能夠產(chǎn)生一組在時間上有先后順序的脈沖。ch8.1、獲得矩形脈沖波的方法:1 )利用多諧振蕩器直接產(chǎn)生所需要的矩形脈沖波2 )利用整形電路,將不理想的波形變換成所要求的矩形脈沖波2、 555 定時器由電阻分壓器、比較器、基本
9、RS觸發(fā)器、三極管開關(guān)和輸出緩沖器等 5 部分組成。3、集成 555 定時器的應(yīng)用:多諧振蕩器、單穩(wěn)態(tài)觸發(fā)器、施密特觸發(fā)器。1 )多諧振蕩器:一種能產(chǎn)生矩形波(方波)的電路。2 )單穩(wěn)態(tài)觸發(fā)器一般用于定時、整形和延時。3 )施密特觸發(fā)器: 一種脈沖波整形電路。 可將邊沿變化緩慢的輸入信號波形整形為矩形波。Ch9.1、模 / 數(shù)轉(zhuǎn)換:將模擬量轉(zhuǎn)換成數(shù)字量的過程。2、數(shù) / 模轉(zhuǎn)換:把數(shù)字量換換成模擬量的過程。3、實現(xiàn)數(shù) / 模轉(zhuǎn)換的基本方法:用電阻網(wǎng)絡(luò)將數(shù)字量按著每位數(shù)碼的權(quán)轉(zhuǎn)換成相應(yīng)的模擬量,然后用求和電路將這些模擬量相加。4、 DAC的主要技術(shù)指標(biāo):1 )分辨率: DAC電路所能分辨的最小輸
10、出電壓與滿刻度輸出電壓之比。2 )轉(zhuǎn)換誤差3 )建立時間:數(shù)字信號由全 0 變?nèi)?1,或由全 1 變?nèi)?0,模擬信號電壓或電流達(dá)到穩(wěn)態(tài)值所需要的時間。5、模 / 數(shù)轉(zhuǎn)換器:把模擬電壓或電流轉(zhuǎn)換成與之成正比的數(shù)字量。6、一般模 / 數(shù)( A/D)轉(zhuǎn)換需經(jīng)采樣、保持、量化、編碼4 個步驟。但這4 個步驟并不是由四個電路來完成的。例如,采樣和保持兩步就由采樣- 保持電路完成,而量化與編碼又常常在轉(zhuǎn)換過程中同時完成。7、采樣:按一定時間間隔采集模擬信號。8、采樣定理(必記! ):只有當(dāng)采樣頻率大于模擬信號的最高頻率分量的2 倍時,所采集的信號樣值才能不失真地反映原來模擬信號的變化規(guī)律。9、若要不產(chǎn)生混疊,采樣頻率就不能小于正弦波頻率的采樣頻率必須大于正弦波頻率的 2 倍。2 倍。要不失真地恢復(fù)正弦信號,10、采樣 - 保持電路主要有兩個指標(biāo):采集時間、保持電壓下降速率。11、量化:近似的過程。12、量化方法:1 )“只舍不入法” :將不夠量化單位的值舍掉。2)“有舍有入法” :將小于/2 的值舍去,將小于而大于13、編碼: 量化過程只是把模擬信號按量化單位作了取整處理,/2 的值視為數(shù)字量。只有用代碼表示量化后的值才能得到數(shù)字量,這一過程成為編碼。14、 ADC的主要技術(shù)指標(biāo):1 )轉(zhuǎn)換時間2 )分解度3 )量化誤差4 )精度
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