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文檔簡介

1、 cadence系列軟件在eda行業(yè)可以說是久負(fù)盛名，是諸多高速pcb設(shè)計的首選工具。然而對于一些簡單的pcb，如果使用allegro進行布線，似乎并不需要那么多嚴(yán)格的規(guī)則，簡簡單單快速成型或許更好，然而orcad capture cis的原理圖繪制功能實在讓人愛不釋手，功能強大但用起來很簡單很順手。因此，如果能將capture的原理圖功能，與altiumdesigner的layout部分結(jié)合起來，對于常規(guī)設(shè)計來說應(yīng)該是一個非常方便的組合。 因此如何將capture的原理圖對應(yīng)到altiumdesigner中的pcb，成為了操作的關(guān)鍵。筆者曾經(jīng)試過，將capture的原理圖保存為16.2版本，

2、再在ad中導(dǎo)入，雖看起來容易實現(xiàn)，可步驟繁瑣不說，有一次ad還直接將原理圖中的兩個地平面混在了一起，幸好及時發(fā)現(xiàn)才沒有釀成大錯。于是想到了網(wǎng)表功能，經(jīng)過反復(fù)實踐，現(xiàn)在已經(jīng)可以實現(xiàn)兩者的無縫拼接，且效率非常高，即便在設(shè)計過程中需要對原理圖進行多次更改，也能夠方便快速的更新到pcb中。具體方法如下：1、 在orcad capture cis中完成原理圖設(shè)計后，選擇dsn文件，在上方選擇tools creat netlist2、 在other中的格式選擇中找到 orprotel2.dll ,點擊ok即可生成網(wǎng)表3、 在altiumdesigner中新建工程，創(chuàng)建一個新的pcb文件，并將剛才的.net網(wǎng)標(biāo)文件添加進來（如果與該工程不在同一目錄下，則網(wǎng)表文件會顯示為快捷方式）4、 在pcb文件中單擊右鍵，選擇show differences5、 選擇 advanced mode ，按下圖所示分別選擇pcb及網(wǎng)表文件6、 在彈出的對話框中會顯示網(wǎng)表文件與當(dāng)前pcb的區(qū)別（今后更新網(wǎng)表時可用于檢查更改是否正確），在顯示主欄中右鍵，并選擇 update all in pcb document 。7、 點擊create engineering change order 8、 之后就可以看到熟悉的畫面了，點擊validate changes檢查封裝是否都正確，之后點擊execute chan

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