mux41四選一選擇器的3種寫法對比_第1頁
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1、library ieee;use ieee.std_logic_1164.all;entity mux4_1b1 isport(s0,s1:in std_logic; a,b,c,d:in std_logic; y:out std_logic);end entity;architecture b1 of mux4_1b1 is signal s:std_logic_vector(1 downto 0);begin s y y y y y=Z; end case; end process;end architecture;library ieee;use ieee.std_logic_1164.

2、allentity mux is port(s1,s0:in std_logic; a,b,c,d:in std_logic; y:out std_logic);end entity;architecture one of mux isbegin process(s1,s0) begin if s1=0then if s0=0 then y=a; else y=b; end if; elsif s1=1 then if s0=0 then y=c; else y=d; end if; end if; end process; end architecture; library ieee;use

3、 ieee.std_logic_1164.all;entity mux4_1b isport(s0,s1:in std_logic; a,b,c,d:in std_logic; y:out std_logic);end entity;architecture b1 of mux4_1b is signal s:std_logic_vector(1 downto 0);beginbegin s=s1 & s0; process(s,a,b,c,d) if (s=00) then y=a; elsif (s=01) then y=b; elsif (s=10) then y=c; elsif (s=11) then y=d; else y=Z;

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