萬(wàn)科物業(yè)發(fā)展有限公司63

1、新型多核網(wǎng)絡(luò)處理器主要參考文獻(xiàn)Advanced Processor with System on a Chip Interconnect Technology. 思科QuantumFlow處理器及其戰(zhàn)略研究。研發(fā)背景今天的網(wǎng)絡(luò)要求越來(lái)越高的帶寬和越來(lái)越復(fù)雜的數(shù)據(jù)包處理：鏈路帶寬迅速提高增長(zhǎng)速度高于CPU性能的提升速度新的業(yè)務(wù)大量涌現(xiàn)音/視頻通信、P2P業(yè)務(wù)等，要求網(wǎng)絡(luò)設(shè)備具備快速的業(yè)務(wù)升級(jí)能力。業(yè)務(wù)流量持續(xù)增長(zhǎng)每12個(gè)月翻一番包處理越來(lái)越復(fù)雜：平安：IPSec/VPN，SSL，防火墻應(yīng)用認(rèn)知application awareness流量工程Traffic Engineering：QoS/SLA

2、等。深度數(shù)據(jù)包檢查Deep Packet Inspection，DPI現(xiàn)狀目前的網(wǎng)絡(luò)設(shè)備大多采用通用處理器+ASIC的設(shè)計(jì)模式：ASIC無(wú)法提供業(yè)務(wù)快速升級(jí)所需的靈活性傳統(tǒng)網(wǎng)絡(luò)處理器：主要用于加速根本的包處理任務(wù)內(nèi)部資源有限，無(wú)法支持DPI這樣的復(fù)雜處理采用低級(jí)語(yǔ)言，缺乏相應(yīng)的支持軟件新型NP與傳統(tǒng)NP的不同傳統(tǒng)NP只處理數(shù)據(jù)面任務(wù)，新型NP可應(yīng)用于控制面、數(shù)據(jù)面、管理面處理。傳統(tǒng)NP主要卸載網(wǎng)絡(luò)層和傳輸層功能，而新型NP可以卸載第四層以上的處理如DPI、加/解密、壓縮/解壓縮等，這主要通過(guò)集成各種特殊的硬件加速器來(lái)實(shí)現(xiàn)。傳統(tǒng)NP一般采用微碼編程，新型NP支持標(biāo)準(zhǔn)嵌入式操作系統(tǒng)和高級(jí)語(yǔ)言C/C

3、+編程。 主要的多核NP半導(dǎo)體廠商CavirmMIPS架構(gòu)BroadcomMIPS架構(gòu)RMIMIPS架構(gòu)CiscoFreescalePowerPC架構(gòu)Tilera1. Cavium OCTEON處理器 面向網(wǎng)絡(luò)、無(wú)線、控制和存儲(chǔ)等應(yīng)用，提供高度集成和低本錢的64位計(jì)算解決方案，廣泛用于各種網(wǎng)絡(luò)設(shè)備。 一種片上系統(tǒng)SoC，集成了：12個(gè)定制的cnMIPS64 CPU core：專門針對(duì)網(wǎng)絡(luò)效勞而設(shè)計(jì)，功耗很小。各種硬件加速器應(yīng)用，平安：針對(duì)下一代IP網(wǎng)絡(luò)各種需求的L3-L7數(shù)據(jù)、內(nèi)容和平安效勞硬件加速選項(xiàng)，分擔(dān)MIPS core的很多任務(wù)。豐富的可配置網(wǎng)絡(luò)接口：以太網(wǎng)、PCI/PCI-X、VoI

4、P、USB 2.0等。OCTEON CN31XX的內(nèi)部結(jié)構(gòu)CN31XX的組成cnMIPS64 core：帶有片上存儲(chǔ)管理單元MMU負(fù)責(zé)虛擬地址和物理地址之間的映射增強(qiáng)的MIPS64 Release 2整數(shù)指令集雙發(fā)射、5級(jí)流水線的超標(biāo)量體系結(jié)構(gòu)32KB指令緩存和8KB L1數(shù)據(jù)緩存一致存儲(chǔ)子系統(tǒng)：256KB L2 cache 64/72-bit DDR2 內(nèi)存控制器可選的低延遲16-bit DDR2-667，用于基于內(nèi)容的處理和保存元數(shù)據(jù) CN31XX的組成續(xù)集成的應(yīng)用加速協(xié)處理器：數(shù)據(jù)包I/O處理引擎：針對(duì)L2-L4的包處理和緩沖區(qū)管理引擎。TCP加速：包括全面的檢查、標(biāo)簽產(chǎn)生、校驗(yàn)和、定時(shí)

5、器和緩沖區(qū)管理。 隊(duì)列/調(diào)度和效勞質(zhì)量硬件：對(duì)于輸入包實(shí)現(xiàn)基于Diffserv、QoS/ToS、輸入端口的隊(duì)列/調(diào)度；對(duì)于輸出包實(shí)現(xiàn)基于固定優(yōu)先級(jí)或加權(quán)公平隊(duì)列WFQ的隊(duì)列/調(diào)度。平安硬件完全分擔(dān)：針對(duì)IPSec、SSL、SRTP、WLAN 802.11i平安協(xié)議處理，支持所有的標(biāo)準(zhǔn)算法。壓縮/解壓縮硬件加速：實(shí)現(xiàn)GZIP、PKZIP和各種協(xié)議。模式匹配硬件加速引擎8個(gè)：深度數(shù)據(jù)包檢查。 不同的處理器版本通信處理器、平安通信處理器、網(wǎng)絡(luò)效勞處理器包含不同的硬件加速選項(xiàng)。CN31XX的組成續(xù)集成的高性能網(wǎng)絡(luò)接口：最多3個(gè)可配置的以太網(wǎng)接口：3個(gè)10/100/1000 Ethernet MAC R

6、GMII，或者1個(gè)RGMII+1個(gè)GMII。32位PCI/PCI-X 主設(shè)備或從設(shè)備。支持無(wú)縫VoIP的TDM/PCM接口。480Mbps USB2.0 主設(shè)備性能每秒最多執(zhí)行10億條CN3110或20億條CN3120指令。500Mbps2Gbps的應(yīng)用性能：最高2Gbps 64B IP轉(zhuǎn)發(fā)最高2Gbps TCP、IPSec、SSL、壓縮/解壓縮最高1Gbps正規(guī)表達(dá)式匹配工業(yè)標(biāo)準(zhǔn)的編程模型，不需要任何專用工具或微代碼 2. Broadcom BCM14803. RMI XLR處理器采用SoC技術(shù)，將網(wǎng)絡(luò)連接、負(fù)載平衡、平安、XML等功能集成在一個(gè)芯片上?；贛ips64架構(gòu)。支持Linux

7、SMP和VxWorks等常見(jiàn)的操作系統(tǒng)，允許利用工業(yè)標(biāo)準(zhǔn)的開(kāi)發(fā)工具和環(huán)境進(jìn)行軟件設(shè)計(jì)，沒(méi)有代碼空間的限制?？捎糜谌魏涡枰W(wǎng)絡(luò)加速的場(chǎng)合，目標(biāo)市場(chǎng)包括多業(yè)務(wù)交換機(jī)，路由器，防火墻/VPN/IDS/內(nèi)容認(rèn)知網(wǎng)絡(luò)、網(wǎng)絡(luò)效勞、虛擬存儲(chǔ)和負(fù)載平衡等網(wǎng)絡(luò)應(yīng)用。 XLR732的內(nèi)部結(jié)構(gòu)XLR處理器的設(shè)計(jì)特色多核多線程：包含多個(gè)Mips64核心，每個(gè)核心擁有4個(gè)線程，每個(gè)線程擁有完全獨(dú)立的存放器組，在線程調(diào)度時(shí)不需要進(jìn)行上下文切換。高速內(nèi)部網(wǎng)絡(luò)：采用專利技術(shù)構(gòu)成的內(nèi)部網(wǎng)絡(luò)連接各個(gè)核、網(wǎng)絡(luò)接口、DMA和平安引擎，允許以上各部件之間獨(dú)立并行地傳遞數(shù)據(jù)。硬件加速器：數(shù)據(jù)包處理，平安處理。豐富的接口：以太網(wǎng)、Hype

8、r Transport、內(nèi)存、PCI-X、DMA、串口等。 XLR處理器內(nèi)部結(jié)構(gòu)XLR的專利設(shè)計(jì)自帶數(shù)據(jù)cache和指令cache的處理器核與各個(gè)核的cache相連的data switch interconnect ringDSI，在各個(gè)核之間傳遞與內(nèi)存相關(guān)的數(shù)據(jù)。連接到DSI上的共享L2 cache，存放內(nèi)核可直接訪問(wèn)的數(shù)據(jù)。與各個(gè)核的指令cache及各個(gè)通信端口相連的fast messaging ring，在核與通信端口之間提供與存儲(chǔ)無(wú)關(guān)的點(diǎn)對(duì)點(diǎn)消息傳輸。與消息網(wǎng)絡(luò)及通信端口相連的interface switch interconnectISI，用于在消息網(wǎng)絡(luò)和通信端口之間傳輸消息。與DS

9、I和至少一個(gè)通信端口相連的內(nèi)存橋，在DSI和通信端口之間直接通信。與DSI、ISI和至少一個(gè)通信端口相連的超級(jí)內(nèi)存橋，與DSI、ISI和通信端口通信。3.1 處理器核每個(gè)處理器核采用4路多線程單發(fā)射10級(jí)流水線結(jié)構(gòu)，為線程級(jí)并行而優(yōu)化。指令級(jí)并行對(duì)于訪存密集型應(yīng)用而言意義不大，而數(shù)據(jù)包處理具有自然的線程級(jí)并行。 不同的核可以執(zhí)行不同的程序，甚至運(yùn)行不同的操作系統(tǒng)。一個(gè)核中的不同線程可以執(zhí)行不同的程序，甚至運(yùn)行不同的操作系統(tǒng)。處理器核之間通過(guò)消息網(wǎng)絡(luò)進(jìn)行通信。線程調(diào)度-Eager round-robin線程調(diào)度Multithreaded fixed-cycle scheduling線程調(diào)度-Mu

10、ltithreaded fixed-cycle scheduling with eager round-robin可編程中斷控制器PIC 可編程中斷控制器PIC從中斷源接受中斷請(qǐng)求后，可以將中斷指派給任何一個(gè)核/線程去處理。CPU mask是一個(gè)32比特的數(shù)，用于指示哪些核/線程不處理該中斷。如有多個(gè)未屏蔽的核或線程，采用round-robin方式進(jìn)行任務(wù)分配。XLR還允許一個(gè)線程中斷另一個(gè)線程。3.2 L2 Cache統(tǒng)一的指令與數(shù)據(jù)片上L2 Cache，2MB容量，32B cache line。包含與處理器核數(shù)量一樣多的bank。每個(gè)時(shí)鐘周期最多可以同時(shí)接收8路訪問(wèn)。可以不包括L1 cac

11、he中的內(nèi)容，從而有效地提高整個(gè)內(nèi)存系統(tǒng)的容量。可被處理器核直接訪問(wèn)。3.3 數(shù)據(jù)交換data switchDSI、內(nèi)存橋和超級(jí)內(nèi)存I/O橋構(gòu)成一個(gè)用于數(shù)據(jù)交換的環(huán)，其中內(nèi)存橋連接存儲(chǔ)端口與處理器核，超級(jí)內(nèi)存I/O橋連接存儲(chǔ)端口、通信端口與處理器核。每個(gè)處理器核、內(nèi)存橋和超級(jí)內(nèi)存I/O橋各自通過(guò)一個(gè)環(huán)單元連接到環(huán)上。每個(gè)處理器核的環(huán)單元與該處理器核的指令cache以及 L2 cache中的相應(yīng)bank連接。實(shí)際上有4個(gè)環(huán)構(gòu)成了這個(gè)環(huán)結(jié)構(gòu)：請(qǐng)求環(huán)RQ、數(shù)據(jù)環(huán)DT、Snoop RingSNP和響應(yīng)環(huán)RSP，每個(gè)節(jié)點(diǎn)包括了4個(gè)環(huán)上的環(huán)單元。環(huán)上的通信是基于包的通信，每個(gè)包包含像目的ID、事務(wù)ID等域

12、，包在環(huán)上傳遞直至被接收節(jié)點(diǎn)收到。數(shù)據(jù)交換互連環(huán)示意圖環(huán)單元結(jié)構(gòu)包在環(huán)上的傳遞過(guò)程3.4 消息傳遞網(wǎng)絡(luò)FMN環(huán)單元結(jié)構(gòu)消息的數(shù)據(jù)結(jié)構(gòu)基于信用的流量控制對(duì)于一個(gè)特定的接收者，分配給所有發(fā)送者的信用總數(shù)不能超過(guò)接收隊(duì)列RCV Queue的入口總數(shù)如256。軟件可以控制信用的分配。比方，啟動(dòng)時(shí)每個(gè)發(fā)送者可以被分配一個(gè)缺省的信用數(shù)，然后軟件再可以為每個(gè)發(fā)送者分配信用。當(dāng)一個(gè)代理要發(fā)送一個(gè)消息給某個(gè)接收者時(shí)，它必須具有向該目標(biāo)發(fā)送消息的信用。當(dāng)發(fā)送一個(gè)消息后，其相應(yīng)的信用要減1。當(dāng)信用為0時(shí)，必須停止向該目標(biāo)發(fā)送消息。目標(biāo)取得消息后，向發(fā)送者發(fā)送一個(gè)響應(yīng)信號(hào)，發(fā)送者的信用加1。3.5 本地節(jié)點(diǎn)上的分組流

13、Packet Distribution EnginePDEPDE包括一個(gè)XGMII/SPI-4.2接口和4個(gè)RGMII接口。PDE利用FMN，將數(shù)據(jù)包負(fù)載均衡地、快速地分發(fā)到軟件指定的線程。事實(shí)上，數(shù)據(jù)包并沒(méi)有真正地在FMN上傳遞。網(wǎng)絡(luò)接口將數(shù)據(jù)包寫入內(nèi)存，PDE將一個(gè)包描述符插入到消息中興旺給軟件指定的接收者。PDE分配數(shù)據(jù)包舉例之一 在這個(gè)例子中，軟件選擇thread 4thread7處理接收的數(shù)據(jù)包，并且PDE均勻地將數(shù)據(jù)包分配到4個(gè)線程上。PDE分配數(shù)據(jù)包舉例之二 基于信用的round-robinPacket Ordering DevicePOD許多應(yīng)用要求維持包序，維持包序的方法：用

14、軟件實(shí)現(xiàn)，達(dá)不到線速處理速度。將屬于同一個(gè)流的包發(fā)送到同一個(gè)線程，要求包分類，影響性能，且不利于負(fù)載均衡。XLR使用硬件加速部件POD，在發(fā)送到輸出網(wǎng)絡(luò)接口前排序數(shù)據(jù)包。POD續(xù)每個(gè)數(shù)據(jù)包都被輸入接口分配一個(gè)序號(hào)，該序號(hào)連同其它包信息一起由PDE發(fā)送給工作線程。線程處理完數(shù)據(jù)包后，將包描述符和原始序號(hào)交給POD。POD根據(jù)序號(hào)建立一個(gè)隊(duì)列，對(duì)每一個(gè)收到的數(shù)據(jù)包在隊(duì)列中排序，并按順序發(fā)送到輸出端口。POD的工作機(jī)制POD續(xù)隊(duì)頭阻塞問(wèn)題：較早的一個(gè)數(shù)據(jù)包一直沒(méi)有到達(dá)POD：用定時(shí)器解決在超時(shí)前隊(duì)列滿：丟棄隊(duì)頭的包，以便接收新的包損壞的包或控制包：軟件知道這些包不會(huì)到達(dá)POD，可以在POD中插入一個(gè)

15、啞“包描述符來(lái)消除暫時(shí)的隊(duì)頭阻塞問(wèn)題。芯片上可以有5個(gè)可編程的POD，可以指定哪個(gè)POD對(duì)應(yīng)哪個(gè)接口，也可以配置成繞過(guò)POD。XLR的最大特色高速內(nèi)部網(wǎng)絡(luò)是XLR處理器的最大特色：對(duì)于1.5GHz的XLR，F(xiàn)MN的帶寬到達(dá)96GBps，DSI的帶寬到達(dá)3.84TBps。允許各個(gè)核、核與接口網(wǎng)絡(luò)接口、平安引擎、DMA之間在同一時(shí)間各自并行地傳遞數(shù)據(jù)，防止了通常的總線所需要的仲裁階段。4. 思科QuantumFlow網(wǎng)絡(luò)處理器QuantumFlowQFP是思科在廣域接入和智能化邊緣設(shè)備解決方案中的重要技術(shù)支持，定位在邊緣路由器和企業(yè)路由器。芯片主要解決基于狀態(tài)的效勞stateful service

16、和轉(zhuǎn)發(fā)合一如音/視頻、防火墻、深度包檢查等芯片內(nèi)部包含40個(gè)處理器核，每個(gè)處理器核有4個(gè)硬件線程，可以同時(shí)做160個(gè)數(shù)據(jù)處理，計(jì)算能力超強(qiáng)。芯片的一般情況處理器核：最多40個(gè)核，每個(gè)核4個(gè)線程主頻：最高1.2GHz晶體管數(shù)量：8億內(nèi)存：兩個(gè)片上DDR2控制器，最高1GB RLDRAM片上包內(nèi)存：存儲(chǔ)包頭和載荷，以便進(jìn)行快速的DPICAM：外掛TAM，最高40MB片內(nèi)高速互聯(lián)：Crossbar Switch片外互聯(lián)：ESI網(wǎng)絡(luò)接口：4個(gè)10Gbps SPI4.2功耗：80瓦QFP體系結(jié)構(gòu)QFP結(jié)構(gòu)-處理器觀點(diǎn) 指令集：購(gòu)置了Tensilica的Xtensa的ISA，32位流水線：3發(fā)射5級(jí)流水線

17、 4個(gè)線程共享一個(gè)L1指令緩存 每個(gè)線程有自己的L1數(shù)據(jù)緩存 40個(gè)核共享一個(gè)L2指令緩存 所有節(jié)點(diǎn)通過(guò)crossbar交換機(jī)構(gòu)成一個(gè)2維mesh全聯(lián)通圖QFP體系結(jié)構(gòu)互聯(lián)觀點(diǎn)QFP體系結(jié)構(gòu)報(bào)文觀點(diǎn)從報(bào)文的觀點(diǎn)來(lái)看，QFP是一個(gè)L2-L7的數(shù)據(jù)處理與轉(zhuǎn)發(fā)引擎。在ASR1000系列中，QFP用于集中式的數(shù)據(jù)控制和處理。從線卡和控制平面卡來(lái)的所有數(shù)據(jù)都進(jìn)入QFP，處理后再轉(zhuǎn)發(fā)給某個(gè)線卡或控制平面卡。QFP的邏輯分為兩大局部：Processor engine：主要是40個(gè)CPU核Traffic Manager：由一些數(shù)據(jù)緩存、隊(duì)列和相應(yīng)的調(diào)度算法邏輯組成。包處理流程數(shù)據(jù)包通過(guò)一個(gè)SPI-4.2通道進(jìn)

18、入，包分發(fā)器將一個(gè)完整的幀傳送到片上包內(nèi)存中，進(jìn)行一些根本的包處理和分析，然后將這個(gè)包分配給一個(gè)線程去處理。該線程負(fù)責(zé)數(shù)據(jù)包的全部處理輸入、轉(zhuǎn)發(fā)、輸出，將數(shù)據(jù)包送到流量管理器的某個(gè)隊(duì)列。流量管理器調(diào)度數(shù)據(jù)包，將數(shù)據(jù)包發(fā)往另一個(gè)線卡、控制平面、備用ESP卡或片上包內(nèi)存如果需要再處理一遍，假設(shè)需加密那么啟動(dòng)外掛的加密部件。流量管理器支持128K隊(duì)列、三級(jí)報(bào)文隊(duì)列調(diào)度和多種隊(duì)列調(diào)度算法。QFP體系結(jié)構(gòu)-軟件觀點(diǎn)ASR1000運(yùn)行的操作系統(tǒng)稱為IOS-XE，這是一個(gè)基于Linux的IOS操作系統(tǒng)。IOS-XE的根本特點(diǎn)是：在控制平面卡上，支持單卡上兩個(gè)IOS運(yùn)行，從而支持單控制平面卡的高可用性，這是很

19、重要的一個(gè)亮點(diǎn)。在數(shù)據(jù)處理卡ESP上，主控CPUPowerPC運(yùn)行一個(gè)Linux內(nèi)核和相應(yīng)的管理進(jìn)程，與控制平面卡的IOS和相應(yīng)的進(jìn)程通過(guò)標(biāo)準(zhǔn)的IPC進(jìn)行通信，使控制平面和數(shù)據(jù)平面同步工作。主控CPU還控制QFP，負(fù)責(zé)安裝、啟動(dòng)和運(yùn)行QFP的軟件。QFP那么相當(dāng)于一個(gè)專門處理數(shù)據(jù)包的協(xié)處理器。在線卡SIP上，也通過(guò)一個(gè)主控CPU運(yùn)行一個(gè)Linux內(nèi)核和相應(yīng)的管理進(jìn)程，與控制平面卡的IOS和相應(yīng)的進(jìn)程通過(guò)標(biāo)準(zhǔn)的IPC進(jìn)行通信，使控制平面和線卡同步工作。ESP和QFP的軟件結(jié)構(gòu)圖QFP上的軟件結(jié)構(gòu)QFP上沒(méi)有宿主操作系統(tǒng)。多核局部的數(shù)據(jù)包處理邏輯運(yùn)行在一個(gè)裸機(jī)環(huán)境下，或者一個(gè)非常簡(jiǎn)單的硬件抽象層上

20、。QFP的啟動(dòng)、包處理軟件的下載、安裝和運(yùn)行，都是由主控CPU通過(guò)HT接口控制的。QFP的線程作為引擎的角色，運(yùn)行包處理軟件。QFP體系結(jié)構(gòu)系統(tǒng)觀點(diǎn)QFP是作為思科的邊緣路由器ASR1000的重要組成局部設(shè)計(jì)的。ASR1000是一個(gè)分布式結(jié)構(gòu)，但采用的是集中式數(shù)據(jù)處理。任何一個(gè)數(shù)據(jù)包都要通過(guò)線卡SPA-線卡接口模塊SIP-ESI互聯(lián)-ESP-QFP進(jìn)行處理，從控制平面卡出來(lái)的數(shù)據(jù)包如BGP、OSPF報(bào)文等也是如此。因此，QFP起著一個(gè)樞紐的作用。ASR1000邏輯結(jié)構(gòu)圖戰(zhàn)略規(guī)劃核心主導(dǎo)思想：針對(duì)企業(yè)網(wǎng)的高性能WAN接入，包括網(wǎng)絡(luò)平安、WAN優(yōu)化、音/視頻接入等。智能化邊緣路由器，將防火墻、IP

21、Sec/VPN、DPI、會(huì)話邊界控制等多種應(yīng)用集成在一個(gè)系統(tǒng)中。5. Freescale PowerQUICC處理器Freescale的PowerQUICC通信處理器是一種高度集成化的設(shè)計(jì)，將網(wǎng)絡(luò)處理和控制處理功能合并在一起。增強(qiáng)型的Power e500-mc內(nèi)核，用于控制面處理。目前的產(chǎn)品集成了兩個(gè)Power e500-mc核。增強(qiáng)型的QUICC引擎技術(shù)，用于數(shù)據(jù)面處理。包含豐富的接口：DDR2/DDR3存儲(chǔ)控制器、以太網(wǎng)接口SGMII、串行RapidIO互連、 PCI-X、USB2.0等。采用標(biāo)準(zhǔn)的微代碼編程，提供開(kāi)放式的編程模式，具有第三方廠商的軟件支持。Freescale MPC857

22、2EFreescale的多核SoC路線圖6. Tilera TILE64處理器TILE6464個(gè)相同的處理器核，通過(guò)iMesh片上網(wǎng)絡(luò)互連在一起。每個(gè)核是一個(gè)全功能的處理器，包括集成的L1和L2高速緩存和一個(gè)非阻塞的交換機(jī)，交換機(jī)將處理器核連接到mesh中。集成了完全的存儲(chǔ)和I/O控制器，從而不再需要外部的南橋或北橋。每個(gè)核可以獨(dú)立地運(yùn)行一個(gè)完整的操作系統(tǒng)，或者幾個(gè)核一起運(yùn)行一個(gè)多處理OS?？梢愿鶕?jù)不同應(yīng)用的需要將適當(dāng)數(shù)量的核組織成簇。支持C/C+編程利用iMesh將幾個(gè)處理器核組合起來(lái)完成某個(gè)功能，可獲得ASIC或FPGA的性能，同時(shí)具有強(qiáng)大的軟件可編程性。 每秒最多4430億個(gè)操作，31T

23、bps的片上mesh互聯(lián)，最高50Gbps的I/O帶寬，支持各種計(jì)算密集型應(yīng)用。7. 新型網(wǎng)絡(luò)處理器的特點(diǎn)及面臨的困難特點(diǎn)：芯片上集成大量的處理器內(nèi)核。芯片上集成多個(gè)存儲(chǔ)控制器、大量的硬件加速器和大量高速的I/O接口。包含高效率的片上網(wǎng)絡(luò)。面臨的困難：隨著處理器內(nèi)核數(shù)量的增長(zhǎng)，存儲(chǔ)一致性成為一個(gè)讓人頭痛的問(wèn)題。提供足夠高的I/O帶寬，讓芯片吃飽同樣是一個(gè)挑戰(zhàn)。多核軟件的開(kāi)發(fā)需要新的編程工具和技術(shù)。新型網(wǎng)絡(luò)處理器：吞吐量 VS. 可編程性總結(jié)通用處理器是早期的網(wǎng)絡(luò)處理器。今天的網(wǎng)絡(luò)是高帶寬和“智能的，要求極高的包處理能力。傳統(tǒng)網(wǎng)絡(luò)處理器是具有不同程度可編程性和硬件加速的專用多核多線程SoC。新型

24、網(wǎng)絡(luò)處理器是支持通用編程模型的專用多核多線程SoC。%s#oXlUiQfNbK8H5D2A+x*u$qZnWkShPeMaJ7F4C1z)w&t!pYmUjRgOcL9I6E3B0y(v%r#oXlTiQfNbK8G5D2A-x*u$qZnVkShPdMaJ7F4C0z)w&s!pYmUjRfOcL9H6E3B+y(u%r#oWlTiQeNbJ8G5D1A-x*t$qYnVkSgPdMaI7F4C0z)v&s!pXmUjRfOcK9H6E2B+y(u%rZoWlThQeNbJ8G4D1A-w*t$qYnVjSgPdLaI7F3C0y)v&s#pXmUiRfNcK9H5E2B+x(u%rZoWk

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