數(shù)字電路與邏輯設計習題 5第五章集成觸發(fā)器_第1頁
數(shù)字電路與邏輯設計習題 5第五章集成觸發(fā)器_第2頁
數(shù)字電路與邏輯設計習題 5第五章集成觸發(fā)器_第3頁
數(shù)字電路與邏輯設計習題 5第五章集成觸發(fā)器_第4頁
數(shù)字電路與邏輯設計習題 5第五章集成觸發(fā)器_第5頁
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文檔簡介

位二進制數(shù)碼的寄存器。N+1。同步RSFF123個觸發(fā)器。8=1使輸入T=45于T觸發(fā)器原態(tài)Q=0使新態(tài)Qnn+1。觸發(fā)器的邏輯功能。Tˊn10使JK觸發(fā)器按Q=工作使JK觸發(fā)器的輸端n+1QnQ13．欲使D觸發(fā)器按Q=工作，應使輸入D=。n+1QnA.0B.1C.Q14．下列觸發(fā)器中，克服了空翻現(xiàn)象的有。邊沿D觸發(fā)器主從RS觸發(fā)器主從JK觸發(fā)器同步RS觸發(fā)器15．下列觸發(fā)器中，沒有約束條件的是基本RS觸發(fā)器主從RS觸發(fā)器邊沿D觸發(fā)器。同步RS觸發(fā)器16．描述觸發(fā)器的邏輯功能的方法有。狀態(tài)轉(zhuǎn)換圖17．為實現(xiàn)將JK觸發(fā)器轉(zhuǎn)換為D觸發(fā)器，應使。DQn+1=DQ無關(guān)以它沒有記憶功能n）））由兩個TTL或非門構(gòu)成的基本RS觸發(fā)器，當R=S=0時，觸發(fā)器的狀態(tài)為不定。對邊沿JK觸發(fā)器，在CP為高電平期間，當J=K=1時，狀態(tài)會）個穩(wěn)態(tài)儲8位二進制信息要個觸發(fā)器。2．一個基本RS觸發(fā)器在正常工作時，它的約束條件是R+S=1，則它不允許輸入S=的信號。為，0狀態(tài)為，可見觸發(fā)器的狀態(tài)指的是端的狀態(tài)。。器不會出現(xiàn)這種現(xiàn)象。Q和SQR、K1端0端SSddQQ√√√√QSR00×11Qn八、要求在輸入電平有效的情況下，沒有干擾信號九、使能條件越苛刻，觸發(fā)器的抗干擾能力越強十、JK觸發(fā)器的功能：清0，置1，保持，翻轉(zhuǎn)n700Qn01Qn118十三、、Y的波形如下圖

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