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文檔簡介
項目十二——加法器項目12
加法器
內容:加法器的設計方法學習要求:
目的:了解加法器的組成,掌握其設計方法。重點:加法器的設計方法。難點:加法器的設計方法。半加器加法器能對兩個1位二進制數(shù)進行相加而求得和及進位的邏輯電路稱為半加器。加數(shù)本位的和向高位的進位全加器能對兩個1位二進制數(shù)進行相加并考慮低位來的進位,即相當于3個1位二進制數(shù)相加,求得和及進位的邏輯電路稱為全加器。Ai、Bi:加數(shù),Ci-1:低位來的進位,Si:本位的和,Ci:向高位的進位。全加器的邏輯圖和邏輯符號實現(xiàn)多位二進制數(shù)相加的電路稱為加法器。串行進位加法器構成:把n位全加器串聯(lián)起來,低位全加器的進位輸出連接到相鄰的高位全加器的進位輸入。特點:進位信號是由低位向高位逐級傳遞的,速度不高。為了提高運算速度,在邏輯設計上采用超前進位的方法,即每一位的進位根據(jù)各位的輸入同時預先形成,而不需要等到低位的進位送來后才形成,這種結構的多位數(shù)
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