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(實(shí)驗(yàn)報(bào)告姓名: 單位: 日期 工作報(bào)告工作報(bào)告|Work第第PAGE10
實(shí)驗(yàn)六同步計(jì)數(shù)器的設(shè)計(jì)JKJK1
M2n1<M2n(或狀態(tài)轉(zhuǎn)換表)和選定的狀態(tài)編碼、觸發(fā)器的類型,⑺設(shè)計(jì)步驟簡(jiǎn)圖3設(shè)計(jì)步驟簡(jiǎn)圖
遞增計(jì)數(shù) 每來一個(gè)CP,觸發(fā)器的組成狀態(tài)按二進(jìn)制代碼規(guī)律增加 J-K1J-K1J-K2J-KJ-K觸發(fā)器中,凡是要求接“1”的,一定要接高電平(5V,否則④J-K觸發(fā)器的清零輸入端在工作時(shí)一定要接高電平或連接到實(shí)驗(yàn)箱的清J-K1241212進(jìn)制同步計(jì)數(shù)器中,輸出的狀態(tài)只由前一周期的狀態(tài)決定,而與外來Moore01兩種狀態(tài),因此124Q1、Q2、Q3、Q416種組合中1201~12的對(duì)應(yīng)二進(jìn)制數(shù)為輸出狀態(tài),可得目標(biāo)電路的212J-KJ-K觸發(fā)器特性方程:輸出方程:Y0nQ0n、Y1nQ1n、Y2nQ2、驅(qū)動(dòng)方程:Q0CPJ0K01。Q1Q01nJ1K1Q0Q2Q1Q0112(1100的時(shí)候)發(fā)生變化,因此J2=Q3Q2Q1Q0112的時(shí)候發(fā)生變化,因此4計(jì)數(shù)器及其應(yīng)用12、掌握中規(guī)模集成計(jì)數(shù)器的使用TTLCMOS1CC40192是同步十進(jìn)制可逆計(jì)數(shù)器,具有雙時(shí)鐘輸入,并具有清除和置數(shù)5-9-1所示。9-1CC40192LD—CPU—CPDCO—非同步進(jìn)位輸出端BO—非同步借位輸出端D0、D1、D2、D3Q0、Q1、Q2、Q3—CR—清除端CC401925-9-15-9-1CR為高電平“1”時(shí),計(jì)數(shù)器直接清零;CR置低電平則執(zhí)行其它功CRLDD0、D1、D2、D3置入計(jì)數(shù)器。CR為低電平,LDCPDCPU8421碼十CPU接高電平,計(jì)數(shù)脈沖由減計(jì)數(shù)端CPD5-9-284210~9十個(gè)數(shù),為了擴(kuò)大計(jì)數(shù)器范圍,常用多個(gè)5-9-2CC40192COCPU端構(gòu)成的5-9-2CC40192級(jí)聯(lián)電路NMM<N,CC4019265-9-5CC401924215-9-31、2、11,12、1120數(shù)。如圖所示,當(dāng)計(jì)數(shù)到13CC40192(2)〔時(shí)十位〕直接置成0000CC40192(1)00015-9-412進(jìn)制計(jì)數(shù)器1、+5V2345678CC40192×3CC4011(74LS00)1CC40192CRLDD3、D2、D1、D0Q3、Q2、Q1、Q0接實(shí)驗(yàn)設(shè)備的一個(gè)A、B、C、D;COBO5-9-1逐項(xiàng)測(cè)試并判斷該集成塊的0CR=0CR=0,CPU,CPDLD=0LD=1。CR=0,LD=CPD=1,CPU10個(gè)單次脈沖,8421碼十進(jìn)制狀態(tài)轉(zhuǎn)換表進(jìn)行;輸出狀態(tài)變化是否發(fā)CPU的上升沿。CR=0,LD=CPU=1,CPD3)CRLD、數(shù)據(jù)ABCD,CO、BO5-9-1測(cè)試,其結(jié)果與5-9-1相一致。25-9-2CC401921Hz00—995-9-2(1)CPCR1=0LD1=1Q3CPU1=1,BO12CPD2CR2=0LD2=1BO200460進(jìn)制計(jì)數(shù)器并進(jìn)行實(shí)驗(yàn)。55-9-4實(shí)驗(yàn)報(bào)告1.熟悉硬件描述語(yǔ)言軟件的使用。2.3.useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entitycnt10isport(clk,rst,en,load:instd_logic;data:instd_logic_vector(3downtoarchitecturebehavofcnt10isbeginif(load='0')thenq:=data;elseifq'0');endif;endif;endif;endif;ifq="1001"the
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