![《電子應用技術》授課計劃教案 15.項目9-1組合邏輯電路的設計(教案)_第1頁](http://file4.renrendoc.com/view10/M00/02/25/wKhkGWesckqAK45RAAHeNpRJdOo194.jpg)
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PAGEPAGE4廣西工業(yè)職業(yè)技術學院教案首頁2022/2023學年第二學期順序號:(15)主講教師職稱教授系、部教學團隊智能制造學院電子教學團隊課程名稱電子應用技術本教案授課學時2學時本次課標題組合邏輯電路的設計授課班級及時間機電22312023年5月4日機電22322023年5月4日教學目標能力目標會設計三人表決器邏輯電路。知識目標1.掌握用小規(guī)模集成電路(SSI)設計組合邏輯電路的方法;2.熟練組合邏輯電路的特點。素質目標培養(yǎng)學生團隊合作能力、組織協(xié)調能力、邏輯思維能力和創(chuàng)新思維能力。培養(yǎng)學生的工作責任心與職業(yè)道德。教學主要內容1.熟悉四人表決器的工作原理。2.學習組合邏輯電路的設計方法。3.設計三人表決器邏輯電路。教學重點、難點重點:通過設計三人表決器、掌握用小規(guī)模集成電路(SSI)設計組合邏輯電路的方法難點:如何由邏輯函數(shù)表達式畫出邏輯電路。備注作業(yè):設計一個三人表決器電路【教學過程設計】課題教學內容教師教學活動學生活動時間分配作業(yè)知識鏈接2:組合邏輯電路的分析與設計1.組合邏輯電路設計;2.組合邏輯電路分析;3.學生設計一個三人表決器電路。1.四人表決器邏輯電路的設計工作任務分析2.組合邏輯電路設計方法講解3.設計舉例設計一個A、B、C三人表決電路。隨時接受學生的咨詢5.組合邏輯電路分析方法講解6.小結4.學生互相交流、討論設計一個三人表決器電路5分鐘15分鐘15分鐘20分鐘20分鐘5分鐘設計一個三人表決器電路【教學內容】組合邏輯電路的設計[工作任務分析]邏輯要求:當表決某個提案時,多數(shù)人(三人以上)同意,提案通過。要求用與非門設計。(1)列出四人表決器的功能真值表。(2)由真值表寫出邏輯表達式并化簡,然后轉換為與非表達式。(3)畫出邏輯電路圖[設計方法講解]一組合邏輯電路的設計給定邏輯功能,要求畫出實現(xiàn)該邏輯功能的組合邏輯電路圖,這是組合邏輯電路設計的任務。組合邏輯電路設計的一般步驟如下:(1)根據(jù)實際問題,定義輸入邏輯變量與輸出邏輯變量,然后列出真值表。(2)根據(jù)列出的真值表寫出輸出函數(shù)表達式。(3)將輸出表達式化簡為最簡的與或表達式。(4)根據(jù)電路要求變換表達式,畫出邏輯電路圖(一般用與非門)。[設計舉例]【例】設計一個A、B、C三人表決電路。當表決某個提案時,多數(shù)人同意,提案通過,同時A具有否決權。用與非門實現(xiàn)。解:(1)分析設計要求,列出真值表。設A、B、C三個人表決同意提案時用1表示,不同意時用0表示;Y為表決結果,提案通過用1表示,通不過用0表示,同時還應考慮A具有否決權。由此可列出表2所示的真值表。輸入輸出ABCY00000101001110010111011100000111表2真值表表2真值表卡諾圖
卡諾圖②將輸出邏輯函數(shù)化簡后,變換為與非表達式。用圖3.4所示的卡諾圖進行化簡,由此可得將上式變換成與非表達式為③根據(jù)輸出邏輯函數(shù)畫邏輯圖。根據(jù)式(3-2)可畫出圖3.5所示的邏輯圖。[學生訓練]工作任務工作任務1(課外作業(yè)練習)設計一個A、B、C三人表決設計一個A、B、C三人表決器電路。當表決某個提案時,多數(shù)人同意,提案通過。要求用與非門實現(xiàn)。工作任務工作任務2(課外作業(yè)練習)有一個火災報警系統(tǒng),設有煙感、溫感和紅外光感三種不同類型的火災探測器。為了防止誤報警,只有當其中兩種或三種探測器發(fā)出探測信號時,報警系統(tǒng)才產生報警信號,試用與非門設計產生報警信號的電路。有一個火災報警系統(tǒng),設有煙感、溫感和紅外光感三種不同類型的火災探測器。為了防止誤報警,只有當其中兩種或三種探測器發(fā)出探測信號時,報警系統(tǒng)才產生報警信號,試用與非門設計產生報警信號的電路。[小結]組合邏輯電路真值表邏輯表達式最簡表達式確定電路功能組合邏輯電路真值表邏輯表達式最簡表達式確定電路功能組合邏輯電路的分析步驟問題提出真值表邏輯表達式化簡變換邏輯圖邏輯表達式問題提出真值表邏輯表達式化簡變換邏輯圖邏輯表達式組合邏輯電路的設計步驟[作業(yè)]設計一個三人表決器電路[云課堂設計]課前:1.請寫出邏輯代數(shù)中反演律的2個公式。2.學習資料:PPT1.請你說出組合邏輯電路的設計步驟。2.組合邏輯電路的設計必須要化簡,電路越簡單,產品成本越低。(對)3.組合邏輯電路無記憶功能,其輸出只取決于輸入信號的現(xiàn)態(tài)。
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