頻率計(jì)調(diào)研報(bào)告.doc

大連科技學(xué)院2016屆本科畢業(yè)生調(diào)研報(bào)大連科技學(xué)院畢業(yè)設(shè)計(jì)（論文）調(diào)研報(bào)告學(xué)生姓名 王運(yùn)運(yùn) 專業(yè)班級(jí) 通信工程2012級(jí)1班 所在院系 電氣工程學(xué)院 指導(dǎo)教師 鞠艷杰 職稱 講師 所在單位 電子電路教研室 完成日期 2016 年 3 月 25 日調(diào)研報(bào)告1 課題來(lái)源及意義 頻率計(jì)又稱為頻率計(jì)數(shù)器，是一種專門(mén)對(duì)被測(cè)信號(hào)頻率進(jìn)行測(cè)量的電子測(cè)量?jī)x器。其功能是實(shí)現(xiàn)信號(hào)的頻率、周期、占空比以及脈寬等指標(biāo)的測(cè)量，在電子測(cè)量、航海、探測(cè)、軍事等眾多領(lǐng)域的。主要由四個(gè)部分構(gòu)成：時(shí)基（T）電路、輸入電路、計(jì)數(shù)顯示電路以及控制電路。EDA為可編寫(xiě)程序設(shè)計(jì)硬件電路設(shè)計(jì)，可重復(fù)下載的優(yōu)勢(shì)非常明顯。這樣做既可節(jié)省時(shí)間又能避免不必要的資源浪費(fèi)。FPGA以硬件描述語(yǔ)言（Verilog或VHDL）所完成的電路設(shè)計(jì)，可以經(jīng)過(guò)簡(jiǎn)單的綜合與布局，快速的燒錄至 FPGA 上進(jìn)行測(cè)試，是現(xiàn)代 IC設(shè)計(jì)驗(yàn)證的技術(shù)主流。這些可編輯元件可以被用來(lái)實(shí)現(xiàn)一些基本的邏輯門(mén)電路（比如AND、OR、XOR、NOT）或者更復(fù)雜一些的組合功能比如解碼器或數(shù)學(xué)方程式。2 國(guó)內(nèi)外研究現(xiàn)狀和發(fā)展趨勢(shì) 2.1 研究現(xiàn)狀： 隨著科學(xué)技術(shù)的發(fā)展，用戶對(duì)電子計(jì)數(shù)器也提出了新的要求。對(duì)于抵擋產(chǎn)品要求使用操作方便，量程（足夠）寬，可靠性能搞，低價(jià)格。而對(duì)于中高檔產(chǎn)品，則要求有高分辨率，高精度，搞穩(wěn)定度，高測(cè)量速率；除通常通用計(jì)數(shù)器所具有的功能外，還要有數(shù)據(jù)處理功能，時(shí)域分析功能等等，或者包含電壓測(cè)量等其他功能。這些要求有的已經(jīng)實(shí)現(xiàn)或者部分實(shí)現(xiàn)，但要真正完美的實(shí)現(xiàn)這些目標(biāo)，對(duì)于生產(chǎn)廠家來(lái)說(shuō)，還有許多工作要做，而不是表面看來(lái)似乎發(fā)展到頭了。 由于微電子技術(shù)和計(jì)算機(jī)技術(shù)的發(fā)展，頻率計(jì)都在不斷地進(jìn)步著，靈敏度不斷提高，頻率范圍不斷擴(kuò)大，功能不斷地增加。在測(cè)試通訊、微波器件或產(chǎn)品時(shí)，通常都是較復(fù)雜的信號(hào)，如含有復(fù)雜頻率成分、調(diào)制的或含有未知頻率分量的、頻率固定的或變化的、純凈的或疊加有干擾的等等。為了能正確地測(cè)量不同類(lèi)型的信號(hào)，必須了解待測(cè)信號(hào)特性和各種頻率測(cè)量?jī)x器的性能。微波計(jì)數(shù)器一般使用類(lèi)型頻譜分析儀的分頻或混頻電路，另外還包含多個(gè)時(shí)間基準(zhǔn)、合成器、中頻放大器等。雖然所有的微波計(jì)數(shù)器都是用來(lái)完成技術(shù)任務(wù)的，但制造廠家都有各自的一套復(fù)雜的計(jì)數(shù)器的設(shè)計(jì)、使得不同型號(hào)的計(jì)數(shù)器性能和價(jià)格會(huì)有所差別，比如說(shuō)一些計(jì)數(shù)器可以測(cè)量脈沖參數(shù)，并提供類(lèi)似于頻率分析儀的頻幕顯示，對(duì)這些功能具有不同功能不同規(guī)格的眾多儀器。我們應(yīng)該視測(cè)試需要正確的選擇，以達(dá)到最經(jīng)濟(jì)和最佳的應(yīng)用效果。 2.2 發(fā)展趨勢(shì)數(shù)字電路制造工業(yè)的進(jìn)步，使得系統(tǒng)設(shè)計(jì)人員能在更小的空間實(shí)現(xiàn)更多的功能，從而提高系統(tǒng)可靠性和速度。現(xiàn)如今，數(shù)字頻率計(jì)已經(jīng)不僅僅是測(cè)量信號(hào)頻率的裝置了，用它還可以測(cè)量方波脈沖的脈寬。在人們的生活中頻率計(jì)也發(fā)揮著越來(lái)越重要的作用，比如用數(shù)字頻率計(jì)來(lái)監(jiān)控生產(chǎn)過(guò)程，這樣可以及時(shí)發(fā)現(xiàn)系統(tǒng)運(yùn)行中的異常情況，以便給人們爭(zhēng)取時(shí)間處理。 除此之外，它還可以應(yīng)用于工業(yè)控制等其它領(lǐng)域。在傳統(tǒng)的電子測(cè)量?jī)x器中，示波器在進(jìn)行頻率測(cè)量是頻率較低，誤差較大。頻率儀可以準(zhǔn)確的測(cè)量頻率并顯示被測(cè)信號(hào)的頻譜，但測(cè)量速度較慢，無(wú)法實(shí)時(shí)的跟蹤捕捉到被測(cè)信號(hào)的頻率變化。正是由于頻率計(jì)能夠快速準(zhǔn)確的捕捉到被測(cè)信號(hào)頻率的變化，因此頻率計(jì)擁有非常廣泛的引用范圍。 在傳統(tǒng)生產(chǎn)制造企業(yè)中，頻率計(jì)被廣泛應(yīng)用在產(chǎn)線的生產(chǎn)測(cè)試中。頻率計(jì)能夠快速的捕捉到晶體振蕩器輸出的頻率變化，用于通過(guò)使用頻率計(jì)能夠迅速的發(fā)現(xiàn)有故障的晶振產(chǎn)品，確保產(chǎn)品質(zhì)量。在計(jì)量實(shí)驗(yàn)室中，頻率計(jì)被用來(lái)對(duì)各種電子測(cè)量設(shè)備的本地振蕩器進(jìn)行校準(zhǔn)。在無(wú)線通訊測(cè)試中，頻率計(jì)既可以被用來(lái)對(duì)無(wú)線通訊基站的主時(shí)鐘進(jìn)行校準(zhǔn)，還可以用來(lái)對(duì)電臺(tái)的跳幀信號(hào)進(jìn)行分析。 對(duì)于頻率計(jì)的設(shè)計(jì)目前也有專用芯片可以實(shí)現(xiàn)，如利用MAXIM公司的ICM7240來(lái)設(shè)計(jì)頻率計(jì)。但由于 這種芯片的計(jì)數(shù)頻率比較低，遠(yuǎn)不能達(dá)到在一些場(chǎng)合需要測(cè)量很搞的頻率要求，而測(cè)量精度也受到芯片本身的限制。提出的用AT8C52單片機(jī)設(shè)計(jì)頻率計(jì)的方法可以解決這些問(wèn)題，實(shí)現(xiàn)精度較高、等精度和寬范圍頻率計(jì)的設(shè)計(jì)。3 研究?jī)?nèi)容 頻率計(jì)的基本原理是用一個(gè)頻率穩(wěn)定度高的頻率源作為基準(zhǔn)時(shí)鐘，對(duì)比測(cè)量其他信號(hào)的頻率。通常情況下計(jì)算每秒內(nèi)待測(cè)信號(hào)的脈沖個(gè)數(shù)，即閘門(mén)時(shí)間為 1S。閘門(mén)時(shí)間可以根據(jù)需要取值，大于或小于1S都可以。閘門(mén)時(shí)間越長(zhǎng)，得到的頻率值就越準(zhǔn)確，但閘門(mén)時(shí)間越長(zhǎng)，則每測(cè)一次頻率的間隔就越長(zhǎng)。閘門(mén)時(shí)間越短，測(cè)得的頻率值刷新就越快，但測(cè)得的頻率精度就受影響。一般取 1S作為閘門(mén)時(shí)間。數(shù)字頻率計(jì)的關(guān)鍵組成部分包括測(cè)頻控制信號(hào)發(fā)生器，計(jì)數(shù)器，鎖存器，譯碼驅(qū)動(dòng)電路和顯示電路。數(shù)字頻率計(jì)的功能,設(shè)計(jì)采用 EDA 技術(shù)，完成功能模塊的劃分，利用測(cè)頻法的原理和 VHDL 語(yǔ)言，分別用VHDL 語(yǔ)言完成底層模塊的設(shè)計(jì)和以原理圖的方法完成頂層模塊的設(shè)計(jì)，采用自頂向下的設(shè)計(jì)方法，實(shí)現(xiàn)了 1Hz10kHz 測(cè)量范圍的的數(shù)字頻率計(jì)，并在軟件平臺(tái)下分別對(duì)設(shè)計(jì)項(xiàng)目、各個(gè)模塊以及頂層模塊進(jìn)行仿真分析。4 研究方法及手段第一，通過(guò)查閱資料、自我學(xué)習(xí)以及向他人請(qǐng)教，掌握頻率計(jì)的概念和基本思路，并在此基礎(chǔ)上的方法。第二，自我分析，查閱資料提出頻率計(jì)實(shí)現(xiàn)的方法原理；第三，在掌握頻率計(jì)實(shí)現(xiàn)算法的基礎(chǔ)上，根據(jù)VHDL語(yǔ)言的特點(diǎn)及應(yīng)用例子將頻率計(jì)的控制、計(jì)數(shù)、鎖存、譯碼等電路模塊進(jìn)行VHDL文本描述。第四，利用Quartus進(jìn)行編譯、波形分析、仿真、調(diào)試程序。可行性分析：FPGA的結(jié)構(gòu)靈活，其邏輯單元、能滿足各種設(shè)計(jì)需求，其速度快、功耗低，通用性強(qiáng)，特別適用于復(fù)雜系統(tǒng)的設(shè)計(jì)。并且利用VHDL工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言,采用自頂向下(ToptoDown)和基于庫(kù)(Library-based)的設(shè)計(jì),設(shè)計(jì)者不但可以不必了解硬件結(jié)構(gòu)設(shè)計(jì),而且將使系統(tǒng)大大簡(jiǎn)化,提高整體的性能和可靠性，因此該設(shè)計(jì)比較容易實(shí)現(xiàn)5 進(jìn)度計(jì)劃第一周：填寫(xiě)并審查大連科技學(xué)院畢業(yè)設(shè)計(jì)（論文）課題進(jìn)度計(jì)劃與考核表并確定研究?jī)?nèi)容。第二周：提交調(diào)研報(bào)告并進(jìn)行外文翻譯的查找準(zhǔn)備工作。第三周：提交外文翻譯資料，并學(xué)習(xí)VHDL語(yǔ)言，語(yǔ)法。第四周：閱讀國(guó)內(nèi)外有關(guān)頻率計(jì)的相關(guān)資料并總結(jié)頻率計(jì)的特點(diǎn)，繼續(xù)學(xué)習(xí)編程語(yǔ)言VHDL的語(yǔ)法。第五周：總結(jié)分析頻率計(jì)的工作原理，進(jìn)行分塊總結(jié)，確定總體方案。第六周：閱讀資料，理解掌握頻率計(jì)各個(gè)分塊工作原理，繼續(xù)學(xué)習(xí)編程語(yǔ)言VHDL的語(yǔ)法。第七周：根據(jù)總體方案對(duì)各個(gè)分模塊進(jìn)行編程實(shí)現(xiàn)。第八周：將各個(gè)模塊進(jìn)行綜合調(diào)試。第九周：檢查驗(yàn)證最終綜合模塊的工作情況，檢查修改各個(gè)模塊的工作情況，并修改錯(cuò)誤。第十周：完善修改綜合程序，進(jìn)行最終的結(jié)果仿真，驗(yàn)證結(jié)果，撰寫(xiě)畢業(yè)論文提綱，規(guī)劃論文內(nèi)容，并開(kāi)始著手寫(xiě)畢業(yè)論文初稿。第十一周：整理材料，文件圖標(biāo)等，完成畢業(yè)論文的撰寫(xiě)，交指導(dǎo)教師審查。第十二周：論文修改，打印，裝訂成冊(cè)，并提交。復(fù)習(xí)各種資料，準(zhǔn)備答辯。第十三周：答辯，畢業(yè)論文成績(jī)?cè)u(píng)定。第十四周：整理畢業(yè)論文及相關(guān)資料，完成成冊(cè)。6 參考文獻(xiàn)1徐輝,王祖強(qiáng),王照君.基于高速串行BCD碼除法的數(shù)字頻率計(jì)的設(shè)計(jì). 電子技術(shù)應(yīng)用, 2002, 31(09) : 6167 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