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1、北京理工大學(xué)珠海學(xué)院20092010學(xué)年第一學(xué)期電路分析基礎(chǔ) A期末試卷(B)誠(chéng)信聲明考場(chǎng)是嚴(yán)肅的,作弊是可恥的,對(duì)作弊人的處分是嚴(yán)厲的。我承諾遵守考場(chǎng)紀(jì)律,不存在抄襲及其它違紀(jì)行為。考生(承諾人)簽字:專業(yè):班級(jí):學(xué)號(hào):適用年級(jí)專業(yè):2008級(jí)信息工程、自動(dòng)化專業(yè)試卷說(shuō)明:閉卷,考試時(shí)間120分鐘題號(hào)-一-二二三四五六七總分得分、填空題(每個(gè)空1分,共20分)【得分:】1. 當(dāng)電壓u和電流i取關(guān)聯(lián)參考方向時(shí),理想電容元件C的電壓與電流間關(guān)系i CdUdt,理想電感元件L的電壓與電流間關(guān)系為dt2. 若電路中a、b、c三點(diǎn)電位分別為3V、1V、2V,則Uhb= 2 VUcb= 1 V 。3.
2、一個(gè)阻值為10Q的電阻,其兩端電壓為5V,則通過(guò)它的電流 A 。當(dāng)通過(guò)它的電流為1.5A時(shí),它兩端的電壓是15 V。當(dāng)電阻兩端沒(méi)有加電 壓時(shí),它的電流是 0 A ,電阻是 10Qo4對(duì)于一個(gè)具有b條支路和n個(gè)結(jié)點(diǎn)的電路,使用支路電流法求解時(shí),可以列出n-1個(gè)獨(dú)立的KC方程,b-(n-1)個(gè)獨(dú)立的KVL方程。5. 兩個(gè)電路等效變換的條件是對(duì)等效電路以外的部分,即端口的伏安關(guān)系關(guān)系保證相同。6. 已知1& 50 30,頻率為 ,則瞬時(shí)值u= 50.2sin( t 30 )。7. RLC串聯(lián)諧振電路工作的基本特點(diǎn)是電壓 和電流 同相,此時(shí)得2 LC到的電路諧振頻率fo為。8. 正弦量的三要素
3、是指幅值、 頻率和。9. 已知乙=3+j3 Q,乙=3-j3 Q,若乙、Z2串聯(lián)其等效阻抗為 6 Q若乙、乙并聯(lián)其等效阻抗為 3 Qo二、判斷題(正確的劃V,錯(cuò)誤的劃X,每小題 2分,共20分)【得分:】1. 電路如圖所示,5V電壓源吸收的功率為-15W0 ( X )+2. 線性電路用疊加定理求解時(shí)能夠疊加電壓、電流和功率。(X )Vi: 10V, V2: 30V,則US=40Vo(X5. 在一階RC電路中,若C不變,R越大,則換路后過(guò)渡過(guò)程時(shí)間越長(zhǎng)。6. 正弦穩(wěn)態(tài)電路的電容上,電流i與電壓u是關(guān)聯(lián)參考方向,則i = 3 Cu=(X )7. 電流表的讀數(shù)是所測(cè)量電流的最大值。(X )8. 電路
4、發(fā)生并聯(lián)諧振時(shí),電路的阻抗為最大值。(X)9. 電容的換路定律為ic(0 ) ic(0 ) o (X )(V )10. 對(duì)于線性電路,全響應(yīng)等于零輸入響應(yīng)與零狀態(tài)響應(yīng)之和、在RLC串聯(lián)電路中,已知 R = 5 Q , L = 10mH , C = 200卩F,接在電壓u =100 .2 sin ( 1000t +300 )V 電源上。求:(1)感抗、容抗、總阻抗。(2)電流的有效值及其瞬時(shí)值表達(dá)式(3)電路的有功功率功率P。解:(1)感抗:Xl31000 10 10 10(2 分)(共16分)【得分:】(3)總阻抗:Z R j(XLXc)5j(10 5)5j5()Z 5 2 45(2 分)&a
5、mp; &100 30Z 51 2 4510 215(2 分)電流有效值為:1UZ1005、2102A(2 分)電流瞬時(shí)值為:i20si n(100t15 )A(2 分)有功功率P UI cos100 10.°cos( 15 )(1 分)(2 分)1000(2)(2 分)容抗:XcC1000 2 0.971365.821200 106 5(1 分)四、求圖示電路的丨1、丨2、12、R、F2和Uso (共12分)【得分:+US+22解:I, 2 1 1A(2分)Ri - 5(2分)12丨2 1A(2分)2U2 5 2 3V(2分)R2 3 3(2分)1Us 2 3 5 11V(2分)五、試用疊加定理畫出各電源單獨(dú)作用時(shí)的計(jì)算電路并求出圖示電路的電壓U。(共12分)【得分:(共8分)六、應(yīng)用節(jié)點(diǎn)電壓法列出下圖所示電路可解的電壓方程?!镜梅郑骸科摺⑷缦聢D所示電路已處于穩(wěn)態(tài),t 0時(shí),開關(guān)K1打開而K2閉合,
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