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1、C. 10試卷總分:100測(cè)試時(shí)間:?單選題一、單選題(共 50道試題,共 100 分。)V1. 處理 的電子電路是數(shù)字電路。A.交流電壓信號(hào)B.直流信號(hào)C.模擬信號(hào)D.數(shù)字信號(hào)滿(mǎn)分:2 分2. 用卡諾圖化簡(jiǎn)具有無(wú)關(guān)項(xiàng)的邏輯函數(shù)時(shí),若用圈1法,在包圍圈內(nèi)的是按處理;在包圍圈外的是按 處理。A. 1 , 1B. 1 , 0C. 0,0D.不確定。 滿(mǎn)分:2 分3.A.變?yōu)?B.保持1不變C.保持0不變D.無(wú)法確定 滿(mǎn)分:2 分4. 10- 4線優(yōu)先編碼器允許同時(shí)輸入 路編碼信號(hào)。A. 1B. 9D.多 滿(mǎn)分:2 分5. 標(biāo)準(zhǔn)TTL門(mén)關(guān)門(mén)電平 UOff之值為。 A.B.C.D. 滿(mǎn)分:2 分6.

2、數(shù)字電路中,晶體管的工作于 狀態(tài)。A.放大B.飽和C.截止D.開(kāi)關(guān) 滿(mǎn)分:2 分7. TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是 A. U OL<B. U OL>C. U OL<D. U OL= 滿(mǎn)分:2 分8. 三極管開(kāi)關(guān)電路中,影響開(kāi)關(guān)速度的主要因素是A. t d B. t r C. t sD. t f滿(mǎn)分:2 分9. TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是 oA. U OH>B. U OH>C. U OH>D. U O=滿(mǎn)分:2 分10. 利用2個(gè)74LS138和1個(gè)非門(mén),可以擴(kuò)展得到1個(gè) 線譯碼器。A. 2-4B. 3-8C. 4-16D.無(wú)法確定。滿(mǎn)分:2

3、 分11. 當(dāng) 時(shí),增強(qiáng)型 NMO潸相當(dāng)于開(kāi)關(guān)接通。A.B.C.D.滿(mǎn)分:2 分12.A.B.C.D.滿(mǎn)分:2 分13. 門(mén)電路輸入端對(duì)地所接電阻RC Roff時(shí),相當(dāng)于此端 。A.接邏輯“1”B.接邏輯“0”C.接電壓D.邏輯不定滿(mǎn)分:2 分14. 格雷碼與奇偶校馬碼又被稱(chēng)為 oA.有權(quán)碼B.符號(hào)碼C.無(wú)權(quán)碼D.可靠性代碼滿(mǎn)分:2 分15. 門(mén)級(jí)組合電路是指 的電路。A.由二、三極管開(kāi)關(guān)組成B.由各種門(mén)電路組成且無(wú)反饋線C.由組合器件組成D.由各種數(shù)字集成電路組成滿(mǎn)分:2 分16. 某邏輯電路由一個(gè)功能塊電路組成,整體電路的邏輯功能與這個(gè)功能塊原來(lái)的邏輯功能 OA. 一定相同B. 一定不同C

4、.不一定相同D.無(wú)法確定滿(mǎn)分:2 分17.A.B.C.D.滿(mǎn)分:2 分18. 二極管與門(mén)的兩輸入信號(hào)AB=時(shí),輸出為高電平A. 00B. 01C. 10D. 11滿(mǎn)分:2 分19. 數(shù)字電路中使用的是 oA.二進(jìn)制B.八進(jìn)制C.十進(jìn)制D.十六進(jìn)制滿(mǎn)分:2 分20.A.B.C.D.滿(mǎn)分:2 分21. 二極管或門(mén)的兩輸入信號(hào)AB=時(shí),輸出為低電平A. 00B. 01C. 10D. 11滿(mǎn)分:2 分22. 在設(shè)計(jì)過(guò)程中,邏輯函數(shù)化簡(jiǎn)的目的是 oA.獲得最簡(jiǎn)與或表達(dá)式B.用最少的邏輯器件完成設(shè)計(jì)C.用最少的集電門(mén)完成設(shè)計(jì)D.獲得最少的與項(xiàng)滿(mǎn)分:2 分23. 數(shù)字系統(tǒng)中,降低尖峰電流影響,所采取的措施是

5、 oA.接入關(guān)門(mén)電阻B.接入開(kāi)門(mén)電阻C.接入濾波電容D.降低供電電壓滿(mǎn)分:2 分24. TTL與非門(mén)閾值電壓 Ut的典型值是 。A.B.C. 2VD.滿(mǎn)分:2 分25. 七段譯碼器74LS47的輸入是4位,輸出是七段反碼。A.二進(jìn)制碼B.七段碼C.七段反碼D. BCD 碼滿(mǎn)分:2 分26. 用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個(gè) B.固定接1A.非門(mén)B.與非門(mén)C.或門(mén)D.或非門(mén)滿(mǎn)分:2 分27. 用不同數(shù)制的數(shù)字來(lái)表示2007,位數(shù)最少的是 oA.二進(jìn)制B.八進(jìn)制C.十進(jìn)制D.十六進(jìn)制滿(mǎn)分:2 分28. 2007個(gè)1連續(xù)異或的結(jié)果是 。A. 0B. 1C.不唯一D.邏輯概念錯(cuò)誤滿(mǎn)

6、分:2 分29. 電源電壓VDd為10V的CMO喋成模擬開(kāi)關(guān)可接通幅度為 的信號(hào)A. 10 0VB. 0 10VC. 0 Vdd/2D. >10V滿(mǎn)分:2 分30. 用三態(tài)門(mén)可以實(shí)現(xiàn)“總線”連接,但其“使能”控制端應(yīng)為 oA.固定接0C.同時(shí)使能D.分時(shí)使能滿(mǎn)分:2 分31. 已知二輸入邏輯門(mén)的輸入A B和輸出F的波形如圖所示,這是哪種邏輯門(mén)的波形A.與非B.或非C.同或D.與滿(mǎn)分:2 分32. 不屬于CMO颼輯電路優(yōu)點(diǎn)的提法是 。A.輸出高低電平理想B.電源適用范圍寬C.抗干擾能力強(qiáng)D.電流驅(qū)動(dòng)能力強(qiáng)滿(mǎn)分:2 分33. 在函數(shù)F=AB+CD勺真值表中,F(xiàn)=1的狀態(tài)共有多少個(gè)A. 2B.

7、 4C. 7D. 16滿(mǎn)分:2 分34. 74LS138有 個(gè)譯碼輸入端。A. 1B. 3C. 8D.無(wú)法確定滿(mǎn)分:2 分35. 組合電路分析的2果是要獲得 oA.邏輯電路圖B.電路的邏輯功能C.電路的真值表D.邏輯函數(shù)式滿(mǎn)分:2 分36. TTL電路中,能實(shí)現(xiàn)“線與”邏輯。A.異或門(mén)B. OC 門(mén)C. TS 門(mén)D.與或非門(mén)滿(mǎn)分:2 分37. 數(shù)字電路中最常用的BCD碼是。A. 5421 碼B. 8421 碼C.余3碼D.循環(huán)碼滿(mǎn)分:2 分38.A.B.C.D.滿(mǎn)分:2 分39. 門(mén)電路輸入端對(duì)地所接電阻R> Ron時(shí),相當(dāng)于此端 A.接邏輯“1”B.接邏輯“0”C.接電壓D.邏輯不定滿(mǎn)

8、分:2 分40. TTL門(mén)電路的開(kāi)門(mén)電阻的典型值為 oA. 3k QB. 2k QC.700 QD. 300 Q滿(mǎn)分:2 分41. 格雷碼的優(yōu)點(diǎn)是 oA.代碼短B.記憶方便C.兩組相鄰代碼之間只有一位不同D.同時(shí)具備以上三者滿(mǎn)分:2 分42. 組合電路設(shè)計(jì)的結(jié)果一般是要得到 A.邏輯電路圖B.電路的邏輯功能C.電路的真值表D.邏輯函數(shù)式滿(mǎn)分:2 分43. 標(biāo)準(zhǔn)TTL門(mén)開(kāi)門(mén)電平 UOn之值為 oA.B.C.D. 2V滿(mǎn)分:2 分44. 數(shù)字信號(hào)是 oA.時(shí)間和幅值上連續(xù)變化的信號(hào)B.時(shí)間和幅值上離散的信號(hào)C.時(shí)間上連續(xù)、幅值上離散變化的信號(hào)D.時(shí)間上離散、幅值上連續(xù)變化的信號(hào)滿(mǎn)分:2 分45.A.B.C.D.滿(mǎn)分:2 分46. 兩個(gè)開(kāi)關(guān)控制一盞燈,只有兩個(gè)開(kāi)關(guān)都閉合時(shí)燈才不亮,則該電路的邏輯關(guān)系是 A.與非B.或非C.同或D.異或滿(mǎn)分:2 分47. 與4位串行進(jìn)位加法器比較,使用超前進(jìn)位全加器的目的是 oA.完成自動(dòng)加法進(jìn)位B.完成4位加法C.提高運(yùn)算速度D.完成4位串行加法滿(mǎn)分:2 分48.A.B.C.D.滿(mǎn)分:2 分49. 某集成電路封裝內(nèi)集成有4個(gè)與非門(mén),它們輸出全

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