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1、線性移位寄存器LFSR電路設(shè)計(jì) ?1234567891011121314151617module LFSR  (     input clk,     input rst_n,     output out );   reg 9:0 q=10'b1010101010; wire tap = q2q9; assign out = q9;   always (posedge clk,negedge rst_n) if(!r

2、st_n)     q <= 10'b1010101010; else    q <= q8:0,tap; endmodule將LFSR賦初始值1010101010，最低為q0=q2 xor  q9,輸出為最高位q9;測(cè)試程序如下：?12345678910111213141516171819202122232425262728293031323334timescale 1 ns/1 ns module LFSR_tb();   localparam  T=

3、20; / clock period      reg     clk,rst_n; wire    out;   LFSR LFSR_tb (     .clk(clk),     .rst_n(rst_n),     .out(out) );     always begin 

4、;   clk = 1'b1;     #(T/2);     clk = 1'b0;     #(T/2); end  initialbegin    rst_n   = 1'b1;     #(T/2);     rst_n   = 1

5、9;b1;     #(100*T);     $stop; end  endmodule功能和時(shí)序仿真結(jié)果如下：測(cè)試文件如下：?12345678910111213141516171819202122232425262728293031323334timescale 1 ns/1 ns module LFSR_tb();   localparam  T=20; / clock period      reg 

6、;    clk,rst_n; wire    out;   LFSR LFSR_tb (     .clk(clk),     .rst_n(rst_n),     .out(out) );     always begin    clk = 1'b1;     #(T/2);     clk = 1'b0;     #(T/2); end  initialbegin    rst_n   = 1'b0;     #(T/2);     rst_n   = 1'b1;  

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