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1、 姓名學(xué)號(hào)實(shí)驗(yàn)組實(shí)驗(yàn)時(shí)間2019.6指導(dǎo)教師成績(jī)實(shí)驗(yàn)項(xiàng)目名稱序列檢測(cè)器的設(shè)計(jì)實(shí)驗(yàn)?zāi)康囊?、?shí)驗(yàn)?zāi)康?、了解用狀態(tài)機(jī)圖的方法實(shí)現(xiàn)序列檢測(cè)器的方法。2、實(shí)現(xiàn)一個(gè)11010串行序列檢測(cè)器,用VHDL語(yǔ)言實(shí)現(xiàn)。3、掌握元件例化語(yǔ)句的使用方法,掌握利用VHDL語(yǔ)言實(shí)現(xiàn)層次化設(shè)計(jì)的方法。實(shí)驗(yàn)原理標(biāo)志Z在最后一用。XCPRST圖11010S2機(jī)序列檢測(cè)4-1序列檢測(cè)示意圖411,S3表示收到達(dá)和遙測(cè)等領(lǐng)域中(110101后,輸出1,0。Z-2所示S01,S11,110,S4表示收到1101。學(xué)院:專業(yè):電子信息工程班級(jí):X=1X=1X=1X=1X=1SS00S20S40YNYNNYZ=1S10S30YNNY實(shí)
2、驗(yàn)quartusII9.0軟件。電腦、儀器X=1X=1X=1X=1X=1SS00S20S40YNYNNYZ=1S10S30YNNY實(shí)驗(yàn)quartusII9.0軟件。電腦、儀器圖4-2產(chǎn)生11010的狀態(tài)機(jī)圖實(shí)驗(yàn)內(nèi)容實(shí)驗(yàn)內(nèi)容1、用VHDL語(yǔ)言編寫11010序列檢測(cè)器源程序。2、用VHDL語(yǔ)言設(shè)計(jì)一個(gè)包含11010和一個(gè)不包含實(shí)驗(yàn)三基礎(chǔ)上修改)。將上述兩個(gè)序列發(fā)生器用元件例化語(yǔ)句,構(gòu)成一個(gè)頂層文件,口編譯,仿真。11010序列的序列發(fā)生器(可在實(shí)驗(yàn)步驟1、建立工程2、添加VHDL文件3、編寫VHDL程序4、改口5、導(dǎo)出電路圖波形仿真1、用VHDL語(yǔ)言編寫11010序列檢測(cè)器源程序libraryie
3、ee;useieee.std_logic_1164.all;實(shí)驗(yàn)數(shù)據(jù)entityxuleijianceisport(clk,rst,x:inSTD_LOGIC;z:outSTD_LOGIC);endxuleijiance;architecturebehaveofxuleijianceisTYPESTATEis(S0,S1,S2,S3,S4);SIGNALS:STATE;beginPROCESS(clk,rst)BEGINIFrst=0THENSIFx=1THENSIFx=1THENS=S2;ELSESIFx=0THENSIFx=1THENS=S4;ELSESIFx=1THENS=S2;ELSE
4、S=S0;ENDIF;ENDCASE;ENDIF;ENDPROCESS;ZIJ4e1MUHlCDCMfUl.ItSTCffl,WillieCOMPONENTxuleijianceport(clk,rst,x:inSTD_LOGIC;z:outSTD_LOGIC);ENDCOMPONENT;SIGNALS:Ji,H=|U.iAPltfl/ENDbehave;|&qroWmRn.|苗vhluUxlaulWlUALaIJ4e1MUHlCDCMfUl.ItSTCffl,WillieCOMPONENTxuleijianceport(clk,rst,x:inSTD_LOGIC;z:outSTD_LOGIC
5、);ENDCOMPONENT;SIGNALS:STD_LOGIC;BEGINU1:xulieportMAP(clk,rst,S);U2:xuleijianceportMAP(clk,rst,S,z);DODO:EH*pry*xiLUisllKacnXLsj31Lu1-tMlEitpiXesa修,awwtHtU,沒有我們感興趣的結(jié)果。因?yàn)樾蛄邪l(fā)生器產(chǎn)生的序列不為11010001100101Mi4許HsrlflTmiilS-ra1*PmiH釜沿enlB-i-riKMlpfciESDI”SWlpM婚NUMELSIFclkEVENTANDclk=1THENIFQ=110THENQ=000;ELSEQ=Q+1;ENDIF;ENDIF;endprocess;x1(EVAPLCimWT4tBWWNLHWflO”tfWL*purtJikSjcnvdlufe-aJmA-vuiLu
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