任務(wù)三時(shí)序邏輯電路及其應(yīng)用4任意進(jìn)制計(jì)數(shù)器教學(xué)課件_第1頁
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任務(wù)三時(shí)序邏輯電路及其應(yīng)用3.1寄存器3.2二進(jìn)制計(jì)數(shù)器3.3十進(jìn)制計(jì)數(shù)器34任意進(jìn)制計(jì)數(shù)器小結(jié)任務(wù)三時(shí)序邏輯電路及其應(yīng)用3,1寄存器3.2二進(jìn)制計(jì)數(shù)器3.3十進(jìn)制計(jì)數(shù)器34任意進(jìn)制計(jì)數(shù)器本章小結(jié)任務(wù)三時(shí)序邏輯電路及其應(yīng)用31寄存器3,1,1數(shù)碼寄器將僅僅具有接收數(shù)碼、儲(chǔ)存數(shù)碼和刪除原有數(shù)碼功能的寄存器稱為數(shù)碼寄存器。寄存器存儲(chǔ)數(shù)據(jù)的位數(shù)等于構(gòu)成它的觸發(fā)器的個(gè)數(shù)任務(wù)三時(shí)序邏輯電路及其應(yīng)用電路如圖3.1所示圖3.1四位數(shù)碼寄存器任務(wù)三時(shí)序邏輯電路及其應(yīng)用當(dāng)接收脈沖CP的上升沿到達(dá)時(shí),寄存器接收新的藪據(jù),H仔人各觸發(fā)器之中,同時(shí)田Q~Q3輸出更新后的數(shù)據(jù)寄存器的數(shù)據(jù)可以保存到下一個(gè)CP脈沖的上升沿到來之前數(shù)碼寄存器接收數(shù)碼時(shí)所有代碼同時(shí)讀入,且同時(shí)出現(xiàn)在輸出端,這種方式稱為并行輸入、并行輸出方式任務(wù)三時(shí)序邏輯電路及其應(yīng)用3,12移位寄存器1單向移位寄存器(1)電路結(jié)構(gòu)四位單向移位寄存器如圖3.2所示任務(wù)三時(shí)序邏輯電路及其應(yīng)用Q3FA一)圖3.2四位單向移寄存器任務(wù)三時(shí)序邏輯電路及其應(yīng)用(2)邏輯功能分析①驅(qū)動(dòng)方程Do=dDi=

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