Synopsys HAPS系列基于FPGA的ASIC原型最快捷的交付方式-1

SynopsysHAPS系列基于FPGA的ASIC原型最快捷的交付方式硅片tapeout前用于系統(tǒng)驗證和硬件/軟件集成的原型對于現(xiàn)在的IP和SoC設(shè)計團(tuán)隊而言必不可少。但是開發(fā)原型的時間很短，從RTL完備到獲得芯片時間也很少，這意味著原型開發(fā)工程師必須盡快交付操作原型，他們所承受的壓力巨大。HAPSProtoCompiler通過設(shè)計規(guī)劃、邏輯綜合、調(diào)試以及連接至其他驗證環(huán)境（例如SynopsysVCS和ZeBu）等自動化功能，為IP驗證和軟件開發(fā)減少系統(tǒng)啟動的時間和難度，只要該系統(tǒng)是基于SynopsysHAPS系列的。原型軟件同HAPS系列緊密集成，以便實現(xiàn)傳統(tǒng)“廉價”電路板和FPGA設(shè)計工具均無法企及的系統(tǒng)性能。功能：

HAPSProtoCompiler的功能用于加快實現(xiàn)原型的時間。這主要關(guān)注啟動時間和計劃的改善，從而使得處理時間最多可縮短至競爭產(chǎn)品的50%。HAPSProtoCompiler技術(shù)擁有高效的數(shù)據(jù)模型、編譯器和分割工具，并通過使用基于FPGA原型的SynopsysHAPS系列，來提高工程師的工作效率。該系統(tǒng)可在設(shè)計流程的關(guān)鍵進(jìn)程點中實現(xiàn)短迭代循環(huán)，而完成該部分向來很耗時。通過HAPS系列專用的快速編譯器和時鐘轉(zhuǎn)換，來加速ASIC設(shè)計的編譯和轉(zhuǎn)換。2.5億ASIC門分割引擎可自動生成適合多個FPGA的可行設(shè)計，僅需幾分鐘便能交付結(jié)果，相比之前的幾小時更加便捷。重復(fù)使用對于ASIC設(shè)計和原型來說都是最佳實踐。HAPS硬件架構(gòu)的模塊化性質(zhì)結(jié)合HAPSProtoCompiler的增量和層次化項目管理功能，可避免冗長的重新編譯及布局布線周期，從而加快啟動時間。原型項目所開發(fā)的HAPS-DX及HAPS系列系統(tǒng)直接兼容，允許原型開發(fā)團(tuán)隊將單個ASIC模塊或IP原型項目集成至較大型的子系統(tǒng)中，從而實現(xiàn)完整的SoC驗證場景。功能

優(yōu)勢

針對HAPS的FPGA綜合

DesignWare庫兼容

HAPS系列事先驗證ASICIP便于遷移

時序驅(qū)動的綜合

最大化系統(tǒng)時鐘速度

系統(tǒng)規(guī)劃

系統(tǒng)硬件目標(biāo)定位

管理HAPS子板、堆疊系統(tǒng)、互聯(lián)和存儲器

大容量設(shè)計分割

數(shù)百萬ASIC門級設(shè)計，只需幾分鐘便可找到分割解決方案

硬件集成和重新使用

快速將原型模塊組成較大型的子系統(tǒng)

調(diào)試和啟動

支持多FPGA無縫調(diào)試

調(diào)試邏輯與設(shè)計模塊的制定位置無關(guān)

SynopsysVerdi/Siloti數(shù)據(jù)交換

快速導(dǎo)入驗證視圖并進(jìn)行根本原因分析

大容量調(diào)試樣例儲存

改善信號可視性并查看較長時間的系統(tǒng)運行

基于事務(wù)處理器的驗證

AMBA事務(wù)處理器

結(jié)合基于FPGA以及虛擬原型，更快實現(xiàn)原型的可用性

比較

ProtoCompiler與ProtoCompilerDX的比較

了解更多ProtoCompiler與ProtoCompilerDX的不同，決定哪個更適合您的原型開發(fā)項目。

ProtoCompilerDX

ProtoCompiler

封裝

包含在?HAPS-DX?中

與HAPS系統(tǒng)一起出售

系統(tǒng)支持

僅HAPS-DX

HAPS-DX/70/80

針對HAPS的FPGA邏輯綜合

多處理

每個許可4個

DesignWare庫支持

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硬件集成和重新使用

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Synopsys設(shè)計約束(SDC)兼容

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UnifiedPowerFormat(UPF)中推斷存儲器

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快速HDL編譯模式

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高質(zhì)量綜合結(jié)果

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系統(tǒng)規(guī)劃

系統(tǒng)硬件目標(biāo)定位

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高速引腳復(fù)用

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多FPGA分割

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Virtex-7SuperLogicRegion(SLR)規(guī)劃

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門控/生成的時鐘轉(zhuǎn)換

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UnifiedPowerFormat(UPF)支持

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調(diào)試和啟動

無縫跨FPGA可視性

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HAPSDeepTraceDebug(DTD)SDRAM存儲

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HAPSRealTimeDebug(RTD)邏輯分析器輔助

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調(diào)試RTL源代碼

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針對HAPS的故障排除

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SynopsysVerdi/Siloti數(shù)據(jù)交換

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SynopsysFormality邏輯等效性檢查(LEC)支持

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基于事務(wù)處理器的驗證

AMBA事務(wù)處理器

單獨出售

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SCE-MI事務(wù)處理器

單獨出售

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系統(tǒng)要求HAPS系統(tǒng)先決條件HAPS-80系列HAPS-70系列HAPSDevelopereXpress(HAPS-DX)HAPS-80/70/DX系列混合系統(tǒng)OS支持

如需使用HAPSProtoCompiler高效設(shè)計功能（設(shè)計規(guī)劃、邏輯綜合和分割等）64位RedHatEnterpriseLinuxv5或更高版本64位SUSEEnterpriseLinuxv10或更高版本如需使用HAPSProtoCompiler實時調(diào)試功能（RTL調(diào)試、HAPS啟動工具等）64位RedHatE