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數(shù)字電子技術(shù)課程設(shè)計(jì)，串行數(shù)據(jù)檢測(cè)器電路設(shè)計(jì)，2，1 .設(shè)計(jì)內(nèi)容和設(shè)計(jì)要求1，設(shè)計(jì)內(nèi)容設(shè)計(jì)串行數(shù)據(jù)檢測(cè)器。 請(qǐng)求：如果連續(xù)輸入3個(gè)以上的1，則輸出為1，否則輸入的輸出為0。 2、設(shè)計(jì)要求： a .設(shè)計(jì)思路清晰，提交整體設(shè)計(jì)分塊圖的b方案編寫(xiě)簡(jiǎn)潔，要求重要注釋的c設(shè)計(jì)通訊端口3 .主要設(shè)計(jì)條件a.QuartusII-6.0開(kāi)發(fā)環(huán)境b. FPGA開(kāi)發(fā)板。 3，1 .基本原理： a.JK觸發(fā)器的基本原理：2 .分析整個(gè)設(shè)計(jì)的思維方法、基本原理和分塊圖、4、a.JK觸發(fā)器的基本原理、主從JK觸發(fā)器的邏輯功能表、5，2、設(shè)計(jì)方法a、邏輯抽象、電路的狀態(tài)遷移圖或狀態(tài)轉(zhuǎn)換表1 .給出的邏輯問(wèn)題通常，將原因(或條件)作為輸入邏輯變量，將結(jié)果作為輸出邏輯變量的2 .定義輸入、輸出邏輯狀態(tài)和各電路狀態(tài)的含義，對(duì)電路狀態(tài)按順序編號(hào)的3 .按照題意顯示電路的狀態(tài)轉(zhuǎn)換表或描繪電路的狀態(tài)遷移圖。 b .狀態(tài)轉(zhuǎn)換簡(jiǎn)并性當(dāng)兩個(gè)電路狀態(tài)在相同的輸入處具有相同的輸出并且轉(zhuǎn)換到相同的狀態(tài)時(shí)，這兩個(gè)狀態(tài)被稱(chēng)為等效狀態(tài)。 等效狀態(tài)可以集成，但這樣設(shè)計(jì)的電路狀態(tài)數(shù)少，電路簡(jiǎn)單。 c .狀態(tài)分配狀態(tài)分配也稱(chēng)為狀態(tài)查詢密碼1。

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