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文檔簡介
1、.10/100M 單端口快速以太網(wǎng)收發(fā)器特性 10100Mbps 的 TX全雙工或半雙工支持自動的 MDI/MDIX (介質(zhì)相關(guān)交叉)功能完全符合 IEEE 802.3/802.3u支持 IEEE 802.3u 自動協(xié)商支持 MII / RMII / SNI接口 IEEE 802.3 全雙工控制規(guī)范支持自動省電模式支持基線漂移( BLW )補償支持中斷功能支持中繼模式內(nèi)置 2.5V 的調(diào)節(jié)器提供 3.3V 電源基于 DSP 的 PHY 收發(fā)器技術(shù)使用 25MHz 的晶體振蕩器或50MHz 振蕩的 ref_clk 信號作為時鐘源 靈活的 LED 顯示速度、雙工、鏈接、活動和碰撞狀態(tài)通過MDC 和
2、 MDIO 與其他 MAC 通信時支持流量控制 0.25u CMOS 技術(shù), 48 引腳 LQFP 封裝支持無鉛封裝(請參閱訂單信息)一般說明IP101A LF 是一個 IEEE 802.3/802.3u 兼容的單端口 10/100Mbps 快速以太網(wǎng)收發(fā)器。它支持自動的 MDI/MDIX 功能以簡化網(wǎng)絡(luò)安裝和減少系統(tǒng)維護成本。為了提高系統(tǒng)的性能, IP101A 提供了一個硬件中斷引腳 指示 鏈接、速度和雙工狀態(tài)的變化。 IP101A 還提供媒體獨立接口( MII )/ 串行網(wǎng)絡(luò)接口( SNI )或簡化媒體獨立接口( RMII )連接不同類型的 10/100Mbps 的媒體訪問控制器( MAC
3、 )。 IP101A LF 設(shè)計使用 5 類非屏蔽雙絞線電纜連接到其它局域網(wǎng)設(shè)備。IP101A LF 收發(fā)器是用先進的 CMOS 技術(shù)制造的,該芯片只需要 3.3V 的電源并在自動節(jié)能模式消耗非常低的功率。 IP101A LF 可以實現(xiàn)網(wǎng)絡(luò)用雙絞線 RJ-45 接口適配器連接。它也可以很容易地實現(xiàn)集線器、交換機、路由器、接入點。1/29.目錄:特性總則目錄修訂歷史接收和發(fā)送數(shù)據(jù)的路徑框圖引腳定義1 引腳描述2 寄存器描述3 功能描述4 串行管理界面5 晶體規(guī)格6 布局準則7 電氣特性7.1 直流特性絕對最大額定值功率消耗操作條件電源電壓7.2 交流特性7.2.1MII定時時序7.2.2RMII
4、定時時序7.2.3SMI定時時序8 訂單信息9 封裝和機械規(guī)范2/29.修訂歷史修訂 #改變描述IP101A LF-DS-R01初始版本。IP101A LF-DS-R02添加晶體規(guī)范和MII 交流定時。IP101A LF-DS-R03修改?頁 7.1.2功耗。IP101A LF-DS-R04修改?頁寄存器5.11。IP101A LF-DS-R05添加無鉛封裝信息。IP101A LF-DS-R06修改通用描述和修改應(yīng)用程序圖。IP101A LF-DS-R07修改 15 頁的 MII reg3 內(nèi)容 。IP101A LF-DS-R08刪除線路圖。IP101A LF-DS-R09修改第 5 頁的引腳
5、定義。IP101A LF-DS-R10刪除 “序言 ”和修改 Page30 的 X1 輸入電壓IP101A LF-DS-R11修改第 7 頁的 “ RXER“引腳描述。IP101A LF-DS-R12在第?頁和?頁添加 SMI 時序圖。3/29.接收和發(fā)送數(shù)據(jù)的路徑框圖圖 1: IP101A LF的流程圖4/29.引腳配置圖 2: IP101A LF引腳分配5/29.1、引腳描述類型描述類型描述LI上電或復(fù)位的鎖存輸入PD內(nèi)部下拉I/O雙向輸入輸出PU內(nèi)部上拉I輸入P電源O輸出OD開漏引腳號標識類型描述媒體獨立接口(MII )和物理層(PCS) -管理接口引腳25MDCI管理數(shù)據(jù)接口時鐘:此引
6、腳提供了一種時鐘參考MDIO 。時鐘頻率可達10MHz 。26MDIOI/O管理數(shù)據(jù)接口的輸入/輸出: 這些引腳的功能是在物理層( PHY )和媒體訪問控制器 (MAC) 之間傳輸管理信息。媒體獨立接口( MII )和物理層( PCS) -媒體獨立接口( MII)引腳2TX_ENI(PD)發(fā)送使能 (允許 ):此引腳高電平輸入有效。 在電平高狀態(tài),它表明,在 TxD 3:0 展現(xiàn)的數(shù)據(jù)是有效的。7TX_CLKO發(fā)送時鐘: 當芯片工作在 MII 模式時,此引腳提供了一個25MHz(100BT)和 2.5Mbps(10BT) 的連續(xù)時鐘作為TXD3:0 和 TX_EN的定時參考。3, 4,TXD3
7、:0I數(shù)據(jù)傳輸: 當 TX_EN 設(shè)置為高電平時,在 TX_CLK的同5, 6步下, MAC 通過這 4 條線與 PHY 傳輸數(shù)據(jù)。22RX_DVO接收數(shù)據(jù)有效:在高電平狀態(tài)表示數(shù)據(jù)流呈現(xiàn)在RXD0:3 線,而低電平意味著沒有數(shù)據(jù)交換發(fā)生。16RX_CLKO接收時鐘:該引腳提供了 25MHz (100BT) 或 2.5MHz(10BT)時鐘,而 RX_DV 引腳使用這個引腳在信息產(chǎn)業(yè)部的借鑒。18, 19,RXD3:0O接收數(shù)據(jù): 這 4 個數(shù)據(jù)線是 PHY 是傳輸路徑, 在 RX_CLK20, 21的同步下 將數(shù)據(jù)發(fā)送到 Mac 。24RX_ERO(PD)接收錯誤: 當解碼接收的數(shù)據(jù)中有錯誤
8、發(fā)生,此引腳輸出高電平時。(注意:這個引腳已經(jīng)在內(nèi)部拉低。外部還需要 5.1K 下拉電阻是為了避免噪音干擾。 )1 COL/RMIIO/LI(PD)碰撞檢測: 當此引腳輸出高電平信號表示檢測到碰撞。RMII 模式: 在上電復(fù)位期間,該引腳的狀態(tài)被鎖存,并根據(jù) MII/SNIB ( pin44 )確定 MAC 接口RMII MII /SNIB1×RMII 接口01MII 接口00SNI 接口(注意:這個引腳在芯片內(nèi)部拉低)23CRS/LEDO(PD)載波偵聽: 當該管腳輸出高電平指示在發(fā)送或接收中,低MOD電平指示線路空閑狀態(tài)。LEDMOD:在上電復(fù)位期間,該引腳的狀態(tài)被鎖存以確定哪個
9、 LED 模式可操作,請參閱LED 引腳說明。(注意:這個引腳內(nèi)部拉低)6/29.引腳號標識類型描述RMII (Reduced MII簡化 MII)7REF_CLKI參考時鐘輸入: 此引腳是一個輸入引腳, 在 RMII 模式作為50MHz 參考時鐘( REF_CLK )。16C50M_OO參考時鐘輸出: 此引腳在 RMII 模式可配置為50MHz 時鐘輸出。擁有 25MHz 晶體振蕩器時, IP101ALF 能在 RMII模式下產(chǎn)生 50MHz 輸出。2TX_ENI(PD)發(fā)送使能: 指示 Mac 進行發(fā)送操作5,6TXD1:0I兩位數(shù)據(jù)傳輸24RX_ERI/O接收錯誤22CRS_DVO載波偵
10、聽和接收數(shù)據(jù)有效20, 21RXD1:0O兩位數(shù)據(jù)接收SNI (Serial Network Interface串行網(wǎng)絡(luò)接口 ): 僅用于 10Mbps2TX_ENI(PD)發(fā)送使能: 指示 Mac 進行發(fā)送操作7TX_CLKO發(fā)送時鐘: 10MHz ,物理層( PHY )產(chǎn)生的時鐘6TXD0I傳輸串行數(shù)據(jù)16RX_CLKO接收時鐘: 10MHz ,從接收數(shù)據(jù)中恢復(fù)的時鐘1COLO碰撞檢測23CRSO載波偵聽電纜傳輸接口34MDI_TPI/O發(fā)射輸出對: 差分對共享 100Base-TX 和 10Base-T 模式。33MDI_TNI/O當配置為 100Base-TX ,輸出是 MLT-3 的
11、編碼波形。 當配置為 10Base-T,輸出曼徹斯特碼。31MDI_RPI/O接收輸入對: 差分對共享 100Base-TX 和 10Base-T 模式。30MDI_RNI/O7/29.引腳號標識類型描述集成電路的配置選項43ISOLI(PD)加載高電平到該引腳將使IP101A LF 與其他 Mac 隔離。這還將隔離 MDC/MDIO管理接口。當此引腳被激活時功耗最小。這引腳可以直接連接到GND 或 VCC 。(內(nèi)部有弱下拉即默認無效)40RPTRI(PD)高電平使能此引腳將令I(lǐng)P101A LF 進入 中繼器模式。該引腳可以直接連接到 GND 或的 VCC 。(內(nèi)部有弱下拉即默認無效)39SP
12、DLI/O(PU)該引腳在上電或復(fù)位時鎖存輸入。設(shè)為高電平令I(lǐng)P101ALF 進入 100Mbps 的操作。該引腳可以直接連接到GND 或VCC 。(內(nèi)部弱上拉即默認使用100Mbps)38DPLXLI/O(PU)該引腳在上電或復(fù)位時鎖存輸入。設(shè)置高電平為全雙工。該引腳可以直接連接到GND 或的 VCC 。(內(nèi)部弱上拉以默認全雙工)37AN_ENALI/O(PU)該引腳在上電或復(fù)位時鎖存輸入。高電平啟用自動協(xié)商模式,低電平為強制模式。該引腳可以直接連接到GND 或的 VCC 。(內(nèi)部弱上拉默認啟用自動協(xié)商模式)41APSI(PU)高電平令 IP101A LF 啟用 APS 模式。此引腳可直接連
13、接到GND 或 VCC 。請參閱電源掉電模式描述以獲得更多的信息。(內(nèi)部弱上拉即默認啟用APS 模式)44MII_SNIBLI/O(PU)該引腳在上電或復(fù)位時鎖存輸入。高電平令I(lǐng)P101A LF 進入 MII 操作模式。低電平為 SNI 模式。該引腳可以直接連接到 GND 或 VCC 。(內(nèi)部弱上拉以默認設(shè)置MII 模式)8/29.引腳號標識類型描述LED 和 PHY (物理層)地址配置這五個引腳在復(fù)位期間鎖存到IP101A LF以配置用于 MII 管理寄存器接口的 PHY 地址 4:0 。在初始復(fù)位后的正常操作中,他們作為狀態(tài)指示LED 的驅(qū)動引腳。驅(qū)動極性,低電平或高電平有效,由復(fù)位期間每
14、個鎖存的物理地址4:0狀態(tài)決定。如果鎖存狀態(tài)是高則低電平有效,如果鎖存狀態(tài)是低則高電平有效。此外,IP101ALF提供 2個LED操作模式。如果是通過拉高CRS選擇 LED 模式 2,則只需4 個發(fā)光二極管作為狀態(tài)指示。默認的是LED 模式 1。LED 模式 1LED 模式 2LED0LINKLINK /ACT(blinking)LED1FULL DUPLEXFULL DUPLEX /COL(blinking)LED210BT /ACT(blinking)10BTLED3100BT /ACT(blinking)100BTLED4COL (碰撞)Reserved9PHYAD0/LI/O物理地址
15、0LED0狀態(tài):模式 1:連接時激活。模式 2:連接時激活,發(fā)送或接收數(shù)據(jù)時閃爍。10PHYAD1/LI/O物理地址 1LED1狀態(tài):模式 1:全雙工操作時激活。模式 2:全雙工操作時激活,發(fā)生碰撞的時候閃爍。12PHYAD2/LI/O物理地址 2LED2狀態(tài):模式 1:以 10BASE-T 模式連接時激活,當發(fā)收發(fā)數(shù)據(jù)時閃爍。模式 2:以 10BASE-T 模式連接時激活。13PHYAD3/LI/O物理地址 3LED3狀態(tài):模式 1:以 100Base TX 模式連接時激活, 當發(fā)收發(fā)數(shù)據(jù)時閃爍。模式 2:以 100Base TX 模式連接時激活。15PHYAD4/LI/O物理地址 4LED
16、4狀態(tài):模式 1:發(fā)生碰撞時激活。模式 2:保留。9/29.引腳號標識類型描述時鐘和其他-晶體震蕩輸入/輸出引腳47X2O25MHz 的晶體輸出: 連接到晶體提供響應(yīng)輸出。當X1由一個外部 25MHz 振蕩器驅(qū)動的時候必須懸空。46X1I25MHz 的晶體輸入: 連接到晶體提供 25MHz 晶振輸入。如果使用了一個 25MHz 外部振蕩器, X1應(yīng)連接到振蕩器的輸出。 如果一個 50MHz 的時鐘應(yīng)用于Pin7,X1 應(yīng)該連接到 VSS 或 2.5V VDD 。請參考時鐘源描述。時鐘和其他 -其他引腳42RESET_NIRESET_N :提供一個低電平的信號將復(fù)位芯片。要執(zhí)行一個完整的復(fù)位功能
17、,在25MHz的時鐘(X1 )下,RESET_N 的低電平必須維持至少10 個時鐘周期方能出現(xiàn)上升沿。 芯片要在 RESET_N上升沿后 延遲 2.5ms才能操作。 2.5ms 延遲是為了保證系統(tǒng)的穩(wěn)定性。48INTRO(OD)中斷引腳: 當 MII 寄存器 17:< 15 > 設(shè)置為高, 此引腳被用作一個中斷引腳 (注意: 這是一個開漏輸出,所以需要外部上拉電阻)27TEST_ONI (PD)測試使能: 該引腳設(shè)置為高電平運行測試模式,而正常運行時該引腳不需要連接。 (內(nèi)部弱下拉默認禁用測試模式)28ISETI傳輸偏置電阻連接:此引腳應(yīng)該通過一個6.2k ( 1% )電阻連接到
18、GND 定義以電流驅(qū)動傳輸?shù)腄AC 。供電和接地32REGOUTP穩(wěn)壓電源輸出: 這個穩(wěn)壓輸出供IP101A LF 數(shù)字電路。36AVDD33P3.3V 模擬電源輸入: 這是一個3.3V 模擬電路的電源, 應(yīng)注意解耦。29,35AGNDP模擬地: 這 2 個引腳應(yīng)該連接到主板上的GND 。8REGINP穩(wěn)壓電源輸入: 這是一個從 Pin32獲得的穩(wěn)壓電源輸入。無需外部調(diào)節(jié)器。14DVDD33P3.3V 數(shù)字電源輸入:供數(shù)字電路使用的3.3V 電源。11,17,45DGNDP數(shù)字地: 這 3 個引腳應(yīng)該連接到主板上的GND 。10/29.2、寄存器描述位名稱描述 /使用默認值(H):3100Re
19、gister 0 : MII控制寄存器15Reset一旦設(shè)置,將使物理層(PHY )的狀態(tài)和控制寄存器恢復(fù)0, RW默認狀態(tài)。此位也會自動清除。1= 軟件復(fù)位0= 正常運行14Loop-back這一位允許發(fā)送的數(shù)據(jù)環(huán)回到接收數(shù)據(jù)路徑,即,發(fā)送到0, RW接收端。在編程這一位后,IP101A LF至少需要 512us完成連接。 TX / RX 數(shù)據(jù)包應(yīng)該在512us后被激活。1= 啟用環(huán)回0= 正常運行13Speed這一位設(shè)置傳輸速度。1, RWSelection1= 100Mbps0= 10Mbps12Auto-這一點決定了自動協(xié)商功能。1, RW (TP)Negotiation1= 啟用自動
20、協(xié)商;位13和8將被忽略。Enable0=禁用自動協(xié)商;在這種情況下,位13 和 8 將決定連接速度和數(shù)據(jù)傳輸模式。自動 MDIX 功能應(yīng)禁用 ( reg16.11 =1)。請參閱7 節(jié)自動 MDIX 功能細節(jié)描述。11Power這一位置位,將關(guān)閉PHY 芯片供電和內(nèi)部晶體振蕩器電0, RWDown路。 MDC 與 MDIO 仍然活動以維持MAC 的訪問。1= 掉電0= 正常運行10Isolate1= 電隔離 MII 硬件但不隔離MDC和 MDIO0,RW0= 正常運行9Restart這一位可以重啟自動協(xié)商功能。0, RWAuto-1= 重啟自動協(xié)商Negotiation0= 正常運行8Dup
21、lex在禁用自動協(xié)商時該位設(shè)置雙工模式(位12=0 )1, RWMode1= 全雙工0=半雙工完成自動協(xié)商后,這一位也將反映協(xié)商的雙工狀態(tài)。( 1:全雙工, 0:半雙工)7Collision1= 啟用 Col信號測試0,RWTest0= 禁用 Col 信號測試6:0Reserved0, RO11/29.位名稱描述 /使用默認值(H): 7849Register 1 : MII 狀態(tài)寄存器15100Base-T41= 啟用 100Base-T4支持0, RO0= 抑制 100Base-T4支持14100Base-TX1= 啟用 100Base TX全雙工支持1, ROFull Duplex0=
22、抑制 100Base TX全雙工支持13100Base-TX1= 啟用 100Base TX半雙工的支持1, ROHalf Duplex0= 抑制 100Base TX半雙工的支持1210Base-T1= 啟用 10Base-T全雙工支持1, ROFull Duplex0= 抑制 10Base-T全雙工支持1110_Base-T1= 啟用 10Base-T半雙工支持1, ROHalf Duplex0= 抑制 10Base-T半雙工支持10:7Reserved0, RO6MF該 IP101A LF 將接受報頭抑制管理框架。該 IP101A LF 接1, ROPreamble受管理框架沒有報頭。復(fù)
23、位后第一個SMI 讀 /寫事務(wù)至少Suppression需要 32 比特的前導(dǎo)報頭。 按 IEEE802.3u規(guī)格任何兩個管理事務(wù)之間必須要一個空閑比特。5Auto-1= 自動協(xié)商過程完成0, RONegotiation0= 自動協(xié)商過程未完Complete4Remote1= 檢測到遠程故障(讀取時自動清除)0, RO/LHFault0= 沒有遠程故障檢測3Auto-1= 鏈路沒有經(jīng)歷過失敗的狀態(tài)1, RONegotiation0= 鏈路已經(jīng)經(jīng)歷了失敗狀態(tài)2Link Status1= 已建立有效鏈路0, RO/LL0= 未建立有效鏈路1Jabber1= 檢測到 Jabber狀態(tài)0, RO/LH
24、Detect0= 未檢測到 Jabber狀態(tài)0Extended1= 擴展寄存器的 容量(性能)1, ROCapability0= 基本寄存器的 容量(性能)12/29.位名稱描述 /使用默認值(H): 0243Register 2 : PHY標識寄存器 115:0PHYID1IP101A LF的物理標識符ID 供軟件識別0X0243, RORegister 3 : PHY標識寄存器 215:0PHYID2IP101A LF的物理標識符ID 供軟件識別0X0C54, RO注意: Register 2 和 register 3 標識寄存器一起構(gòu)成供應(yīng)商模型、模型版本號和組織唯一標識符( OUI)信
25、息。 32 位全部分配在這 2 個寄存器中,并且在需要時所有位都可以返回零。寄存器 2 包含 OUI 重要標志的最高和最低位,供應(yīng)商的模型,模型版本號分配在寄存器3。位名稱描述 /使用默認值(H): 0001Register 4 : 自動協(xié)商通告寄存器15NP下一頁情況位。0, RO0= 傳輸?shù)闹饕阅軘?shù)據(jù)頁1= 傳輸協(xié)議特定的數(shù)據(jù)頁14Reserved0, RO13RF1= 通告遠程故障檢測能力0, RW0= 不通告遠程故障檢測能力12Reserved0, RO11Asymmetric.1= 本地節(jié)點支持非對稱流動控制0, RWPause0= 本地節(jié)點不支持非對稱流動控制10Pause1=本
26、地節(jié)點支持流量控制0, RW0=本地節(jié)點不支持流量控制9T41= 本地節(jié)點支持100Base-T40, RO0= 本地節(jié)點不支持100Base-T48TX Full1= 本地節(jié)點支持100Base-TX全雙工1, RWDuplex0= 本地節(jié)點不支持100Base-TX全雙工7TX1= 本地節(jié)點支持100Base TX1, RW0= 本地節(jié)點不支持100Base TX610 Full1= 本地節(jié)點支持10Base-T 全雙工1, RWDuplex0= 本地節(jié)點不支持10Base-T 全雙工5101= 本地節(jié)點支持10Base T1, RW0= 本地節(jié)點不支持10Base T4:0Selecto
27、r二進制編碼選擇器支持這個節(jié)點。目前只有CSMA/CD<00001>< 00001 > 指定。沒有其他協(xié)議的支持。RO13/29.位名稱描述 /使用默認值(H): 0000Register 5 : 自動協(xié)商鏈路伙伴能力寄存器(ANLPAR)15Next Page下一頁情況位。0, RO0= 傳輸?shù)闹饕阅軘?shù)據(jù)頁1= 傳輸協(xié)議特定的數(shù)據(jù)頁14Acknowledge1= 鏈路伙伴告知已收到本地節(jié)點的接收性能數(shù)據(jù)字0, RO0= 無確認13Remote1= 鏈路伙伴表明有遠程故障0, ROFault0= 鏈路伙伴未表明有遠程故障12Reserved0, RO11Asymmet
28、ric.1= 鏈路伙伴支持非對稱流動控制0, ROPause0= 鏈路伙伴不支持非對稱流動控制10Pause1= 鏈路伙伴支持流量控制0, RO0= 鏈路伙伴不支持流量控制9T41= 鏈路伙伴支持100Base-T40, RO0= 鏈路伙伴不支持100Base-T48TXFD1= 鏈路伙伴支持100Base-TX全雙工0, RO0= 鏈路伙伴不支持100Base-TX全雙工7100Base-TX1= 鏈路伙伴支持100Base TX0, RO0= 鏈路伙伴不支持100Base TX610FD1= 鏈路伙伴支持10Base-T 全雙工0, RO0= 鏈路伙伴不支持10Base-T 全雙工510B
29、ase-T1= 鏈路伙伴支持10Base T0, RO0= 鏈路伙伴不支持10Base T4:0Selector鏈路伙伴二進制編碼選擇器目前只有CSMA/CD <00001><00000>指定。RO14/29.位名稱描述 /使用默認值(H): 0000Register 6 : 自動協(xié)商擴展寄存器15:0Reserved該位始終設(shè)置為0。0, RO4MLF此狀態(tài)指示是否發(fā)生了多個鏈路故障。0, RO1= 故障0=無故障3LP_NP_ABLE此狀態(tài)指示鏈接伙伴是否支持下一頁的協(xié)商。0, RO1= 支持0=不支持2NP_ABLE該位表明設(shè)備是否能夠發(fā)送額外的下一頁。0, RO
30、1PAGE_RX如果一個新的鏈接代碼字的頁面已收到則該位置位。它在0, RO管理員讀取自動協(xié)商鏈接伙伴能力寄存器(寄存器5)后自動清除。0LP_NW_ABLE1= 鏈路伙伴支持自動協(xié)商。0, RORegister 16 : PHY特殊控制寄存器15Debug Mode0= IP101A LF工作在正常模式0, R/W1= IP101A LF工作在調(diào)試模式(注:功能位16: 4:0 受制于本位的設(shè)置)14:12Reserved11 Auto MDIX Off10Heart BeatEnable9 Jabber Enable8 Far-End Fault Enable/Disable7 Analo
31、g Power Saving Disable0, RO置位可禁用MDI 和 MDI-X的自動開關(guān)。如果在上電期間0, R/W通過設(shè)置Pin37=0而禁用AN ,此位將被自動設(shè)置為1。設(shè)置 Reg0.12=1將重啟 AN ,在這種情況下,如果用戶需要自動介質(zhì)相關(guān)交叉功能,該位應(yīng)設(shè)置為0。有關(guān)詳細信息,請參閱7 節(jié)自動介質(zhì)相關(guān)交叉功能描述。在 10Base-T模式下使能心跳機制0, R/W在 10Base-T模式開啟控時操作0, R/W在 100Base-TX模式 啟用或禁用遠端故障的功能0, R/W1 = Enable0 = Disable置位將在自動協(xié)商過程中禁用省電功能0, R/W6Rese
32、rved0, RO5Bypass DSP置位將在 PCS 子層忽視復(fù)位DSP 機制0, R/Wreset4:3Reserved0, RO2Repeater Mode置位將置 IP101A LF 為中繼模式0, R/W1APS Mode置位將啟用自動省電模式0, R/W0Analog Off置位將關(guān)閉模擬收發(fā)器0, R/W15/29.默認值位名稱描述 /使用(H): 0000Register 17 : PHY15 INTR pin used14:12 Reserved11All Mask10 Speed Mask9 Duplex Mask8Link Mask7 Arbiter State Ena
33、ble中斷控制 /狀態(tài)寄存器置位將使pin48 作為一個中斷引腳。復(fù)位 pin48 將高阻抗。0, R/W0, RO置位將令所有事件的變化無法引起中斷1, R/W置位將令速度模式的變化無法引起中斷1, R/W置位將令雙工模式的變化無法引起中斷1, R/W置位將令鏈路狀態(tài)的變化無法引起中斷1, R/W復(fù)位將令自動協(xié)商器狀態(tài)機的變化無法引起中斷0, R/W6Arbiter State自動協(xié)商仲裁變化中斷標志0, RCChange5:3Reserved0, RO2Link Status鏈接狀態(tài)改變中斷標志0, RCChange1Speed速度變化中斷標志0, RCChange0Duplex雙工模式變
34、化中斷標志0, RCChange16/29.功能描述IP101A LF10/100Mbps 以太網(wǎng)收發(fā)器單芯片集成了100 Base-TX 和 10 Base-T 模塊。IP101ALF 充當物理信號之間的接口和媒體訪問控制器(MAC) 。IP101A LF 有幾個主要功能 :1。物理層 (物理編碼子層 ):這個功能模塊包含傳輸、接收和載波監(jiān)聽功能電路。2。管理接口:媒體獨立接口(MII) 或精簡管理界面 (RMII) 寄存器包含與其他 MAC 的通信信息。3。自動協(xié)商:確定2 個物理收發(fā)器之間的通信條件。IP101A LF 廣播自己的能力,也從對方檢測相應(yīng)的運作模式,最終雙方將達成最優(yōu)化傳輸
35、模式。IP101A LF 的主要功能包括 :1。流量控制能力2。 LED 配置訪問3。支持全雙工和半雙工操作模式4。 APS(Auto Power Saving自動節(jié)能 )模式5?;€漂移 (BLW Base Line Wander ) 補償6。自動 MDI/MDIX功能7。中斷功能8。中繼器模式9。靈活的時鐘源主要功能塊描述功能塊圖是指圖 1:1。 4B /5B 編碼器:100 Base-X 傳輸需要將 4 比特半字節(jié)數(shù)據(jù)轉(zhuǎn)換成5 比特寬代碼字格式。傳輸?shù)臄?shù)據(jù)在 4B /5B 塊起始位置由 J / K 代碼封裝并在結(jié)束位置用T / R 代碼封裝。如果在一個傳輸過程中發(fā)生傳輸錯誤,H 錯誤代碼
36、將被發(fā)送。在兩個包之間發(fā)送空閑碼。2。 4B /5B 解碼器:解碼器從收到的代碼組執(zhí)行4B /5B 解碼。 5 位 (5B )數(shù)據(jù)解碼成四位半字節(jié)數(shù)據(jù)。然后解碼出的 4 位 (4B )數(shù)據(jù)通過 MII轉(zhuǎn)發(fā)到中繼器、交換機或MAC 設(shè)備。 SSD 隨后轉(zhuǎn)化成 4B 的 5 個半字節(jié)數(shù)據(jù), ESD 和空閑碼都換成了 4B 的 0 個半字節(jié)數(shù)據(jù)。解碼數(shù)據(jù)驅(qū)動相應(yīng)的 MII 端口或共享 MII 端口。接收一個無效的代碼組將導(dǎo)致PHY 維護 MII 的 RXER信號。3。擾頻器 /解擾器: 重復(fù)的模式存在于4B /5B 編碼數(shù)據(jù), 會導(dǎo)致較大的射頻頻譜峰值并使系統(tǒng)持續(xù)從監(jiān)管機構(gòu)核準。而加擾傳送的信號的輻
37、射信號峰值顯著下降。擾頻器增加了一個隨機發(fā)生器數(shù)據(jù)信號輸出。由此產(chǎn)生的信號是極少重復(fù)的數(shù)據(jù)模式。被擾亂的數(shù)據(jù)流在接收機通過添加另一個隨機發(fā)生器到輸出端實現(xiàn)解擾。接收者的隨機發(fā)生器具有與發(fā)射機的隨機發(fā)生器相同的函數(shù)。擾頻器操作是由100Base-TX 和 TP_FDDI 標準決定的。4。 NRZI/MLT-3 (曼徹斯特 )編碼器和譯碼器:100Base-TX 傳輸需要將數(shù)據(jù)編碼成不歸零制(NRZ )格式并再轉(zhuǎn)化成MLT-3 信號,在 10Base-T 中將在 NRZ 編碼后轉(zhuǎn)換成曼徹斯特編碼。這有助于消除雙絞線電纜產(chǎn)生的高頻噪聲。在接收端, 編碼是從 MLT-3 ( 曼徹斯特 )信號逆轉(zhuǎn)回不歸
38、零法格式。5。時鐘恢復(fù):接收器電路通過再生嵌入在串行流中的時鐘信息從輸入流恢復(fù)數(shù)據(jù)。時鐘恢復(fù)模塊從接收到的傳輸信號中提取RXCLK 。6。 DSP 引擎:這一模塊包括自適應(yīng)均衡器和基線漂移校正功能。17/29.傳輸?shù)拿枋?0Mbps 發(fā)送流路徑:TXD 并行到串行 NRZI / 曼徹斯特編碼器 D/A 和線路驅(qū)動器 TXOMAC 通過將 4 位半字節(jié)數(shù)據(jù)傳遞到PHY 后,數(shù)據(jù)連續(xù)進行并行到串行轉(zhuǎn)換。該轉(zhuǎn)換器輸出 NRZI 編碼數(shù)據(jù), 然后數(shù)據(jù)再在曼徹斯特編碼器中被映射成曼徹斯特編碼。發(fā)送到物理介質(zhì)之前,曼徹斯特編碼數(shù)據(jù)通過D/A 轉(zhuǎn)換器整形以符合物理介質(zhì)。10Mbps 接收:RXI 靜噪時鐘恢復(fù)曼徹斯特/NRZ 碼解碼器串行到并行RXD靜噪塊通過交流調(diào)速和直流幅值測量確定有效的數(shù)據(jù)。當介質(zhì)中存在有效的數(shù)據(jù), 則靜噪塊將生成一個信號, 表明已收到的數(shù)據(jù)。 接收的數(shù)據(jù)是曼徹斯特編碼的, 并在曼徹斯特到 NRZ碼解碼器進行解碼。然后數(shù)據(jù)被映射成4 位半字節(jié)并發(fā)送到MAC 接口。100Mbps 的發(fā)射:TXD 4B/5B 編碼器擾碼 MUX 并行到串行 NRZI/ MLT-3編碼器 D/A 和線路驅(qū)動TXO10Mbps 和 100Mbps傳輸?shù)闹饕獏^(qū)別是, 100Mbps傳輸需要從4
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