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1、串行進位加法器串行進位加法器串行加法器串行加法器組合電路存儲電路僅取決于電路狀態(tài)有關(guān)、與)(),(QFYQXQXFY1. 真值表：0*特性方程.2SRQRSQ*QQRSQKQJQ*2:.特性方程*QQKJ*QQTQTQTQ*2:.特性方程*QQDDQ *2:.特性方程23213312121321,)(,1,)(寫驅(qū)動方程：.1QKQQJQQKQJKQQJ3232132312121321*)(*，得狀態(tài)方程：*觸發(fā)器的特性方程代入.2QQQQQQQQQQQQQQQQQKQJQJK323QQY 輸出方程.TTL觸發(fā)器，輸入端觸發(fā)器，輸入端懸空時等效懸空時等效“1”下降沿動作下降沿動作穆爾型穆爾型Y

2、QQQQQQ*123123YQQQCLK123 3232132312121321QQQQQQQQQQQQQQQQ*)(*32QQY 七進制計數(shù)器七進制計數(shù)器 Y：進位脈沖：進位脈沖YQQQCLK12301234567邊沿觸發(fā)，上升沿動作邊沿觸發(fā)，上升沿動作米利型米利型DQ*:特性方程可控四進制計數(shù)器：加法計數(shù)器、減法計數(shù)器可控四進制計數(shù)器：加法計數(shù)器、減法計數(shù)器012345678改變隨高電平期間DQclkLS 7574功能。有異步置狀態(tài)無關(guān)，存入，與此前后的時，將01757430DDDCLKHC并行輸入、并行輸出方式并行輸入、并行輸出方式翻轉(zhuǎn)一級觸發(fā)器原來的狀態(tài)到達時，各觸發(fā)器按前所以觸發(fā)器有延遲時間因為CLKtpd位1數(shù)據(jù)依次右移0111數(shù)據(jù)運算并代碼轉(zhuǎn)換，串應(yīng)用：0001 1110S1S0S1 S010021TQQQTiii.ETEPDLRCLKD10021TQQQTiii.DUDLSCLKI加/減計數(shù)器加/減控制計數(shù)結(jié)果時鐘加/減計數(shù)器計數(shù)結(jié)果加脈沖減脈沖10T3001QQQT212QQT 030120123QQQQQQQQTQTQTQ*能自啟動ETEPDLRCLKD10T)( 123001QQQQQT)( 32101012QQQQQQ

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