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集電極開(kāi)路門(mén)：OC門(mén)VccT4T5Y1VccT4’T5’Y2輸出端直接相接（線與）當(dāng)Y1=1Y2=0時(shí)燒T4管ABC5v

EpRpYABC5v

EpRpY10輸出為0OC門(mén)電路圖:

國(guó)標(biāo)慣用OC門(mén)的應(yīng)用:1.可以線與(輸出端直接相連實(shí)現(xiàn)與)2.實(shí)現(xiàn)電平轉(zhuǎn)換,可以作為接口電路ABCYABCY&AY11Ep=12V0v3v12v0v后級(jí)輸入輸出的標(biāo)準(zhǔn)高電平為VH=12v前級(jí)標(biāo)準(zhǔn)高電平為VH=3v3.實(shí)現(xiàn)總線傳輸(BUS)E1D1&E2D2&Vcc總線BUSD數(shù)據(jù)端E使能端(片選端)任何時(shí)刻只能選通一個(gè)工作三態(tài)門(mén)(TS門(mén))0,1,高阻T4A

B

Vcc+5vYT5T2T1ENENABY…0001001101010110

1xx高阻

使能端加兩個(gè)反向器，高電平有效ABEN&ENYABENY

國(guó)標(biāo)慣用(高電平使能)三態(tài)門(mén)電路圖:三態(tài)門(mén)的應(yīng)用:AEN&ENBEN&EN總線BUS1.單向總線:任何時(shí)刻只能選通一個(gè)2.雙向總線EN&END1EN&ENBUSD2D當(dāng)EN=1時(shí)D=D1當(dāng)EN=0時(shí)D2=DECL邏輯門(mén)電路（射極偶合邏輯）構(gòu)成：差動(dòng)放大輸入，射極開(kāi)路輸出可以線或（集成注入邏輯）可以線與AL1L2L3A1L1L2L3TTL門(mén)電路及改進(jìn)：

74xx__普通標(biāo)準(zhǔn)TTL74LSxx__低功耗肖特基TTL74Sxx__肖特基TTL(抗飽和)74系列74ALSxx__先進(jìn)低功耗肖基TTL74ASxx__先進(jìn)肖基TTL74Hxx__高速TTL

作業(yè)：自考：P787,8,9,10,11常用英語(yǔ)：Threestateoutputgate

三態(tài)門(mén)Opencollectorgate

集電極開(kāi)路門(mén)EmitterCoupledlogicECLInt

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