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中規(guī)模集成芯片的組合邏輯電路設計主講教師王濤電工電子技術有n個輸入端的譯碼器,有2n個信號輸出端。即每一個信號輸出端與n個輸入變量的每一個最小項一一對應步驟:用譯碼器設計組合邏輯電路用與非連輸出按順序接輸入找出最小項例1利用74LS138型3-8線譯碼器實現(xiàn)邏輯函數(shù)Y=AB+BC+CA變換Y6Y7Y3Y5CT74LS138A2A0A1S1S2S3Y7Y6Y5Y4Y3Y2Y1Y0ABC&Y“1”總結用n位地址輸入的譯碼器,可以產(chǎn)生任何一種輸入變量數(shù)不大于n的組合邏輯函數(shù)。例2利用CT74LS138型3-8線譯碼器實現(xiàn)全加器CT74LS138A2A0A1S1S2S3Y7Y6Y5Y4Y3Y2Y1Y0ABCi-1Ci“1”&&Si分析用數(shù)據(jù)選擇器設計邏輯電路四選一選擇器功能表類似三變量函數(shù)的表達式!例3利用四選一選擇器實現(xiàn)如下邏輯函數(shù)。與四選一選擇器輸出的邏輯式比較可以令:變換設計時采用函數(shù)式比較法接線圖)()()(GA1)AG(RAGRAGRY·+++=D0D1D2D3A0A1WAGRY“1”74LS1531E總結用n位地址輸入的數(shù)據(jù)選擇器,可以產(chǎn)生任何一種輸入變量數(shù)不大于n+1的組合邏輯函數(shù)。設計時可以采用函數(shù)式比較法??刂贫耍吹刂份斎攵耍┳鳛檩斎攵?,數(shù)據(jù)輸入
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