(5.12.3)-25JK觸發(fā)器電路及電路

主要內(nèi)容JK觸發(fā)器的電路結(jié)構(gòu)和邏輯功能重難點JK觸發(fā)器邏輯功能的四種描述方法3.JK觸發(fā)器邊沿觸發(fā)的主從型JK觸發(fā)器是目前功能最完善、使用較靈活和通用性較強的一種觸發(fā)器。（1）電路組成KJCPQ1Q1&&G6G5&G7&G8RDSDRDSD&&G2G1&G3&G4QQ1

圖示為主從型JK觸發(fā)器邏輯電路結(jié)構(gòu)圖。其中G1~G4構(gòu)成主觸發(fā)器，輸入通過一個非門和CP控制端相連。G5~G8構(gòu)成從觸發(fā)器，從觸發(fā)器直接與CP控制端相連。

主觸發(fā)器Q端與G7的一個輸入相連，Q端和G8的一個輸入端相連，構(gòu)成兩條反饋線。主觸發(fā)器從觸發(fā)器（2）JK觸發(fā)器的工作原理KJCPQ1Q1&&G6G5&G7&G8RDSDRDSD&&G2G1&G3&G4QQ1CP=1期間：11111110100010

主觸發(fā)器因CP=0被封鎖，輸出狀態(tài)保持不變。

從觸發(fā)器由于CP=1被觸發(fā)，其輸出次態(tài)Q1n+1隨著JK輸入端的變化而改變。

設(shè)輸出現(xiàn)態(tài)Q=1、J=1，K=0G8有0出10G6有0出111G5全1出00

從觸發(fā)器把CP=1時的狀態(tài)記憶下來，在CP下跳沿到來時作為輸入狀態(tài)送入主觸發(fā)器中。1（2）JK觸發(fā)器的工作原理KJCPQ1Q1&&G6G5&G7&G8RDSDRDSD&&G2G1&G3&G4QQ1CP下跳沿到來時：1111111010010

從觸發(fā)器因CP=0被封鎖，輸出狀態(tài)保持不變。

主觸發(fā)器由于CP=1被觸發(fā)，其輸出次態(tài)Qn+1隨著輸入端的變化而改變。G2有0出1G1全1出01G3有0出10

顯然JK觸發(fā)器在CP下跳沿到來時輸出狀態(tài)發(fā)生改變，且此狀態(tài)一直保持到下一個時鐘脈沖下跳沿的到來。21001為什么在CP=0期間輸出狀態(tài)不變？（2）JK觸發(fā)器的工作原理

邊沿觸發(fā)的主從型JK觸發(fā)器能有效地抑制“空翻”現(xiàn)象。在時鐘脈沖CP下降沿到來時，其輸出、輸入端子之間的對應(yīng)關(guān)系為：①J＝0，K＝0時，觸發(fā)器無論現(xiàn)態(tài)如何，次態(tài)Qn+1＝Qn，保持功能；②當(dāng)J＝1，K＝0時，無論觸發(fā)器現(xiàn)態(tài)如何，次態(tài)Qn+1＝1，置1功能；③當(dāng)J＝0，K＝1時，無論觸發(fā)器現(xiàn)態(tài)如何，次態(tài)Qn+1＝0；置0功能；④當(dāng)J＝1，K＝1時，無論觸發(fā)器現(xiàn)態(tài)如何，次態(tài)Qn+1＝Qn，翻轉(zhuǎn)功能。結(jié)論：JK不同時，輸出次態(tài)總是隨著J的變化而變化；JK均為0時，輸出保持不變；JK均為1時，輸出發(fā)生翻轉(zhuǎn)。

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74LS112

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VCC

D1RD2R2CP

2K

2JD2S

2Q

1CP

1K

1JD1S

1Q

1Q

Q2

GND

·

實際應(yīng)用中大多采用集成JK觸發(fā)器。常用的集成芯片型號有下降沿觸發(fā)的雙JK觸發(fā)器74LS112、上升沿觸發(fā)的雙JK觸發(fā)器CC4027和共用置1、清0端的74LS276四JK觸發(fā)器等。74LS112雙JK觸發(fā)器每片芯片包含兩個具有復(fù)位、置位端的下降沿觸發(fā)的JK觸發(fā)器，通常用于緩沖觸發(fā)器、計數(shù)器和移位寄存器電路中。

下圖所示為其管腳排列圖：（3）常用集成JK觸發(fā)器

芯片型號中含有74表示TTL集成芯片；含有CC或CD表示CMOS集成芯片。JK觸發(fā)器邏輯功能的描述①特征方程11，10②狀態(tài)圖01觸發(fā)器的“0”態(tài)觸發(fā)器的“1”態(tài)01，1100010010SRC11K1JRDSDCPKJQQJK觸發(fā)器邏輯圖符號此符號表示邊沿觸發(fā)加圈表示下降沿觸發(fā)③JK觸發(fā)器功能真值表CPJKQnQn+1功能↓0000保持↓0011保持↓0100置“0”↓0110置“0”↓001置“1”↓1011置“1”↓101翻轉(zhuǎn)↓1110翻轉(zhuǎn)置1置0翻轉(zhuǎn)保持④JK觸發(fā)器時序波形圖

歸納JK觸發(fā)器的特點：①邊沿觸發(fā)，即