3時(shí)序邏輯電路(101.5.17)

實(shí)驗(yàn)三、時(shí)序邏輯電路一、實(shí)驗(yàn)?zāi)康?.掌握D觸發(fā)器的邏輯功能和使用

2.掌握中規(guī)模集成計(jì)數(shù)器74LS161、的邏輯功能和使用方法。3.掌握用觸發(fā)器和中規(guī)模集成電路構(gòu)成任意進(jìn)制計(jì)數(shù)器的方法。1二、實(shí)驗(yàn)原理1、集成觸發(fā)器集成D觸發(fā)器74LS74是雙D觸發(fā)器器件，它的翻轉(zhuǎn)時(shí)刻是在CP的上升沿，管腳如圖D觸發(fā)器特征方程:Qn+1=DCP↑集成JK觸發(fā)器JK觸發(fā)器的特征方程：Qn+1=JQn+KQnCP↓22、74LS161四位二進(jìn)制同步計(jì)數(shù)器（異步清除）74LS161為帶預(yù)置功能的二進(jìn)制同步計(jì)數(shù)器，其功能表見表，外引線排列圖見圖,15腳為進(jìn)位輸出端。從功能表中可看到，當(dāng)Cr=0時(shí)，CP端無(wú)論有無(wú)脈沖，計(jì)數(shù)器立即清零，因此是異步清除。當(dāng)LD=0時(shí)，計(jì)數(shù)器隨著CP脈沖的到來(lái)被置數(shù)，屬同步置數(shù)。33、用74LS161構(gòu)成六進(jìn)制計(jì)數(shù)器

如用反饋清零法，則計(jì)數(shù)器如圖（a）所示連線，當(dāng)Q3Q2Q1Q0=0110時(shí)，通過(guò)反饋線強(qiáng)制計(jì)數(shù)器清零。由于0110狀態(tài)只是瞬時(shí)過(guò)渡狀態(tài)，因此，隨著CP脈沖的到來(lái)，計(jì)數(shù)器的狀態(tài)依次是0，1，2，3，4，5，0構(gòu)成六進(jìn)制計(jì)數(shù)器。圖（b）是用反饋置數(shù)法構(gòu)成的七進(jìn)制計(jì)數(shù)器，當(dāng)Q3Q2Q1Q0=0110時(shí)，LD=0，此時(shí)，計(jì)數(shù)器的輸出仍是0110，當(dāng)下一個(gè)即第7個(gè)CP脈沖到來(lái)時(shí)，計(jì)數(shù)器才被置數(shù)，Q3Q2Q1Q0=D3D2D1D0=0000，計(jì)數(shù)器輸出為0。4三、實(shí)驗(yàn)內(nèi)容用D觸發(fā)器（74LS74）設(shè)計(jì)一個(gè)三進(jìn)制同步加法計(jì)數(shù)器，結(jié)果用LED表示。2.用74LS161設(shè)計(jì)一個(gè)任意進(jìn)制計(jì)數(shù)器（1）用異步清零法實(shí)現(xiàn)6進(jìn)制計(jì)數(shù)器（2）用同步置數(shù)法實(shí)現(xiàn)8進(jìn)制計(jì)數(shù)器51、用D觸發(fā)器實(shí)現(xiàn)同步三進(jìn)制計(jì)數(shù)器D觸發(fā)器的激勵(lì)表：三進(jìn)制計(jì)數(shù)器的激勵(lì)表：由激勵(lì)表得特征方程：由特征方程畫出電路圖（略）或672、用161實(shí)現(xiàn)任何進(jìn)制：8實(shí)驗(yàn)報(bào)告要求⒈畫出用D觸發(fā)器組成的三進(jìn)制計(jì)數(shù)器的電路圖。2.畫出用兩種不同方法組成的6進(jìn)制、8進(jìn)制完整電路圖（包括分頻器）。3.用坐標(biāo)紙對(duì)應(yīng)時(shí)間軸，畫出6進(jìn)制計(jì)數(shù)器CP、Q0、Ql、Q2、Q3五個(gè)波形的波形圖，標(biāo)出周期，并比較它們的相位關(guān)系。4.說(shuō)明同步計(jì)數(shù)器和異步計(jì)數(shù)器的區(qū)別是什么？5.比較反饋同步置數(shù)法和異步清零法各自的優(yōu)缺點(diǎn)。6.總結(jié)時(shí)序電路的特點(diǎn)及使用體會(huì)。9注意事項(xiàng)⒈CP脈沖一般由函數(shù)發(fā)生器的TTL端輸出。⒉CC4511是CMOS件，不能把管腳懸空作為高電平處理，5腳為鎖存端，一定正確連接。10反相器:六非門

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74LS00外引線排列圖

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