第5-1章 圖形設(shè)計方法_第1頁
第5-1章 圖形設(shè)計方法_第2頁
第5-1章 圖形設(shè)計方法_第3頁
第5-1章 圖形設(shè)計方法_第4頁
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文檔簡介

EDA技術(shù)與VHDL第6章圖形設(shè)計方法

KX康芯科技6.1設(shè)計初步1.為本項工程設(shè)計建立文件夾

2.輸入設(shè)計項目和存盤

圖6-1元件輸入對話框

KX康芯科技6.1設(shè)計初步3.將設(shè)計項目設(shè)置成可調(diào)用的元件

圖6-2將所需元件全部調(diào)入原理圖編輯窗并連接好

6.1設(shè)計初步4.設(shè)計全加器頂層文件

圖6-3連接好的全加器原理圖f_adder.bdf6.1設(shè)計初步5.將設(shè)計項目設(shè)置成工程和時序仿真

圖6-4f_adder.bdf工程設(shè)置窗

6.1設(shè)計初步5.將設(shè)計項目設(shè)置成工程和時序仿真

圖6-5加入本工程所有文件

6.1設(shè)計初步5.將設(shè)計項目設(shè)置成工程和時序仿真

圖6-6全加器工程f_adder的仿真波形

6.2應(yīng)用宏模塊的原理圖設(shè)計6.2.1測頻計數(shù)器設(shè)計

圖6-7含有時鐘使能的兩位十進制計數(shù)器

6.2應(yīng)用宏模塊的原理圖設(shè)計6.2.1測頻計數(shù)器設(shè)計

圖6-8兩位十進制計數(shù)器工作波形

6.2應(yīng)用宏模塊的原理圖設(shè)計6.2.2頻率計主結(jié)構(gòu)電路設(shè)計

圖6-9兩位十進制頻率計頂層設(shè)計原理圖文件

6.2應(yīng)用宏模塊的原理圖設(shè)計6.2.2頻率計主結(jié)構(gòu)電路設(shè)計

圖6-10兩位十進制頻率計測頻仿真波形

6.2應(yīng)用宏模塊的原理圖設(shè)計6.2

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